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戶(hù)外屏

  • 0107、32x8 LED點陣屏電子鐘設(shè)計制作資料

    0107、32x8 LED點陣屏電子鐘設(shè)計制作資料

    標簽: 0107 32x8 LED 點陣屏

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • LED電子屏控制卡資料.part2

    LED電子屏控制卡資料.part2

    標簽: part LED 電子屏 控制卡

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • 0110、led大屏幕點陣屏設(shè)計資料

    0110、led大屏幕點陣屏設(shè)計資料

    標簽: 0110 led 大屏幕 點陣屏

    上傳時間: 2013-04-15

    上傳用戶:eeworm

  • 你的身體會說話.[(德)薇拉·弗·比爾肯比爾著.景麗屏譯][安徽人民出版社][2003][]

    你的身體會說話.[(德)薇拉·弗·比爾肯比爾著.景麗屏譯][安徽人民出版社][2003][]

    標簽: 2003 出版社

    上傳時間: 2013-06-11

    上傳用戶:eeworm

  • H橋驅(qū)動.rar

    H橋的一些資料,自己整理得,包括一些電路圖和pdf文檔資料

    標簽: H橋驅(qū)動

    上傳時間: 2013-04-24

    上傳用戶:banyou

  • 在點陣屏上繪圖——基于LCD12864.rar

    在點陣屏上繪圖——基于LCD12864,畫點、畫線、畫各種圖形界面的方法

    標簽: 12864 LCD 點陣屏

    上傳時間: 2013-04-24

    上傳用戶:uuuuuuu

  • 永磁同步發(fā)電機的電磁場分析.rar

    永磁同步發(fā)電機由于一系列高效節(jié)能的優(yōu)點,在工農(nóng)業(yè)生產(chǎn)、航空航天、國防和日常生活中得到廣泛應用,并且受到許多學者的關(guān)注,其研究領(lǐng)域主要涉及永磁同步發(fā)電機的設(shè)計、精確性能分析、控制等方面。 本課題作為國家自然科學基金項目《無刷無勵磁機諧波勵磁的混合勵磁永磁電機的研究》的課題,主要研究永磁電機的電磁場空載和負載計算,求出永磁電機的電壓波形和電壓調(diào)整率,為分段式轉(zhuǎn)子的混合勵磁永磁電機的研究奠定基礎(chǔ),主要做了以下工作: 首先介紹了永磁同步發(fā)電機的基本原理,包括永磁同步發(fā)電機的結(jié)構(gòu)形式和永磁同步發(fā)電機的運行性能,采用傳統(tǒng)解析理論給出了電壓調(diào)整率的計算方法及外特性的計算模型;然后用有限元ANSYS對永磁同步發(fā)電機樣機進行實體建模,經(jīng)過定義分配材料、劃分網(wǎng)格、加邊界條件和載荷、求解計算等,得到矢量磁位Az、磁場強度H、磁感應強度B等結(jié)果,直觀地看出電機內(nèi)部的磁場分布情況。 其次根據(jù)電磁場計算結(jié)果,應用齒磁通法對其進行后處理。該方法求解轉(zhuǎn)子在一個齒距內(nèi)不同位置處的磁場,以定子齒的磁通為計算單位,根據(jù)繞組與齒的匝鏈關(guān)系,計算出磁鏈隨時間的變化,進而得到永磁同步發(fā)電機空、負載時電壓大小及波形。通過計算結(jié)果寫實驗結(jié)果對比,驗證了齒磁通法的正確性,為計算永磁同步發(fā)電機各種性能特性提供有力工具。 最后,基于齒磁通法對永磁同步發(fā)電機的外特性進行了深入研究,定量分析了結(jié)構(gòu)參數(shù)對外特性的影響規(guī)律,提出了有效降低電壓調(diào)整率的方法的是:增加氣隙長度g的同時,適當增加永磁體的磁化方向的長度hm;此外,要盡量的減少每相串聯(lián)匝數(shù)N和增大導線面積以減小阻抗參數(shù)。通過改變電機的結(jié)構(gòu)參數(shù),對其電磁場進行計算,找到永磁電機電壓調(diào)整率的變化規(guī)律,為加電勵磁的混合勵磁永磁電機做準備,達到穩(wěn)定輸出電壓的目的。

    標簽: 永磁同步 發(fā)電機 磁場分析

    上傳時間: 2013-04-24

    上傳用戶:15853744528

  • UCOS_UCGUI_MDK_LPC2134的移植代碼.rar

    arm文件夾 內(nèi)放的是和LPC2134啟動有關(guān)的代碼 arm_pc 文件夾內(nèi)放的是 uc/os有關(guān)的代碼 Project_Data內(nèi)放的是項目有關(guān)的文件 BootLoader和LPC2134啟動有關(guān)的代碼 OS_SOURCE放的是UC/OS 2.52的源文件 UCGUI內(nèi)放的是UCGUI的源代碼(增加了我用的屏的驅(qū)動文件LCD12864L.C和LCD12864L.H) SourceInsight內(nèi)放的是SourceInsight有關(guān)的工程文件 MDK內(nèi)放的是MDK3.20有關(guān)的工程文件 MySource內(nèi)放的是硬件驅(qū)動代碼以及應用層代碼 用ZLG提供的UCOS基于MDK的模板移植的

    標簽: UCOS_UCGUI_MDK_LPC 2134 移植

    上傳時間: 2013-07-17

    上傳用戶:huangzchytems

  • 基于FPGA的H.264變換量化、去方塊濾波研究及設(shè)計.rar

    H.264/AVC是由國際電信聯(lián)合會的視頻專家組和國際標準化組織的運動圖像專家組組成的聯(lián)合視頻小組制定的下一代視頻壓縮標準。新標準采用了一些先進算法,因此具有優(yōu)異的壓縮性能和極好的網(wǎng)絡(luò)親和性,滿足低碼率情況下的高質(zhì)量視頻的傳輸。 H.264/AVC采用的先進算法包括多模式幀間預測、1/4像素精度預測、整數(shù)變換量化、去方塊濾波和熵編碼。本論文著重對整數(shù)變換與量化、去方塊濾波做了研究。整數(shù)變換是一種只有加法和移位的運算,量化可以通過查表和乘法操作就可以完成,避免了反變換的時候失配問題,沒有精度損失;去方塊濾波是一種用來去除低碼率情況下的每個宏塊的塊效應,提高了解碼圖像的外觀。 本文主要從算法研究和硬件實現(xiàn)兩方面著手,在算法研究方面設(shè)計了一個可視化測試軟件,在硬件實現(xiàn)方面主要對整數(shù)變換、量化和去方塊濾波做了研究和實現(xiàn)。視頻壓縮技術(shù)的關(guān)鍵在于視頻壓縮算法及其芯片的實現(xiàn),F(xiàn)PGA可重復使用,設(shè)計修改靈活,片內(nèi)資源豐富,具備DSP模塊等優(yōu)勢。在本論文的目標實現(xiàn)部分模塊FPGA的硬件設(shè)計,用Verilog完成了關(guān)鍵部分的設(shè)計。首先簡要介紹了視頻壓縮基本原理,常用視頻壓縮標準及其特性以及國內(nèi)外的研究動態(tài),并對H.264標準基本檔次所涉及的核心技術(shù)進行了詳細介紹,兩種分層結(jié)構(gòu)分別討論。其次在掌握了H.264.算法及編解碼流程的基礎(chǔ)上,設(shè)計了基于H.264編解碼的可視化軟件平臺。然后詳細介紹了整數(shù)變換、量化、反變換和反量化核心模塊的設(shè)計和實現(xiàn),并在Altera的軟件和開發(fā)板上進行了仿真驗證;對去方塊濾波算法做了軟件研究測試,并給出了一種改進的硬件整體結(jié)構(gòu)設(shè)計。最后,對全文工作進行了總結(jié)和對未來研究工作做了展望。我在課題中所做的主要工作有: 1.查閱相關(guān)文獻,熟悉H.264.標準及整數(shù)變換、量化和去方塊濾波等算法。 2.用VC++完成了基于H.264編解碼的可視化軟件平臺設(shè)計。 3.用Verilog完成了整數(shù)變換量化、反變換反量化模塊FPGA設(shè)計與驗證。 4.去方塊濾波器的算法研究、仿真和硬件整體結(jié)構(gòu)設(shè)計。

    標簽: FPGA 264 變換

    上傳時間: 2013-04-24

    上傳用戶:lanjisu111

  • H.264幀內(nèi)預測算法優(yōu)化及幾個重要模塊的FPGA實現(xiàn).rar

    H.264作為新一代視頻編碼標準,相比上一代視頻編碼標準MPEG2,在相同畫質(zhì)下,平均節(jié)約64﹪的碼流。該標準僅設(shè)定了碼流的語法結(jié)構(gòu)和解碼器結(jié)構(gòu),實現(xiàn)靈活性極大,其規(guī)定了三個檔次,每個檔次支持一組特定的編碼功能,并支持一類特定的應用,因此。H.264的編碼器的設(shè)計可以根據(jù)需求的不同而不同。 H.264雖然具有優(yōu)異的壓縮性能,但是其復雜度卻比一般編碼器高的多。本文對H.264進行了編碼復雜度分析,并統(tǒng)計了整個軟件編碼中計算量的分布。H.264中采用了率失真優(yōu)化算法,提高了幀內(nèi)預測編碼的效率。在該算法下進行幀內(nèi)預測時,為了得到一個宏塊的預測模式,需要進行592次率失真代價計算。因此為了降低幀內(nèi)預測模式選擇的計算復雜度,本文改進了幀內(nèi)預測模式選擇算法。實踐證明,在PSNR值的損失可以忽略不計的情況下,該算法相比原算法,幀內(nèi)編碼時間平均節(jié)約60﹪以上,對編碼的實時性有較大幫助。 為了實現(xiàn)實時編碼,考慮到FPGA的高效運算速度和使用靈活性,本文還研究了H.264編碼器基本檔次的FPGA實現(xiàn)。首先研究了H.264編碼器硬件實現(xiàn)架構(gòu),并對影響編碼速度,且具有硬件實現(xiàn)優(yōu)越性的幾個重要部分進行了算法研究和FPGA.實現(xiàn)。本文主要研究了H.264編碼器中整數(shù)DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數(shù)DCT變換等部分。分別對這些模塊進行了綜合和時序仿真,并將驗證后通過的系統(tǒng)模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中,進行了在線測試,驗證了該系統(tǒng)對輸入的殘差數(shù)據(jù)實時壓縮編碼的功能。 本文對H.264編碼器幀內(nèi)預測模式選擇算法的改進,算法實現(xiàn)簡單,對軟件編碼的實時性有很大幫助。本文對在單片F(xiàn)PGA上實現(xiàn)H.264編碼器做出了探索性嘗試,這對H.264編碼器芯片的設(shè)計有著積極的借鑒性。

    標簽: FPGA 264 幀內(nèi)預測

    上傳時間: 2013-06-13

    上傳用戶:夜月十二橋

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