在16MHZ頻率下速度為16MIPS的8位RISC結(jié)構(gòu)單片機，內(nèi)含硬件乘法器。 支持JTAG端口仿真和編程，仿真效果比傳統(tǒng)仿真同更真實有效。 8通道10位AD轉(zhuǎn)換器，支持單端和雙端差分信號輸入，內(nèi)帶增益可編程運算放大器。 16K字節(jié)的FLASH存貯器，支持ISP、IAP編程，使系統(tǒng)開發(fā)、生產(chǎn)、維護更容易。 多達1K字節(jié)的SRAM，32個通用寄存器，三個數(shù)據(jù)指針，使用C語言編程更容易。 512字節(jié)的EEPROM存貯器，可以在系統(tǒng)掉電時保存您的重要數(shù)據(jù)。 多達20個中斷源，每個中斷有獨立的中斷向量入口地址。 2個8位定時/計數(shù)器，1個16位定時/計數(shù)器，帶捕捉、比較功能，有四個通道的PWM。 硬件USART、SPI和基于字節(jié)處理的I2C接口。 杰出的電氣性能，超強的抗干擾能力。每個IO口可負載40mA的電流，總電流不超過200mA。 可選片內(nèi)/片外RC振蕩、石英/陶瓷晶振、外部時鐘，更具備實時時鐘（RTC）功能；片內(nèi)RC振蕩可達8MHZ，頻率可校調(diào)到1%精度；片外晶振振蕩幅度可調(diào)，以改善EMI性能。 內(nèi)置模擬量比較器。 可以用熔絲開啟、帶獨立振蕩器的看門狗，看門狗溢出時間分8級可調(diào)。 內(nèi)置上電復位電路和可編程低電壓檢測（BOD）復位電路。 六種睡眠模式，給你更低的功耗和更靈活的選擇。 ATMEGA16L工作電壓2.7V-5.5V，工作頻率0-8MHZ；ATMEGA16工作電壓4.5-5.5V，工作頻率0-16MHZ。 32個IO口，DIP40、TQFP44封裝。 與其它8位單片機相比，有更高的程序安全性，保護您的知識產(chǎn)權(quán)。
上傳時間： 2013-11-22
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摘要：在工業(yè)自動控制中，單片機與PLC的遠距離通信是一個難點與熱點問題。本文設計了S7-200PLC與PIC16F877單片機實現(xiàn)遠距離串行通信的硬件連接和軟件實現(xiàn)方法。本文采用了MAX485E芯片進行TTL電平與差分信號之間的轉(zhuǎn)換，使用RS-485端口和半雙工模式進行通信。最后通過異或校驗碼對接收到的數(shù)據(jù)進行核對，以進一步提高數(shù)據(jù)傳輸?shù)目煽啃浴嶒炞C明，該方法成功實現(xiàn)了單片機與PLC的遠距離通信，并且具有開發(fā)簡單，抗干擾能力強的特點，具有一定實用價值。關鍵詞：單片機 PLC 串行通信
上傳時間： 2014-12-27
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描述ATtiny15/L是一款基于AVRRISC的低功耗CMOS的8位單片機。通過在一個時鐘周期內(nèi)執(zhí)行一條指令，ATtiny15/L可以取得接近1MIPS/MHz的性能，從而使得設計人員可以在功耗和執(zhí)行速度之間取得平衡。AVR核將32個工作寄存器和豐富的指令集聯(lián)結(jié)在一起。所有的工作寄存器都與ALU算邏單元直接相連，允許在一個時鐘周期內(nèi)執(zhí)行的單條指令同時訪問兩個獨立的寄存器。這種結(jié)構(gòu)提高了代碼效率，使AVR得到了比普通CISC單片機高將近10倍的性能。ATtiny15/L具有4個單端及一個20倍增益的差分ADC通道。高速PWM輸出使得ATtiny15/L十分適合于電池充電器應用和電源調(diào)節(jié)電路。
上傳時間： 2014-12-27
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基于P87 C591的CAN總線系統(tǒng)智能節(jié)點設計Design of CAN System Intelligent Node Based on P87C591 給出了基于帶CAN控制器的單片8位微控制器P87C591的智能節(jié)點的硬件電路及軟件結(jié)構(gòu)，詳細介紹了設計中的難點及實現(xiàn)過程中應注意的問題。關鍵詞:CAN總線;智能節(jié)點 Abstract:A h ardc ircuita nds oftw arec onfigurationo fth ei ntelligentnode based on a microcontroller with CAN controller P87C591 arepresented.E speciallyt hec ruxi nd esigninga ndt hep roblemst hatshould be paid attention in realizing are discussed in details.Keyw ords:C AN;in telligentn ode CA N 總線 是德國Bosch從20世紀80年代初為解決現(xiàn)代汽車中眾多的控制與測試儀器之間的數(shù)據(jù)交換而開發(fā)的一種串行數(shù)據(jù)通信協(xié)議，它是一種多主總線，通信介質(zhì)可以是雙絞線、同軸電纜或光導纖維。由于CAN總線具有較強的糾錯能力，支持差分收發(fā)，因而適合高噪聲環(huán)境。并具有較遠的傳輸距離，適用于許多領域的分布式測控系統(tǒng)。目前已在工業(yè)自動化、建筑物環(huán)境控制、醫(yī)療設備等許多領域得到廣泛的應用。CAN已成為國際標準化組織IS011898標準。
標簽： P87C591 CAN 總線系統(tǒng) 智能節(jié)點
上傳時間： 2013-10-30
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陷波器是無限沖擊響應(IIR)數(shù)字濾波器，該濾波器可以用以下常系數(shù)線性差分方程表示：ΣΣ==−−−=MiNiiiinybinxany01)()()( (1)式中： x(n)和y(n)分別為輸人和輸出信號序列；和為濾波器系數(shù)。 iaib對式(1)兩邊進行z變換，得到數(shù)字濾波器的傳遞函數(shù)為： ΠΠΣΣ===−=−−−==NiiMiiNiiiMiiipzzzzbzazH1100)()()( (2)式中：和分別為傳遞函數(shù)的零點和極點。 izip由傳遞函數(shù)的零點和極點可以大致繪出頻率響應圖。在零點處，頻率響應出現(xiàn)極小值；在極點處，頻率響應出現(xiàn)極大值。因此可以根據(jù)所需頻率響應配置零點和極點，然后反向設計帶陷數(shù)字濾波器。考慮一種特殊情況，若零點在第1象限單位圓上，極點在單位圓內(nèi)靠近零點的徑向上。為了防止濾波器系數(shù)出現(xiàn)復數(shù)，必須在z平面第4象限對稱位置配置相應的共軛零點、共軛極點。 izip∗iz∗ip這樣零點、極點配置的濾波器稱為單一頻率陷波器，在頻率ωo處出現(xiàn)凹陷。而把極點設置在零的的徑向上距圓點的距離為l-μ處，陷波器的傳遞函數(shù)為： ))1()()1(())(()(2121zzzzzzzzzHμμ−−−−−−= (3)式(3)中μ越小，極點越靠近單位圓，則頻率響應曲線凹陷越深，凹陷的寬度也越窄。當需要消除窄帶干擾而不能對其他頻率有衰減時，陷波器是一種去除窄帶干擾的理想數(shù)字濾波器。當要對幾個頻率同時進行帶陷濾波時，可以按(2)式把幾個單獨頻率的帶陷濾波器(3)式串接在一起。一個例子：設有一個輸入，它
上傳時間： 2013-10-18
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為了在CDMA系統(tǒng)中更好地應用QDPSK數(shù)字調(diào)制方式，在分析四相相對移相（QDPSK)信號調(diào)制解調(diào)原理的基礎上，設計了一種QDPSK調(diào)制解調(diào)電路，它包括串并轉(zhuǎn)換、差分編碼、四相載波產(chǎn)生和選相、相干解調(diào)、差分譯碼和并串轉(zhuǎn)換電路。在MAX+PLUSⅡ軟件平臺上，進行了編譯和波形仿真。綜合后下載到復雜可編程邏輯器件EPM7128SLC84-15中，測試結(jié)果表明，調(diào)制電路能正確選相，解調(diào)電路輸出數(shù)據(jù)與QDPSK調(diào)制輸入數(shù)據(jù)完全一致，達到了預期的設計要求。 Abstract: In order to realize the better application of digital modulation mode QDPSK in the CDMA system， a sort of QDPSK modulation-demodulation circuit was designed based on the analysis of QDPSK signal modulation-demodulation principles. It included serial/parallel conversion circuit, differential encoding circuit, four-phase carrier wave produced and phase chosen circuit, coherent demodulation circuit, difference decoding circuit and parallel/serial conversion circuit. And it was compiled and simulated on the MAX+PLUSⅡ software platform,and downloaded into the CPLD of EPM7128SLC84-15.The test result shows that the modulation circuit can exactly choose the phase，and the output data of the demodulator circuit is the same as the input data of the QDPSK modulate. The circuit achieves the prospective requirement of the design.
標簽： QDPSK CPLD 調(diào)制解調(diào) 電路設計
上傳時間： 2014-01-13
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基于Message-Passing Interface （ MPI）的編程環(huán)境，以PML （Perfectly Matched Layer）為吸收邊界條件，討論了時域有限差分法FDTD的三維并行運算情況。通過一定的數(shù)值計算，定量地給出了MPI下FDTD并行算法中的網(wǎng)格數(shù)、進程數(shù)、分割方式三者之間的關系以及對計算效率的影響。
上傳時間： 2013-11-05
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利用天寶GPS差分測量步驟及詳細介紹
上傳時間： 2014-12-29
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作者RICHARD CHI-HSI LI，結(jié)合自己20年RF設計經(jīng)驗，整理的RF設計技術與經(jīng)驗，工程性很強，從最基本的LNA、MIXERS、差分對等講起，涉及到阻抗匹配，接地，天線設計，RF系統(tǒng)分析，是一本很不錯的書。英文版
上傳時間： 2013-10-30
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根據(jù)MSK信號的特點，分析了直擴MSK信號的解調(diào)方法。基于兩種可能的應用形式，在Matlab/Simulink環(huán)境下搭建了直擴MSK信號差分相干解調(diào)與包絡非相干解調(diào)的仿真模型。然后進行了性能仿真。所得結(jié)論為直擴MSK信號解調(diào)的實際應用提供了參考。
上傳時間： 2013-11-13
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