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將來(lái)自不同系統(tǒng)的信息集成到一個(gè)解決方案中。

  • :樸素貝葉斯分類器是一種簡單而高效的分類器

    :樸素貝葉斯分類器是一種簡單而高效的分類器,但是它的屬性獨立性假設使其無法表示現實世界屬性之間的依賴關 系,以及它的被動學習策略,影響了它的分類性能。本文從不同的角度出發,討論并分析了三種改進樸素貝葉斯分類 性能的方法。為進一步的研究打下堅實的基礎。

    標簽: 分類器 貝葉斯

    上傳時間: 2017-08-18

    上傳用戶:cazjing

  • 在編寫管理信統軟件中,您是否對于繁瑣的多用戶權限管理而頭痛?需要對不同的用戶設置不同的權限,需要添加/刪除用戶,并進行相應的管理.您是否對這些功能感到厭煩? 現在,RGP(Red Glove Perm

    在編寫管理信統軟件中,您是否對于繁瑣的多用戶權限管理而頭痛?需要對不同的用戶設置不同的權限,需要添加/刪除用戶,并進行相應的管理.您是否對這些功能感到厭煩? 現在,RGP(Red Glove Permission)權限管理系統能給您解決一切問題! RGP權限管理系統是由Nick.Yan開發的一套簡單的RGP權限管理系統,完全開源,免費使用,節省了程序員編寫相關代碼的大量時間和精力.該模塊體積小,加載迅速,性能穩定,信息加密強度高,適合于中小型管理軟件的用戶權限管理. 使用本模塊,您只需要集中精力在您自己的程序中,程序完成后把僅僅需要添加少量代碼,即可把本模塊無縫集成到您的程序中,能夠穩定保密的對您自己的用戶進行完全控制,非常適合各類軟件開發人員使用,如果把系統中繁雜的權限設計部分去掉,你會擁有更多的精力去完善您獨特的設計,讓您的開發更快捷、更高效、更靈活 主要實現在了分組權限,角色權限以及個人權限的管理功能,該系統從2008年的11月發布,當時完成了多語言,多皮膚,支持多數據庫的功能,從發布到至今已經經歷了將近五個月的時間,得到很多朋友的支持與關注,從中了解到了更多人的需求,暫時去掉了次要的部分完善了主要的功能

    標簽: Glove Perm RGP Red

    上傳時間: 2013-12-29

    上傳用戶:sdq_123

  • 1) 基礎核心功能的開發 基礎核心層自定義功能的開發將作為這一階段主體開發部分

    1) 基礎核心功能的開發 基礎核心層自定義功能的開發將作為這一階段主體開發部分,也是第一階段所需要完成的項目版本所包含的主要功能,預計在明年初1月28日前完成此版本的初步開發。這個版本預計是可以作為獨立運行的,并具有一定的實用功能可以給客戶使用的版本。另外在可控時間范圍內,適當的基礎的業務系統開發將被納入這一階段開發考慮中。

    標簽: 核心 自定義

    上傳時間: 2013-12-30

    上傳用戶:sevenbestfei

  • 產生高斯白噪聲并估計自相關序列

    產生高斯白噪聲并估計自相關序列,有幫助的可以看看

    標簽: 高斯白噪聲 序列

    上傳時間: 2014-10-30

    上傳用戶:weixiao99

  • 自認為比較好的按鍵處理程序 自認為比較好的按鍵處理程序 在中斷內檢測

    自認為比較好的按鍵處理程序 自認為比較好的按鍵處理程序 在中斷內檢測,主程序中處理

    標簽: 比較 按鍵 處理程序 中斷

    上傳時間: 2014-09-02

    上傳用戶:luopoguixiong

  • 自適應軟頻率復用

    在LTE系統中采用自適應軟頻率復用的方法,有效的提高了邊緣區域的SINR以及整體的性能。

    標簽: 頻率借用 soft 自適應

    上傳時間: 2015-11-23

    上傳用戶:wang1234

  • CCS環境兩次編程實現DSP串行EEPROM自舉的方法

    針對TI公司TMS320VC54系列DSP處理器獨立運行需要程序自舉引導的問題,介紹了一種利用CCS軟件兩次編程實現DSP通過SPI串行EEPROM完成程序代碼自舉的方法,給出了相應的硬件設計和軟件編程思路,及以該方法實現DSP自舉的實驗。該方法硬件設計簡單、成本低,而軟件兩次編程設計又方便DSP系統的在線編程調試和軟件升級,可廣泛用于程序代碼不超過64K字節的DSP系統中。 

    標簽: SP 自舉 串行EEPROM SPI

    上傳時間: 2015-12-31

    上傳用戶:icebee251

  • 感應電機轉子磁鏈自適應觀測及參數辨識

    為了在現代異步電機高性能調速系統中實現磁鏈的準確觀測,提出了一種基于模型參考方法的自適應轉子磁鏈觀測器.在電機運行過程中,以電機為參考模型,以觀測方程為可調系統,建立了一個模型參考自適應系統(MRAS),對電機的轉子磁鏈進行了實時觀測,并對電機參數進行了在線辨識.設計了電機參數的自適應律,證明了磁鏈觀測器的收斂性.仿真結果表明,當電機參數未知或者電機參數變化時,觀測器能夠準確觀測電機的轉子磁鏈;在電機的激勵電壓滿足持續激勵的條件下,觀測器能夠快速準確地辨識出電機參數. 

    標簽: 感應電機 模型參考自適應系統 狀態觀測器 持續激勵 參數辨識

    上傳時間: 2016-01-01

    上傳用戶:icebee251

  • struct

    幫助學習作業系統的 一些資料   我需要獲得3的 積分  請有興趣者可看

    標簽: struct

    上傳時間: 2016-06-14

    上傳用戶:fp4397251

  • 基于FPGA的viterbi設計及Verilog代碼

    viterbi譯碼算法是一種卷積碼的解碼算法。優點不說了。缺點就是隨著約束長度的增加算法的復雜度增加很快。約束長度N為7時要比較的路徑就有64條,為8時路徑變為128條。 (2<<(N-1))。所以viterbi譯碼一般應用在約束長度小于10的場合中。 先說編碼(舉例約束長度為7):編碼器7個延遲器的狀態(0,1)組成了整個編碼器的64個狀態。每個狀態在編碼器輸入0或1時,會跳轉到另一個之中。比如110100輸入1時,變成101001(其實就是移位寄存器)。并且輸出也是隨之而改變的。 這樣解碼的過程就是逆過程。算法規定t時刻收到的數據都要進行64次比較,就是64個狀態每條路有兩條分支(因為輸入0或1),同時,跳傳到不同的兩個狀態中去,將兩條相應的輸出和實際接收到的輸出比較,量度值大的拋棄(也就是比較結果相差大的),留下來的就叫做幸存路徑,將幸存路徑加上上一時刻幸存路徑的量度然后保存,這樣64條幸存路徑就增加了一步。在譯碼結束的時候,從64條幸存路徑中選出一條量度最小的,反推出這條幸存路徑(叫做回溯),得出相應的譯碼輸出。

    標簽: viterbi Verilog FPGA 代碼

    上傳時間: 2016-08-08

    上傳用戶:June

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