ALLEGRO15.X學習與的用(下)
標簽: ALLEGRO 15
上傳時間: 2013-06-28
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全面模仿AVR的UART功能,與AVR直接實現(xiàn)接口調(diào)試。資料全面完整。
標簽: UART AVR 模
上傳時間: 2013-08-05
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基于FPGA CPLD設計與實現(xiàn)UART,一聽名字就知道,不用再說了吧,
標簽: FPGA CPLD UART
上傳時間: 2013-08-09
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用FPGA器件實現(xiàn)UART核心功能的一種方法.doc
標簽: FPGA UART 器件 核心
上傳時間: 2013-08-14
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用fpga設計uart的案例,word格式
標簽: fpga uart 案例
上傳時間: 2013-08-15
上傳用戶:zhangxin
FPGA的uart控制器的verilog源程序,在cyclone II EP2C8Q208上調(diào)試運行成功
標簽: verilog FPGA uart 控制器
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5分鐘學會使用CPLD,經(jīng)典資料,有想學習CPLD的朋友有福了
標簽: CPLD 分
上傳時間: 2013-08-22
上傳用戶:xmsmh
一個UART的FPGA core,附有詳細的代碼閱讀筆記
標簽: UART FPGA core
上傳時間: 2013-08-24
上傳用戶:stella2015
用VHDl設計UART的文章,使用QuartusII平臺
標簽: VHDl UART
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基于FPGA的串行通信UART控制器,采用VHDL語言編寫,包含多個子模塊。\r\n在ISE或FPGA的其它開發(fā)環(huán)境下新建一個工程,然后將文檔中的各個模塊程序添加進去,即可運行仿真。源程序已經(jīng)過本人的仿真驗證。
標簽: FPGA UART 串行通信 控制器
上傳時間: 2013-09-03
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