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基本流程

  • 基于Xilinx公司的SOPC的以太網設計

      1.設計(論文)的主要任務及目標   (1) 研究SOPC理論如何應用于以太網終端設計;   (2) 研究如何使用EDK軟件和IP核搭建整個設計硬件結構;   (3) 在開發板上實現以太網終端設計,驗證整個結論。   2.設計(論文)的基本要求和內容   (1) 符合以太網設計的基本概念和原理;   (2) 能準確運用EDK軟件在嵌入式系統設計中的優勢;   (3) 選取合適的對象,并構造合理的以太網模型。 圖 Xilinx的SOPC設計流程

    標簽: Xilinx SOPC 以太網

    上傳時間: 2013-12-20

    上傳用戶:qwer0574

  • ISE13設計流程詳解

    ISE13[1].1_設計流程詳解

    標簽: ISE 13 設計流程

    上傳時間: 2015-01-01

    上傳用戶:kbnswdifs

  • FPGA設計中的基本問題

    第6章 FPGA設計中的基本問題

    標簽: FPGA

    上傳時間: 2014-12-04

    上傳用戶:shfanqiwei

  • PCB布局布線基本規則

    介紹了PCB布局布線的基本規則及注意事項,值得一看

    標簽: PCB 布局布線 基本規則

    上傳時間: 2013-12-22

    上傳用戶:summery

  • Time Quest筆記-FPGA的開發流程

    本文詳細介紹了有關FPGA的開發流程,對初學者會有很大的指導作用。

    標簽: Quest Time FPGA 開發流程

    上傳時間: 2013-11-12

    上傳用戶:lps11188

  • PCB做板流程

    PCB做板流程

    標簽: PCB 流程

    上傳時間: 2014-01-19

    上傳用戶:yuanyuan123

  • 可編輯程邏輯及IC開發領域的EDA工具介紹

    EDA (Electronic Design Automation)即“電子設計自動化”,是指以計算機為工作平臺,以EDA軟件為開發環境,以硬件描述語言為設計語言,以可編程器件PLD為實驗載體(包括CPLD、FPGA、EPLD等),以集成電路芯片為目標器件的電子產品自動化設計過程。“工欲善其事,必先利其器”,因此,EDA工具在電子系統設計中所占的份量越來越高。下面就介紹一些目前較為流行的EDA工具軟件。 PLD 及IC設計開發領域的EDA工具,一般至少要包含仿真器(Simulator)、綜合器(Synthesizer)和配置器(Place and Routing, P&R)等幾個特殊的軟件包中的一個或多個,因此這一領域的EDA工具就不包括Protel、PSpice、Ewb等原理圖和PCB板設計及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法:一種是按公司類別進行分類,另一種是按功能進行劃分。 若按公司類別分,大體可分兩類:一類是EDA 專業軟件公司,業內最著名的三家公司是Cadence、Synopsys和Mentor Graphics;另一類是PLD器件廠商為了銷售其產品而開發的EDA工具,較著名的公司有Altera、Xilinx、lattice等。前者獨立于半導體器件廠商,具有良好的標準化和兼容性,適合于學術研究單位使用,但系統復雜、難于掌握且價格昂貴;后者能針對自己器件的工藝特點作出優化設計,提高資源利用率,降低功耗,改善性能,比較適合產品開發單位使用。 若按功能分,大體可以分為以下三類。 (1) 集成的PLD/FPGA開發環境 由半導體公司提供,基本上可以完成從設計輸入(原理圖或HDL)→仿真→綜合→布線→下載到器件等囊括所有PLD開發流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ,Xilinx公司的ISE,Lattice公司的 ispDesignExpert等。其優勢是功能全集成化,可以加快動態調試,縮短開發周期;缺點是在綜合和仿真環節與專業的軟件相比,都不是非常優秀的。 (2) 綜合類 這類軟件的功能是對設計輸入進行邏輯分析、綜合和優化,將硬件描述語句(通常是系統級的行為描述語句)翻譯成最基本的與或非門的連接關系(網表),導出給PLD/FPGA廠家的軟件進行布局和布線。為了優化結果,在進行較復雜的設計時,基本上都使用這些專業的邏輯綜合軟件,而不采用廠家提供的集成PLD/FPGA開發工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類 這類軟件的功能是對設計進行模擬仿真,包括布局布線(P&R)前的“功能仿真”(也叫“前仿真”)和P&R后的包含了門延時、線延時等的“時序仿真”(也叫“后仿真”)。復雜一些的設計,一般需要使用這些專業的仿真軟件。因為同樣的設計輸入,專業軟件的仿真速度比集成環境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim,Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。 以上介紹了一些具代表性的EDA 工具軟件。它們在性能上各有所長,有的綜合優化能力突出,有的仿真模擬功能強,好在多數工具能相互兼容,具有互操作性。比如Altera公司的 QuartusII集成開發工具,就支持多種第三方的EDA軟件,用戶可以在QuartusII軟件中通過設置直接調用Modelsim和 Synplify進行仿真和綜合。 如果設計的硬件系統不是很大,對綜合和仿真的要求不是很高,那么可以在一個集成的開發環境中完成整個設計流程。如果要進行復雜系統的設計,則常規的方法是多種EDA工具協調工作,集各家之所長來完成設計流程。

    標簽: EDA 編輯 邏輯

    上傳時間: 2013-10-11

    上傳用戶:1079836864

  • 用veriloghdl進行fpga設計的一些基本方法

    veriloghdl進行fpga設計的一些基本方法,對初學者很有幫助

    標簽: veriloghdl fpga

    上傳時間: 2013-10-19

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  • Allegro后仿真流程介紹

    Allegro后仿真流程介紹

    標簽: Allegro 仿真流程

    上傳時間: 2013-11-19

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  • Alter FPGA的設計流程以及DSP設計

    Alter FPGA的設計流程以及DSP設計.

    標簽: Alter FPGA DSP 設計流程

    上傳時間: 2013-11-07

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