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四軸飛行器

  • 串行數據轉換器接口

    串行數據轉換器接口,你需要的資源,你指的用歐

    標簽: 串行數據 轉換器接口

    上傳時間: 2016-05-19

    上傳用戶:胡文俊12

  • 四路20秒聲光顯示計分搶答器Multisim14仿真源文件+設計文檔資料

    四路20秒聲光顯示計分搶答器Multisim14仿真源文件+設計文檔資料摘要數字搶答器由主體電路與擴展電路組成。優先編碼電路、鎖存器、譯碼電路將參賽隊的輸入信號在顯示器上輸出;用控制電路和主持人開關啟動報警電路,以上兩部分組成主體電路。通過定時電路和譯碼電路將秒脈沖產生的信號在顯示器上輸出實現計時功能,構成擴展電路。經過布線、焊接、調試等工作后數字搶答器成形。關鍵字:開關陣列電路;觸發鎖存電路;解鎖電路;編碼電路;顯示電路一,設計目的本設計是利用已學過的數電知識,設計的4人搶答器。(1)重溫自己已學過的數電知識;(2)掌握數字集成電路的設計方法和原理;(3)通過完成該設計任務掌握實際問題的邏輯分析,學會對實際問題進行邏輯狀態分配、化簡;(4)掌握數字電路各部分電路與總體電路的設計、調試、模擬仿真方法。二,整體設計(一)設計任務與要求:1.搶答器同時供4名選手或4個代表隊比賽,分別用4個按鈕S0 ~ S3表示。2.設置一個系統清除和搶答控制開關S,該開關由主持人控制。3.搶答器具有鎖存與顯示功能。即選手按動按鈕,鎖存相應的編號,并在LED數碼管上顯示,同時揚聲器發出報警聲響提示。選手搶答實行優先鎖存,優先搶答選手的編號一直保持到主持人將系統清除為止。4.參賽選手在設定的時間內進行搶答,搶答有效,定時器停止工作,顯示器上顯示選手的編號和搶答的時間,并保持到主持人將系統清除為止。5.如果定時時間已到,無人搶答,本次搶答無效。(二)設計原理與參考電路搶答器的組成框圖搶答器的一般組成框圖如下圖所示。它主要由開關陣列電路、觸發鎖存電路、解鎖電路、編碼電路和顯示電路等幾部分組成。 

    標簽: 聲光顯示 搶答器 multisim

    上傳時間: 2021-11-06

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  • 基于74LS148+74LS279+74LS48設計的四路搶答器電路Multisim仿真源文件

    基于74LS148+74LS279+74LS48設計的四路搶答器電路Multisim仿真源文件,Multisim10以上版本可打開運行,可以做為你的學習設計參考。

    標簽: 74ls148 74ls279 74ls48 搶答器 multisim

    上傳時間: 2021-11-07

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  • 倒計時計數計時器數字頻率計四位數密碼鎖 4位搶答器數字鐘簡易電子琴等Multisim仿真實例30個合

    倒計時計數計時器數字頻率計四位數密碼鎖 4位搶答器數字鐘簡易電子琴等Multisim仿真實例30個合集

    標簽: 密碼鎖

    上傳時間: 2021-12-11

    上傳用戶:kent

  • LTC2756 18位乘法串行輸入電流輸出數模轉換器DAC模塊ALTIUM原理圖+PCB文件

    LTC2756 18位乘法串行輸入電流輸出數模轉換器DAC模塊ALTIUM原理圖+PCB文件,硬件4層板設計,大小為66mmx39mm,ALTIUM設計的工程文件,包括完整的原理圖和PCB文件,可以做為你的設計參考。 原理圖器件列表: Library Component Count : 14 Name                Description ---------------------------------------------------------------------------------------------------- AD8397ARDZ          Imported Capacitor           CAP.,1uF,X74,10V,10%,1206 Header 10X1 2.54 Header, 100mil, 2x1_1Header, 100mil, 2x1, Tin plated, TH Header, 100mil, 3x1 Header, 100mil, 3x1, Tin plated, TH KJDZ-2              快接端子 LT1012              LT1012 LT1360              LT1360 LTC2054_1           LTC2054 LTC2756AIG          LTC2756AIG LTC6244             Imported LTC6655             LTC6655 Resistor            RES.,1K OHMS,5%,1/16W,0603 SMA-KE              CONNECTOR, SHEILDED, END LAUNCH JACK, GOLD PLATED, FOR 0.062 PCB, EDGE MOUNTED

    標簽: 數模轉換器

    上傳時間: 2021-12-22

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  • ST188光耦隔離+LM339四路比較器電路 Altium設計 硬件原理圖+PCB文件

    ST188光耦隔離+LM339四路比較器電路 Altium設計 硬件原理圖+PCB文件

    標簽: st188 光耦隔離 lm339

    上傳時間: 2022-04-06

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  • 基于CAN總線的變電站測控系統設計.rar

    變電站是電力系統的一個重要環節,它的運行情況直接影響到電力系統的可靠、經濟運行。一個變電站運行情況的優劣,在很大程度上取決于其二次設備的工作性能。現在的變電站有三種運行模式:一種是常規變電站,一種是部分實現微機管理、具有一定自動化水平的變電站,再有一種是實現無人值班、全面微機化的綜合自動化變電站。在常規變電站中,其繼電保護、中央信號系統、變送器、遠動及故障錄波裝置等所有二次設備都是采用傳統的分立式設備,而且站內配備大量控制、保護、記錄用屏盤。使裝備設置復雜,占地面積大,日常維護管理工作繁重。這種常規變電站的一個致命弱點是不具備自診斷能力,對二次系統本身的故障無法監測。因此,這種常規變電站已逐漸被淘汰。 要提高變電站運行的可靠性及經濟性,一個最有效的方法就是提高變電站運行管理的自動化水平,實現變電站的綜合自動化,以微機化的新型二次設備取代傳統使用的分立式設備。開發集保護、控制、監測及遠動等功能為一體的新型設備,并實現設備共享、信息資源共享,使變電站設計簡捷、布局緊湊,運行更加可靠安全。 隨著微型計算機技術、集成電路技術的迅速發展,原來越多的新技術和新產品應用到變電站的二次設備中去,使變電站的二次設備得到不斷的更新換代。該項研究把一種新型的低壓電能量測量芯片與高性能的數字信號處理器(DSP)結合起來,利用DSP體積小、功能強、功耗低、速度快、性價比高等優點,設計出新型的變電站線路測控單元,實現對高壓線路的測量、監視和控制,這種新型的二次設備比傳統的二次設備具有更高的精度和更快的相應速度。 與此同時,網絡理論和技術的發展,也使變電站監控系統的結構發生了很大的變化,由原來的集中控制型逐步過渡到功能分散、模塊化的分散網絡型,通過現場總線,使主控室和現場之間的聯系變成了串行通信聯系,從而提高的系統的可靠性和可維護性。CAN總線應用于變電站的監控系統中,組成變電站的數據通信網絡,可以提高系統的抗干擾能力和容錯能力。 該文就以上的兩個方面進行研究和設計,主要內容包括:一是在簡單介紹新型電能測量芯片和DSP的基本知識的基礎上,提出了一個變電站測控單元的設計方案,并從從硬件和軟件兩個方面進行了詳細的介紹,主要部分是對測量模塊的設計;二是系統的通信接口模塊設計,從硬件和軟件方面詳細的介紹了通信模塊的三種不同的通信接口的設計,分別是RS-232串行通信、RS-485總線通信、CAN總線通信;三是在分析現代測控系統發展歷史,指出了現場總線測控系統的優越性;四是設計出的測控系統單元的基礎上,利用CAN現場總線構建變電站的綜合監控系統。 該文提出的方案、技術以及結論對于變電站監控系統和自綜合動化系統的研究開發、工程設計都具有實際的參考意義。

    標簽: CAN 總線 變電站

    上傳時間: 2013-04-24

    上傳用戶:fhzm5658

  • 級聯多電平變頻器測控系統的設計.rar

    多電平逆變器中每個功率器件承受的電壓相對較低,因此可以用低耐壓功率器件實現高壓大容量逆變器,且采用多電平變換技術可以顯著提高逆變器輸出電壓的質量指標。因此,隨著功率器件的不斷發展,采用多電平變換技術將成為實現高壓大容量逆變器的重要途徑和方法。本文選取其中一種極具優勢的多電平拓撲結構一級聯多電平變頻器作為研究對象,完成了其拓撲結構、控制策略及測控系統的設計。 @@ 首先,對多電平變頻器的研究意義,國內外現狀進行了分析,比較了三種成熟拓撲結構的特點,得出了級聯型多電平變頻器的優點,從而將其作為研究對象。對比分析了四種調制策略,確定載波移相二重化的調制方法和恒壓頻比的控制策略,進行數學分析和理論仿真,得出了選擇的正確性及可行性。并指出了級聯單元個數與載波移相角的關系和調制比對輸出電壓的影響;完成了級聯變頻器數學模型的建立和死區效應的分析。 @@ 其次,完成了相關硬件的設計,包括DSP、CPLD、IPM的選型,系統電源的設計、檢測(轉速、電流、電壓、故障)電路的設計、通信電路的設計等。用Labwindows/CVI實現了上位機界面的編寫,實現了開關機、設定轉速、通信配置、電壓電流轉速檢測、電流軟件濾波、諧波分析。編寫了下位機DSP的串口通信、AD轉換、轉速檢測(QEP)以及部分控制程序。 @@ 最后,在實驗臺上完成硬件和軟件的調試,成功的實現了變頻器載波移相SPWM的多電平輸出,并驅動異步電機進行了空載變頻試驗,測控界面能準確的與下位機進行通信,快捷的給定各種控制命令,并能實時的顯示變頻器的輸出頻率、輸出電壓和輸出電流,為實驗調試增加了方便性,提高了工作效率。 @@關鍵詞:級聯多電平逆變器;載波移相;IPM;DSP;Labwindows/CVI;測控界面

    標簽: 級聯 電平變頻器 測控系統

    上傳時間: 2013-04-24

    上傳用戶:米卡

  • 帶諧波抑制功能的分布式發電并網逆變器的研究.rar

    隨著“節能環保”概念的提出,以解決電力緊張,環境污染等問題為目的的新能源利用方案得到迅速的推廣,使得分布式發電備受關注,即將成為世界各國重要的發電形式。帶有分布式電源的配電網及電力電子裝置的大量應用致使電能質量下降,如何將分布式發電系統的能量回饋至電網的同時有效改善電能質量是一個重要的問題,因此在分布式發電系統中起電能變換作用的逆變器成為研究的一個熱點。本篇主要以電壓型并網逆變器為研究對象,對并網逆變器的拓撲結構、控制策略、參數的選擇、并網實驗等方面作出了詳細的分析和研究。 首先根據帶有分布式發電的配電網的特點提出一種新的諧波治理思路,即將改善電能質量的有源濾波技術結合到分布式逆變電源中,設計一種新型的多功能并網逆變器。用開關函數法建立了并網逆變器小信號數學模型,確定了以PI閉環調節為核心的復合控制策略,同時為了使輸出電流控制達到更好的效果,采用電網電壓前饋補償方法抵消電網電壓擾動對并網電流的影響;基于瞬時無功功率的id-iq諧波電流檢測算法能精確檢測和分離所需要的有功和諧波分量;基于DSP的軟件鎖相控制算法能實現并網電流與電網電壓同頻同相。 其次對并網逆變器控制系統的軟硬件進行了分塊設計:對逆變系統的A/D轉換電路、逆變驅動電路、PWM信號發生電路等電路進行了詳細地分析和說明。利用DSP主控芯片TMS320LF2407A內部的SCI異步串行通信接口實現了逆變器的人機交互功能,利用其內嵌的CAN控制模塊實現了逆變器的并機通信功能;同時在TI DSP2000的運行環境下給出控制系統的主程序和周期中斷子程序流程。 最后開發了以功率器件IPM構成的三相PWM變流橋主電路的多功能逆變電源實驗平臺和相關配套輔助電路,完成了逆變電源的輸出有功功率及消除諧波的實驗并給出了裝置樣機的實物圖以及實驗波形圖。驗證了逆變器工作原理分析的正確性和系統設計思路的可行性。 本文所做工作拓寬了帶有分布式發電的配電網諧波治理的思路,對推動我國節能供電、新能源的利用以及改善電網電能質量等方面具有一定的理論意義和較強的實用價值。

    標簽: 諧波抑制 分布式發電 并網逆變器

    上傳時間: 2013-06-06

    上傳用戶:amandacool

  • 基于FPGA的通用異步收發器的設計.rar

    通用異步收發器(Universal Asynchronous Receiver Transmitter,UART)是一種能同時支持短距離和長距離數據傳輸的串行通信接口,被廣泛應用于微機和外設之間的數據交換。像8251、NS8250、NS16550等都是常用的UART芯片,但是這些專用的串行接口芯片的缺點是數據傳輸速率比較慢,難以滿足高速率數據傳輸的場合,而更重要的就是它們都具有不可移植性,因此要利用這些芯片來實現PC機和FPGA芯片之間的通信,勢必會增加接口連線的復雜程度以及降低整個系統的穩定性和有效性。 本課題就是針對UART的特點以及FPGA設計具有可移植性的優勢,提出了一種基于FPGA芯片的嵌入式UART設計方法,其中主要包括狀態機的描述形式以及自頂向下的設計方法,利用硬件描述語言來編制UART的各個子功能模塊以及頂層模塊,之后將其集成到FPGA芯片的內部,這樣不僅能解決傳統UART芯片的缺點而且同時也使整個系統變得更加具有緊湊性以及可靠性。 本課題所設計的LIART支持標準的RS-232C傳輸協議,主要設計有發送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個獨立的數據緩沖區FIFO模塊。該模塊具有可變的波特率、數據幀長度以及奇偶校驗方式,還有多種中斷源、中斷優先級、較強的抗干擾數據接收能力以及芯片內部自診斷的能力,模塊內分開的接收和發送數據緩沖寄存器能實現全雙工通信。除此之外最重要的是利用IP模塊復用技術設計數據緩沖區FIFO,采用兩種可選擇的數據緩沖模式。這樣既可以應用于高速的數據傳輸環境,也能適合低速的數據傳輸場合,因此可以達到資源利用的最大化。 在具體的設計過程中,利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發環境中對各個功能模塊進行綜合優化、仿真驗證以及下載實現。各項數據結果表明,本課題中所設計的UART滿足預期設計目標。

    標簽: FPGA 異步收發器

    上傳時間: 2013-08-02

    上傳用戶:rocketrevenge

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