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加法器

加法器是產生數的和的裝置。加數和被加數為輸入，和數與進位為輸出的裝置為半加器。若加數、被加數與低位的進位數為輸入，而和數與進位為輸出則為全加器。常用作計算機算術邏輯部件，執行邏輯操作、移位與指令調用。在電子學中，加法器是一種數位電路，其可進行數字的加法計算。三碼，主要的加法器是以二進制作運算。由于負數可用二的補數來表示，所以加減器也就不那么必要。

一元稀疏多項式計算器。實現稀疏多項式的加法和減法。

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一元稀疏多項式計算器[加法和乘法] 問題描述：設計一元系數多項式計數器實現兩個多項式間的加法、減法。基本要求：（1）輸入并建立多項式（2）輸出多項式

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8位相加乘法器

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使用ADI方法解偏微分方程（二微加熱器方程）

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VHDL中IP核之參數化加減法器中文使用介紹

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十進制加法計數器.VHDL程序,可在Quratus 2中運行

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三元組表示的稀疏矩陣的加法,減法,乘法運算器

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帶有異步復位和同步時鐘的十進制加法計數器

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8*8乘法器及其測試：采用booth編碼的乘法器：1． ultipler_quick_add_4 即4位的并行全加器

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移位相加8位硬件乘法器電路設計乘法器是數字系統中的基本邏輯器件

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