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分組密碼,代數(shù)故障分析,LED

  • 智能LED燈照明設(shè)計,RF遙控器調(diào)光,恒流控制(原理圖、源代碼、設(shè)計報告)

    智能LED燈照明設(shè)計,RF遙控器調(diào)光,恒流控制(原理圖、源代碼、設(shè)計報告)

    標簽: 智能 led照明 rf遙控器 原理圖

    上傳時間: 2022-08-10

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  • 電子技術(shù)基礎(chǔ)-數(shù)字部分-(第四版)526頁-華中理工-康華光.pdf

    《電子技術(shù)基礎(chǔ)(數(shù)字部分)》是根據(jù)國家教育部最新制定的《高職、高專教育數(shù)字電子技術(shù)基礎(chǔ)課程教學基本要求》,結(jié)合多年教學改革與實踐的基礎(chǔ)進行編寫的。《電子技術(shù)基礎(chǔ)(數(shù)字部分)》著重物理概念和基本原理的闡述,避免繁瑣的理論推導。在文字上,力求通俗易懂,便于自學。在內(nèi)容上刪減了陳舊的、冗余的內(nèi)容,減少內(nèi)部電路分析,理論聯(lián)系實際,突出工程應用;增加中、大規(guī)模集成電路內(nèi)容并適當介紹可編程邏輯器件PLD。   全書共八章,包括數(shù)字邏輯基礎(chǔ)、邏輯門電路、組合邏輯電路、集成觸發(fā)器、時序邏輯電路、脈沖波形的產(chǎn)生與整形、A/D及D/A轉(zhuǎn)換器、大規(guī)模集成電路等內(nèi)容,并有與內(nèi)容配合的思考題和習題。   《電子技術(shù)基礎(chǔ)(數(shù)字部分)》可作為全國招收初中五年制高職和中等專業(yè)學校工科電工類專業(yè)的教材,也可供相近專業(yè)的師生和工業(yè)技術(shù)人員參考。

    標簽: 526 電子技術(shù)基礎(chǔ) 數(shù)字

    上傳時間: 2013-04-24

    上傳用戶:brucewan

  • 無刷直流電機的無位置傳感器DSP控制.rar

    隨著大功率開關(guān)器件、集成電路及高性能的磁性材料的進步,采用電子換相原理工作的無刷直流電機得到了長足的發(fā)展。無刷直流電動機既具有交流電動機的結(jié)構(gòu)簡單、運行可靠維護方便等一系列優(yōu)點,又具備直流電動機的運行效率高、無勵磁損耗及調(diào)速性能好等諸多優(yōu)點,在當今國民經(jīng)濟各個領(lǐng)域的應用同益普及。 普通無刷直流電機存在著轉(zhuǎn)子位置傳感器,當電機尺寸較小時轉(zhuǎn)子位置傳感器難于安裝并且維修困難,另外傳統(tǒng)的霍爾元件溫度特性不好,導致系統(tǒng)可靠性變差,所以在一些小型,輕載啟動條件下,無位置傳感器無刷直流電機就成為理想選擇,并具有廣闊的發(fā)展前景。 同時隨著微處理器技術(shù)的發(fā)展,微處理器越來越多的用在控制系統(tǒng)中。許多復雜但有效的算法越來越多的用于電機控制當中。但是在無位置傳感器無刷直流電機,應用時往往需要精確的速度控制,尤其在高速運行場合,對信號反饋控制靈敏度的要求更為嚴格,并且算法也比較復雜。傳統(tǒng)的微處理器如 5l、96系列在實現(xiàn)對其的控制時,由于本身指令功能不強,乘除法所用周期過多,外圍電路數(shù)據(jù)轉(zhuǎn)換速度慢,資源相對較少,使其不能很好的完成對無位置傳感器無刷直流電機的控制。美國TI公司專門為電機的數(shù)字化控制設(shè)計的16位定點DSP控制器 TMS320X240集DSP的信號高速處理能力及適用于電機控制的優(yōu)化的外圍電路于一體,可以為高性能,復雜傳動控制提供可靠高效的信號處理與控制硬件。本論文所研究的無位置傳感器無刷直流電機DSP控制系統(tǒng)即為滿足這一需要而設(shè)計的。 本論文首先對無刷直流電動機及其無位置傳感器控制的基本原理以及DSP芯片 TMS320F240進行了必要的介紹,并且對基于反電勢檢測法的DSP實現(xiàn)作了詳細的分析,包括對反電勢檢測及其相位實時修正方法,電機換流的實現(xiàn),速度、電流雙閉環(huán)控制算法,電機的啟動分析,正反轉(zhuǎn)控制,速度的調(diào)節(jié),制動、保護等都做了——詳細論述。本論文還對控制系統(tǒng)的控制及功率部分硬件作了詳細的分析。最后本論文對軟件的具體實現(xiàn)作了具體的闡述。 根據(jù)本論文所述的設(shè)計方案設(shè)計的無刷電機無位置傳感器DSP控制系統(tǒng),可以獲得良好的速度控制性能。而且,DSP技術(shù)不僅使系統(tǒng)獲得了高精度,高可靠性,還簡化了系統(tǒng)結(jié)構(gòu),增加了系統(tǒng)的可靠性。具有控制靈活,智能水平高,參數(shù)易改等優(yōu)點。

    標簽: DSP 無刷直流電機 無位置傳感器

    上傳時間: 2013-05-28

    上傳用戶:Alibabgu

  • 三電平變頻器技術(shù)的實用化研究.rar

    近年來,在電氣傳動領(lǐng)域中三電平變頻器得到了廣泛的應用。三電平逆變器拓撲結(jié)構(gòu)的出現(xiàn)為高電壓、大功率變頻器的實現(xiàn)提供了一個有效的途徑。研究和開發(fā)三電平大功率變頻器,無論在技術(shù)上還是在實際應用上都有十分重要的意義。本文圍繞三電平大功率通用變頻器的實用化技術(shù)進行了深入分析和研究。 論文首先介紹了三電平逆變器主電路的拓撲結(jié)構(gòu)、控制要求、基本原理、特性和PWM控制策略以及調(diào)試中存在的問題和相關(guān)的解決方法。 中點電位不平衡是三電平拓撲結(jié)構(gòu)的一個固有問題。針對這一問題,本論文分析了中點電壓不平衡的根本原因,采用了一種基于滯環(huán)控制的電壓平衡控制方法。該方法根據(jù)負載電流方向的不同組合,通過調(diào)整小矢量的冗余狀態(tài)和作用時間,并充分考慮到中矢量對中點平衡的影響,動態(tài)調(diào)整兩個電容器上的電壓,同時,詳細地分析了當參考電壓矢量落到具有一種或兩種冗余小矢量的小三角形區(qū)間時開關(guān)狀態(tài)的選擇、開關(guān)序列的順序以及作用時間的分配。 基于載波的調(diào)制策略是三電平變頻器采用的主要調(diào)制方式之一。本論文對所采用的基于載波的調(diào)制策略,作了深入分析,得出了相應的諧波特性。基于諧波總含量,對調(diào)制特性的優(yōu)劣進行了比較,同時得出了不同載波調(diào)制策略輸出電壓諧波含量與調(diào)制度變化的對應關(guān)系,并通過實驗和仿真對相關(guān)結(jié)果進行了驗證。 主電路和控制電路的硬件設(shè)計將直接影響到變頻器的運行性能。本論文介紹了在現(xiàn)場實際運行中變頻器的主回路及其控制回路的硬件設(shè)計,采用理論計算與實踐驗證相結(jié)合的方法得出器件相關(guān)參數(shù),并且針對變頻器內(nèi)外RCD緩沖電路在工作時所產(chǎn)生的電壓不平衡作了分析,詳細的給出了其緩沖吸收電路算法。 最后,把本文的部分研究結(jié)果應用于實際工業(yè)現(xiàn)場中,研制了690V/600kW的大功率中壓變頻器,給出了現(xiàn)場運行結(jié)果。運行結(jié)果表明該變頻器輸出波形良好,性能滿足要求。

    標簽: 三電平 變頻器

    上傳時間: 2013-08-04

    上傳用戶:kirivir

  • 基于FPGA的3D頭盔顯示設(shè)備研究.rar

    圖像顯示器是人類接受外部信息的重要手段之一。而立體顯示則能再現(xiàn)場景的三維信息,提供場景更為全面、詳實的信息,在醫(yī)學、軍事、娛樂具有廣泛的應用前景。而現(xiàn)有的3D立體顯示設(shè)備價格都比較貴,基于此,本人研究了基于SDRAM存儲器和FPGA處理器的3D頭盔顯示設(shè)備并且設(shè)計出硬件和軟件系統(tǒng)。該系統(tǒng)圖像效果好,并且價格成本便宜,從而具有更大的實用性。本文完成的主要工作有三點: 1.設(shè)計了基于FPGA處理器和SDRAM存儲器的3D頭盔顯示器。該方案有別于現(xiàn)有的基于MCU、DSP和其它處理芯片的方案。本方案能通過線性插值算法把1024×768的分辨率變成800×600的分辨率,并能實現(xiàn)120HZ圖像刷新率,采用SDRAM作為高速存儲器,并且采用乒乓操作,有別于其它的開關(guān)左右眼視頻實現(xiàn)立體圖像。在本方案中每時每刻都是左右眼視頻同時輸出,使得使用者感覺不到視頻圖像有任何閃爍,減輕眼睛疲勞。本方案還實現(xiàn)了圖像對比對度調(diào)節(jié),液晶前照光調(diào)節(jié)(調(diào)節(jié)輸出脈沖的占空比),立體圖像源自動識別,還有人性化的操作界面(OSD)功能。 2.完成了該系統(tǒng)的硬件平臺設(shè)計和軟件設(shè)計。從便攜性角度考慮,盡量減小PCB板面積,給出了它們詳細的硬件設(shè)計電路圖。完成了FPGA系統(tǒng)的設(shè)計,包括系統(tǒng)整體分析,各個模塊的實現(xiàn)原理和具體實現(xiàn)的方法。完成了單片機對AD9883的配置設(shè)計。 3.完成了本方案的各項測試和調(diào)試工作,主要包括:數(shù)據(jù)采集部分測試、數(shù)據(jù)存儲部分測試、FPGA器件工作狀態(tài)測試、以電腦顯示器作為顯示器的聯(lián)機調(diào)試和以HX7015A作為顯示器的聯(lián)機調(diào)試,并且最終調(diào)試通過,各項功能都滿足預期設(shè)計的要求。實驗和分析結(jié)果論證了系統(tǒng)設(shè)計的合理性和使用價值。 本文的研究與實現(xiàn)工作通過實驗和分析得到了驗證。結(jié)果表明,本文提出的由FPGA和SDRAM組成的3D頭盔顯示系統(tǒng)完全可以實現(xiàn)高質(zhì)量的立體視覺效果,從而可以將該廉價的3D頭盔顯示系統(tǒng)用于我國現(xiàn)代化建設(shè)中所需要的領(lǐng)域。

    標簽: FPGA 顯示設(shè)備

    上傳時間: 2013-07-16

    上傳用戶:xiaoxiang

  • 基于FFT的GPS信號并行捕獲的研究及其FPGA實現(xiàn).rar

    本課題深入分析了GPS軟件接收機基于FFT并行捕獲算法并詳細闡述了其FPGA的實現(xiàn)。相比于其它的捕獲方案,該方案更好地滿足了信號處理實時性的要求。 論文的主體部分首先簡單分析了擴頻通信系統(tǒng)的基本原理,介紹了GPS系統(tǒng)的組成,詳細闡述了GPS信號的特點,并根據(jù)GPS信號的組成特點介紹了接收機的體系結(jié)構(gòu)。其次,通過對GPS接收機信號捕獲方案的深入研究,確定了捕獲速度快且實現(xiàn)復雜度不是很高的基于FFT的并行捕獲方案,并對該方案提出了幾點改進的措施,根據(jù)前面的分析,提出了系統(tǒng)的實現(xiàn)方案,利用MATLAB對該系統(tǒng)進行仿真,仿真的結(jié)果充分的驗證了方案的可行性。接著,對于捕獲環(huán)節(jié)中的核心部分—FFT處理器,設(shè)計中沒有采用ALTERA提供的IP核,獨立設(shè)計實現(xiàn)了基于FPGA的FFT處理器,并通過對一組數(shù)據(jù)在MATLAB中運算得到結(jié)果和FPGA輸出結(jié)果相對比,可以驗證該FFT處理器的正確性。再次重點分析了GPS接收機并行捕獲部分的FPGA具體實現(xiàn),通過捕獲的FPGA時序仿真波形,證明了該系統(tǒng)已經(jīng)能成功地捕獲到GPS信號。最后,對全文整個研究工作進行總結(jié),并指出以后繼續(xù)研究的方向。 本課題雖然是對于GPS接收機的研究,但其原理與GALILEO、北斗等導航系統(tǒng)的接收機相近,因此該課題的研究對我國衛(wèi)星導航事業(yè)的發(fā)展起到了積極的推動作用。

    標簽: FPGA FFT GPS

    上傳時間: 2013-08-06

    上傳用戶:青春123

  • 液位—流量串級控制系統(tǒng)設(shè)計

    兩級PID調(diào)節(jié)液位,流量的原理分析,及其試驗數(shù)據(jù)的分析(畢業(yè)設(shè)計)

    標簽: 液位 流量 串級控制 系統(tǒng)設(shè)計

    上傳時間: 2013-04-24

    上傳用戶:qsbbear

  • 基于DSPFPGA的H264AVC實時編碼器

    H.264/AVC是ITU-T和ISO聯(lián)合推出的新標準,采用了近幾年視頻編碼方面的先進技術(shù),以較高編碼效率和網(wǎng)絡(luò)友好性成為新一代國際視頻編碼標準。 本文以實現(xiàn)D1格式的H.264/AVC實時編碼器為目標,作者負責系統(tǒng)架構(gòu)設(shè)計,軟硬件劃分以及部分模塊的硬件算法設(shè)計與實現(xiàn)。通過對H.264/AVC編碼器中主要模塊的算法復雜度的評估,算法特點的分析,同時考慮到編碼器系統(tǒng)的可伸縮性,可擴展性,本文采用了DSP+FPGA的系統(tǒng)架構(gòu)。DSP充當核心處理器,而FPGA作為協(xié)處理器,針對編碼器中最復雜耗時的模塊一運動估計模塊,設(shè)計相應的硬件加速引擎,以提供編碼器所需要的實時性能。 H.264/AVC仍基于以前視頻編碼標準的運動補償混合編碼方案,其中一個主要的不同在于幀間預測采用了可變塊尺寸的運動估計,同時運動向量精度提高到1/4像素。更小和更多形狀的塊分割模式的采用,以及更加精確的亞像素位置的預測,可以改善運動補償精度,提高圖像質(zhì)量和編碼效率,但同時也大大增加了編碼器的復雜度,因此需要設(shè)計專門的硬件加速引擎。 本文給出了1/4像素精度的運動估計基于FPGA的硬件算法設(shè)計與實現(xiàn),包括整像素搜索,像素插值,亞像素(1/2,1/4)搜索以及多模式選擇(支持全部七種塊分割模式)。設(shè)計中,將多處理器技術(shù)和流水線技術(shù)相結(jié)合,提供高性能的并行計算能力,同時,采用合理的存儲器組織結(jié)構(gòu)以提供高數(shù)據(jù)吞吐量,滿足運算的帶寬要求,并使編碼器具有較好的可伸縮性。最后,在Modelsim環(huán)境下建立測試平臺,完成了對整個設(shè)計的RTL級的仿真驗證,并針對Altera公司的FPGA芯片stratixⅡ系列的EP2S60-4器件進行優(yōu)化,從而使工作頻率最終達到134MHz,分析數(shù)據(jù)表明該模塊能夠滿足編碼器的實時性要求。

    標簽: DSPFPGA H264 264 AVC

    上傳時間: 2013-07-24

    上傳用戶:sn2080395

  • 基于FFT的GPS信號并行捕獲的研究

    本課題深入分析了GPS軟件接收機基于FFT并行捕獲算法并詳細闡述了其FPGA的實現(xiàn)。相比于其它的捕獲方案,該方案更好地滿足了信號處理實時性的要求。 論文的主體部分首先簡單分析了擴頻通信系統(tǒng)的基本原理,介紹了GPS系統(tǒng)的組成,詳細闡述了GPS信號的特點,并根據(jù)GPS信號的組成特點介紹了接收機的體系結(jié)構(gòu)。其次,通過對GPS接收機信號捕獲方案的深入研究,確定了捕獲速度快且實現(xiàn)復雜度不是很高的基于FFT的并行捕獲方案,并對該方案提出了幾點改進的措施,根據(jù)前面的分析,提出了系統(tǒng)的實現(xiàn)方案,利用MATLAB對該系統(tǒng)進行仿真,仿真的結(jié)果充分的驗證了方案的可行性。接著,對于捕獲環(huán)節(jié)中的核心部分—FFT處理器,設(shè)計中沒有采用ALTERA提供的IP核,獨立設(shè)計實現(xiàn)了基于FPGA的FFT處理器,并通過對一組數(shù)據(jù)在MATLAB中運算得到結(jié)果和FPGA輸出結(jié)果相對比,可以驗證該FFT處理器的正確性。再次重點分析了GPS接收機并行捕獲部分的FPGA具體實現(xiàn),通過捕獲的FPGA時序仿真波形,證明了該系統(tǒng)已經(jīng)能成功地捕獲到GPS信號。最后,對全文整個研究工作進行總結(jié),并指出以后繼續(xù)研究的方向。 本課題雖然是對于GPS接收機的研究,但其原理與GALILEO、北斗等導航系統(tǒng)的接收機相近,因此該課題的研究對我國衛(wèi)星導航事業(yè)的發(fā)展起到了積極的推動作用。

    標簽: FFT GPS 信號 并行

    上傳時間: 2013-05-29

    上傳用戶:ice_qi

  • 無線通信系統(tǒng)的FPGA設(shè)計和研究

    在數(shù)字化、信息化的時代,數(shù)字集成電路應用得非常廣泛。隨著微電子技術(shù)和工藝的發(fā)展,數(shù)字集成電路從電子管、晶體管、中小規(guī)模集成電路、超大規(guī)模集成電路(VLSIC)逐步發(fā)展到今天的專用集成電路(ASIC)。但是ASIC因其設(shè)計周期長,改版投資大,靈活性差等缺陷制約著它的應用范圍。可編程邏輯器件的出現(xiàn)彌補了ASIC的缺陷,使得設(shè)計的系統(tǒng)變得更加靈活,設(shè)計的電路體積更加小型化,重量更加輕型化,設(shè)計的成本更低,系統(tǒng)的功耗也更小了。FPGA是英文Field Programmable Gate Array的縮寫,即現(xiàn)場可編程門陣列,它是在PAL、GAL、EPID等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。 本論文撰寫的是用FPGA來實現(xiàn)無人小飛機系統(tǒng)中基帶信號的處理過程。整個信號處理過程全部采用VHDL硬件描述語言來設(shè)計,并用Modelsim仿真系統(tǒng)功能進行調(diào)試,最后使用了Xilinx 公司可編程的FPGA芯片XC2S100完成,滿足系統(tǒng)設(shè)計的要求。 本文首先研究和討論了無線通信系統(tǒng)中基帶信號處理的總體結(jié)構(gòu),接著詳細闡述了各個模塊的設(shè)計原理和方法,以及FPGA結(jié)果分析,最后就關(guān)鍵技術(shù)和難點作了詳細的分析和研究。本文的最大特色是整個系統(tǒng)全部采用FPGA的方法來設(shè)計實現(xiàn),修改靈活,體積小,功耗小。本系統(tǒng)的設(shè)計包括了數(shù)字鎖相環(huán)、糾錯編解碼、碼組交織、擾碼加入、巴克碼插入、幀同步識別、DPSK調(diào)制解調(diào)及選擇了整體的時序,所有的組成部分都經(jīng)過了反復地修改和調(diào)試,取得了良好的數(shù)據(jù)處理效果,其關(guān)鍵之處與難點都得到了妥善地解決。本文分別在發(fā)射部分(編碼加調(diào)制)和接收部分(解調(diào)加解碼)相獨立和相聯(lián)系的情況下,獲得了仿真與實測結(jié)果。

    標簽: FPGA 無線通信系統(tǒng)

    上傳時間: 2013-07-05

    上傳用戶:acon

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