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凌陽(yáng)(yáng)16

  • VHDL源程序:16位計(jì)數(shù)器的設(shè)計(jì)

    16位計(jì)數(shù)器的設(shè)計(jì),這里是實(shí)現(xiàn)上述功能的VHDL源程序,供大家學(xué)習(xí)和討論。\r\n

    標(biāo)簽: VHDL 源程序 計(jì)數(shù)器

    上傳時(shí)間: 2013-09-05

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  • 16位10 MSPS ADC AD7626的單端轉(zhuǎn)差分高速驅(qū)動(dòng)電路

    圖1所示電路可將高頻單端輸入信號(hào)轉(zhuǎn)換為平衡差分信號(hào),用于驅(qū)動(dòng)16位10 MSPS PulSAR® ADC AD7626。該電路采用低功耗差分放大器ADA4932-1來(lái)驅(qū)動(dòng)ADC,最大限度提升AD7626的高頻輸入信號(hào)音性能。此器件組合的真正優(yōu)勢(shì)在于低功耗、高性能

    標(biāo)簽: MSPS 7626 ADC AD

    上傳時(shí)間: 2013-10-21

    上傳用戶:佳期如夢(mèng)

  • 16位高速模數(shù)轉(zhuǎn)換模塊的設(shè)計(jì)及其動(dòng)態(tài)性能測(cè)試

    本文結(jié)合研究所科研項(xiàng)目需要,基于16 位高速ADC 芯片LTC2204,設(shè)計(jì)了一種滿足課題要求的高速度高性能的16 位模數(shù)轉(zhuǎn)換板卡方案。該方案中的輸入電路和時(shí)鐘電路采用差分結(jié)構(gòu),輸出電路采用鎖存器隔離結(jié)構(gòu),電源電路采用了較好的去耦措施,并且注重了板卡接地設(shè)計(jì),使其具有抗噪聲干擾能力強(qiáng)、動(dòng)態(tài)性能好、易實(shí)現(xiàn)的特點(diǎn)。

    標(biāo)簽: 模數(shù)轉(zhuǎn)換 模塊 動(dòng)態(tài) 性能測(cè)試

    上傳時(shí)間: 2013-11-10

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  • 簡(jiǎn)單的多輸出范圍16位DAC設(shè)計(jì)

      Precision 16-bit analog outputs with softwareconfigurableoutput ranges are often needed in industrialprocess control equipment, analytical and scientificinstruments and automatic test equipment. In the past,designing a universal output module was a daunting taskand the cost and PCB real estate associated with thisfunction were problematic, if not prohibitive.

    標(biāo)簽: DAC 輸出范圍

    上傳時(shí)間: 2014-12-23

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  • 凌力爾特?cái)?shù)字系統(tǒng)的線性電路

    凌力爾特?cái)?shù)字系統(tǒng)的線性電路—凌力爾特一直致力服務(wù)全球模擬產(chǎn)品用戶,滿足日益增長(zhǎng)的嚴(yán)格模擬產(chǎn)品設(shè)計(jì)的需求。公司具有超強(qiáng)的創(chuàng)新能力,每年推出的新產(chǎn)品超過(guò)200款,該公司產(chǎn)品的應(yīng)用領(lǐng)域包括電信、蜂窩電話、網(wǎng)絡(luò)產(chǎn)品、筆記本電腦和臺(tái)式電腦等等。

    標(biāo)簽: 凌力爾特 數(shù)字系統(tǒng) 線性電路

    上傳時(shí)間: 2014-12-23

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  • Altium_designer4層以上高速板布線的16個(gè)技巧

    Altium_designer4層以上高速板布線的16個(gè)技巧

    標(biāo)簽: Altium_designer 高速板布線

    上傳時(shí)間: 2013-10-30

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  • Cadence 16.6和諧方法_修正版

    Cadence 16.6 和諧方法 Cadence16.6 Allegro

    標(biāo)簽: Cadence 16.6

    上傳時(shí)間: 2013-10-20

    上傳用戶:sz_hjbf

  • ORCAD PSPICE 16.5crack文件

    ORCAD PSPICE 16.5crack文件,win7下親測(cè)可用,內(nèi)含詳細(xì)破解過(guò)程和必要的文件

    標(biāo)簽: PSPICE ORCAD crack 16.5

    上傳時(shí)間: 2013-11-15

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  • Altium_designer4層以上高速板布線的16個(gè)技巧

    Altium_designer4層以上高速板布線的16個(gè)技巧

    標(biāo)簽: Altium_designer 高速板布線

    上傳時(shí)間: 2014-12-24

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  • 印刷電路板設(shè)計(jì)原則

    減小電磁干擾的印刷電路板設(shè)計(jì)原則 內(nèi) 容 摘要……1 1 背景…1 1.1 射頻源.1 1.2 表面貼裝芯片和通孔元器件.1 1.3 靜態(tài)引腳活動(dòng)引腳和輸入.1 1.4 基本回路……..2 1.4.1 回路和偶極子的對(duì)稱性3 1.5 差模和共?!?.3 2 電路板布局…4 2.1 電源和地…….4 2.1.1 感抗……4 2.1.2 兩層板和四層板4 2.1.3 單層板和二層板設(shè)計(jì)中的微處理器地.4 2.1.4 信號(hào)返回地……5 2.1.5 模擬數(shù)字和高壓…….5 2.1.6 模擬電源引腳和模擬參考電壓.5 2.1.7 四層板中電源平面因該怎么做和不應(yīng)該怎么做…….5 2.2 兩層板中的電源分配.6 2.2.1 單點(diǎn)和多點(diǎn)分配.6 2.2.2 星型分配6 2.2.3 格柵化地.7 2.2.4 旁路和鐵氧體磁珠……9 2.2.5 使噪聲靠近磁珠……..10 2.3 電路板分區(qū)…11 2.4 信號(hào)線……...12 2.4.1 容性和感性串?dāng)_……...12 2.4.2 天線因素和長(zhǎng)度規(guī)則...12 2.4.3 串聯(lián)終端傳輸線…..13 2.4.4 輸入阻抗匹配...13 2.5 電纜和接插件……...13 2.5.1 差模和共模噪聲……...14 2.5.2 串?dāng)_模型……..14 2.5.3 返回線路數(shù)目..14 2.5.4 對(duì)板外信號(hào)I/O的建議14 2.5.5 隔離噪聲和靜電放電ESD .14 2.6 其他布局問(wèn)題……...14 2.6.1 汽車和用戶應(yīng)用帶鍵盤(pán)和顯示器的前端面板印刷電路板...15 2.6.2 易感性布局…...15 3 屏蔽..16 3.1 工作原理…...16 3.2 屏蔽接地…...16 3.3 電纜和屏蔽旁路………………..16 4 總結(jié)…………………………………………17 5 參考文獻(xiàn)………………………17  

    標(biāo)簽: 印刷電路板 設(shè)計(jì)原則

    上傳時(shí)間: 2013-10-24

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