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  • 基于FPGA的π4-DQPSK全數(shù)字中頻發(fā)射機和接收機的實現(xiàn)

    本文以電子不停車收費系統(tǒng)課題為背景,設計并實現(xiàn)了基于FPGA的π/4-DOPSK全數(shù)字中頻發(fā)射機和接收機。π/4-DQPSK廣泛應用于移動通信和衛(wèi)星通信中,具有頻帶利用率高、頻譜特性好、抗衰落性能強的特點。 近年來現(xiàn)場可編程門陣列(FPGA)器件在芯片邏輯規(guī)模和處理速度等方面性能的迅速提高,用硬件編程實現(xiàn)無線功能的軟件無線電技術在理論和實用化上都趨于成熟和完善,因此可以把數(shù)字調制,數(shù)字上/下變頻,數(shù)字解調在同一塊FPGA上實現(xiàn),即實現(xiàn)了中頻發(fā)射機和接收機一體化的片上可編程系統(tǒng)(SOPC,System On Programmabie Chip)。 本文首先根據指標要求對數(shù)字收發(fā)機方案進行設計,確定了適合不停車收費系統(tǒng)的全數(shù)字發(fā)射機和接收機的結構,接著根據π/4-DQPSK發(fā)射機和接收機的理論,設計并實現(xiàn)了基于FPGA的成形濾波器SRRC、半帶濾波器HB和定時算法并給出性能分析,最后給出硬件測試平臺上結果和測試結果分析。

    標簽: DQPSK FPGA 全數(shù)字 中頻

    上傳時間: 2013-07-18

    上傳用戶:saharawalker

  • 基于FPGA的全數(shù)字化交流變頻調速系統(tǒng)

    本文主要介紹了如何運用可編程邏輯器件(FPGA)實現(xiàn)電機的變頻調速控制系統(tǒng)。  目前,電機控制芯片主要有兩種選擇。一種是專用集成芯片(ASIC),一種是單片機(MCU)或數(shù)字信號處理器(DSP)。而FPGA的數(shù)字資源豐富、工作頻率高、可在系統(tǒng)編程等特點使得開發(fā)靈活、開發(fā)周期相對短,可以取代前二種通用的方式。本文利用80C196KC和FPGA控制感應電機,簡化了硬件和軟件設計,并充分利用了FPGA的快速性,利用FPGA,除本身可以用來控制電機以外:可以制成通用的“IP核”應用到MCU(或DSP),或是作為片內外設,這樣就節(jié)約了片內資源;另外,它還是ASIC設計的驗證的必經階段,這是本文選題和工作的意義。本文設計的FPGA調速控制系統(tǒng)以及2個IP核,下載到芯片,通過驗證。  本文第一章緒論介紹了可編程邏輯器件的發(fā)展、應用,以及EDA的發(fā)展歷程,還介紹了ASIC等。針對FPGA的快速發(fā)展,論述了它在變頻調速技術應用中的優(yōu)勢。  第二章介紹了交流電動機變頻調速技術及其相關技術的發(fā)展和應用情況。著重介紹了電壓空間矢量調制方式,以及矢量控制技術、技術發(fā)展。  第三章詳細介紹了SVPWM調速系統(tǒng)整個系統(tǒng)的FPGA設計,給出了設計思路、具體方案、邏輯時序分析;最后給出了軟件仿真結果和實驗波形對照。文中還給出了SVPWM調速系統(tǒng)運用的FPGA設計結果,驅動電機,得到實驗波形。論證了FPGA在調速系統(tǒng)應用中的可行性和意義。  第四章介紹了作者針對課題相關的一些內容所設計出的IP核,給出的實驗結果等。  論文最后,對本課題所做的工作進行了簡單的總結。

    標簽: FPGA 全數(shù)字 交流變頻 調速系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:zhaiyanzhong

  • STC單片機全系列頭文件

    這個是STC單片機的全系列頭文件. 這個是STC單片機的全系列頭文件

    標簽: STC 單片機 頭文件

    上傳時間: 2013-04-24

    上傳用戶:1054154823

  • 移相全橋(阮新波)

    全橋的好書啊,據說是現(xiàn)在移相全橋類書籍的鼻祖啊

    標簽: 移相全橋

    上傳時間: 2013-07-03

    上傳用戶:zhch602

  • 10種精密全波整流電路

    十種精密全波整流電路 圖中精密全波整流電路的名稱,純屬本人命的名,只是為了區(qū)分;除非特殊說明,增益均按1設計.    圖1是最經典的電路,優(yōu)

    標簽: 精密 全波整流 電路

    上傳時間: 2013-07-21

    上傳用戶:zoushuiqi

  • 基于FPGA的雷達信號偵察數(shù)字接收機

    隨著信號處理技術的進步和電子技術的發(fā)展,雷達信號偵察接收機逐漸從模擬體制向數(shù)字體制轉變。軟件無線電概念的提出,促使雷達偵察接收機朝大帶寬、全截獲方向發(fā)展,現(xiàn)有的串行信號處理體制已經很難滿足系統(tǒng)要求。FPGA器件的出現(xiàn),為實現(xiàn)寬帶雷達信號偵察數(shù)字接收機提供了硬件支持。 本文結合FPGA芯片特點,在前人研究基礎上,從算法和硬件實現(xiàn)兩方面,對雷達信號偵察數(shù)字接收機若干關鍵技術進行了研究和創(chuàng)新,主要研究內容包括以下幾個方面。 1)給出了基于QuartusII/Matlab和ISE/ModelSim/Matlab的兩種FPGA設計聯(lián)合仿真技術。這種聯(lián)合仿真技術,大大提高了基于FPGA的雷達信號偵察數(shù)字接收機的設計效率。 2)給出了一種基于FFT/IFFT的寬帶數(shù)字正交變換算法,并將該算法在FPGA中進行了硬件實現(xiàn),設計可對600MHz帶寬內的輸入信號進行實時正交變換。 3)提出了一種全并行結構FFT的FPGA實現(xiàn)方案,并將其在FPGA芯片中進行了硬件實現(xiàn),設計能夠在一個時鐘周期內完成32點并行FFT運算,滿足了數(shù)字信道化接收機對數(shù)據處理速度的要求。 4)提出了一種自相關信號檢測FPGA實現(xiàn)方案,通過改變FIFO長度改變自相關運算點數(shù),實現(xiàn)了弱信號檢測。提出通過二次門限處理來消除檢測脈沖中的毛刺和凹陷,降低了虛警概率,提高了檢測結果的可靠性。 5)在單通道自相關信號檢測算法基礎上,提出采用三路并行檢測,每路采用不同的相關點數(shù)和檢測門限,再綜合考慮三路檢測結果,得到最終檢測結果。給出了算法FPGA實現(xiàn)過程,并對設計進行了聯(lián)合時序仿真,提高了檢測性能。 6)給出了一種利用FFT變換后的兩根最大譜線進行插值的快速高精度頻率估計方法,并將該算法在FPGA硬件中進行了實現(xiàn)。通過利用FFT運算后的實/虛部最大值進行插值,降低了硬件資源消耗、縮短了運算延遲。 7)結合4)、5)、6)中的研究成果,完成了對雷達脈沖信號到達時間、終止時間、脈沖寬度和脈沖頻率的估計,最終在一塊FPGA芯片內實現(xiàn)了一個精簡的雷達信號偵察數(shù)字接收機,并在微波暗室中進行了測試。

    標簽: FPGA 雷達信號 數(shù)字接收機

    上傳時間: 2013-06-13

    上傳用戶:Divine

  • 基于FPGA的全數(shù)字擴頻收發(fā)機

    軟件無線電(SDR)

    標簽: FPGA 全數(shù)字 擴頻 收發(fā)機

    上傳時間: 2013-06-13

    上傳用戶:linlin

  • 基于FPGA的全同步數(shù)字頻率計的設計

    頻率是電子技術領域內的一個基本參數(shù),同時也是一個非常重要的參數(shù)。穩(wěn)定的時鐘在高性能電子系統(tǒng)中有著舉足輕重的作用,直接決定系統(tǒng)性能的優(yōu)劣。隨著電子技術的發(fā)展,測頻系統(tǒng)使用時鐘的提高,測頻技術有了相當大的發(fā)展,但不管是何種測頻方法,±1個計數(shù)誤差始終是限制測頻精度進一步提高的一個重要因素。 本設計闡述了各種數(shù)字測頻方法的優(yōu)缺點。通過分析±1個計數(shù)誤差的來源得出了一種新的測頻方法:檢測被測信號,時基信號的相位,當相位同步時開始計數(shù),相位再次同步時停止計數(shù),通過相位同步來消除計數(shù)誤差,然后再通過運算得到實際頻率的大小。根據M/T法的測頻原理,已經出現(xiàn)了等精度的測頻方法,但是還存在±1的計數(shù)誤差。因此,本文根據等精度測頻原理中閘門時間只與被測信號同步,而不與標準信號同步的缺點,通過分析已有等精度澳孽頻方法所存在±1個計數(shù)誤差的來源,采用了全同步的測頻原理在FPGA器件上實現(xiàn)了全同步數(shù)字頻率計。根據全同步數(shù)字頻率計的測頻原理方框圖,采用VHDL語言,成功的編寫出了設計程序,并在MAX+PLUS Ⅱ軟件環(huán)境中,對編寫的VHDL程序進行了仿真,得到了很好的效果。最后,又討論了全同步頻率計的硬件設計并給出了電路原理圖和PCB圖。對構成全同步數(shù)字頻率計的每一個模塊,給出了較詳細的設計方法和完整的程序設計以及仿真結果。

    標簽: FPGA 數(shù)字頻率計

    上傳時間: 2013-04-24

    上傳用戶:qqoqoqo

  • QPSK中頻全數(shù)字解調器的設計與FPGA實現(xiàn)

    隨著數(shù)字信號處理技術和大規(guī)模集成電路的飛速發(fā)展以及軟件無線電技術的廣泛應用,中頻全數(shù)字解調技術得到了進一步的發(fā)展,在無線通信中得到了廣泛應用。論文簡要介紹了QPSK數(shù)字調制的基本原理,對QPSK中頻全數(shù)字解調器的...

    標簽: QPSK FPGA 中頻 全數(shù)字

    上傳時間: 2013-05-30

    上傳用戶:as275944189

  • 全數(shù)字OQPSK解調算法的研究及FPGA實現(xiàn)

    隨著各種通信系統(tǒng)數(shù)量的日益增多,為了充分地利用有限的頻譜資源,高頻譜利用率的調制技術不斷被應用。偏移正交相移鍵控(OQPSK: Offset QuadraturePhase Shift Keying)是一種恒包絡調制技術,具有較高的頻譜利用率和功率利用率,廣泛應用于衛(wèi)星通信系統(tǒng)和地面移動通信系統(tǒng)。因此,對于OQPSK全數(shù)字解調技術的研究具有一定的理論價值。 本文以軟件無線電和全數(shù)字解調的相關理論為指導,成功設計并實現(xiàn)了基于FPGA的OQPSK全數(shù)字解調。論文介紹了OQPSK全數(shù)字接收解調原理和基于軟件無線電設計思想的全數(shù)字接收機的基本結構,詳細闡述了當今OQPSK數(shù)字解調中載波頻率同步、載波相位同步、時鐘同步和數(shù)據幀同步的一些常用算法,并選擇了相應算法構建了三種系統(tǒng)級的實現(xiàn)方案。通過MATLAB對解調方案的仿真和性能分析,確定了FPGA中的系統(tǒng)實現(xiàn)方案。在此基礎上,本文采用VerilogHDL硬件描述語言在Altera公司的Quartus II開發(fā)平臺上設計了同步解調系統(tǒng)中的各個模塊,還對各模塊和整個系統(tǒng)在ModelSim中進行了時序仿真驗證,并對設計中出現(xiàn)的問題進行了修正。最后,經過FPGA調試工具嵌入式邏輯分析儀SignalTapⅡ的硬件實際測試,本文對系統(tǒng)方案進行了最終的改進與調整。 實際測試結果表明,本文的設計最終能夠達到了預期的指標和要求。本課題設計經過時序和資源優(yōu)化后還可以向ASIC和系統(tǒng)級SOC轉化,以進一步縮小系統(tǒng)體積、降低成本和提高電路的可靠性,因此具有良好的實際應用價值。

    標簽: OQPSK FPGA 全數(shù)字 解調

    上傳時間: 2013-07-14

    上傳用戶:aappkkee

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