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內(nèi)(nèi)核編程

  • 基于FPGA的GPIB接口IP核的研究與設(shè)計

    基于FPGA的GPIB接口IP核的研究與設(shè)計

    標(biāo)簽： FPGA GPIB 接口 IP核

    上傳時間： 2013-11-04

    上傳用戶：bensonlly

  • ISE新建工程及使用IP核步驟詳解

    ISE新建工程及使用IP核步驟詳解

    標(biāo)簽： ISE IP核 工程

    上傳時間： 2013-11-18

    上傳用戶：peterli123456

  • ISE_IP核創(chuàng)建教程及DDR3_ip核使用注意事項

    ISE_IP核創(chuàng)建教程及DDR3_ip核使用注意事項

    標(biāo)簽： ISE_IP DDR ip 教程

    上傳時間： 2013-11-11

    上傳用戶：lmeeworm

  • 基于NiosII軟核處理器的步進(jìn)電機(jī)接口設(shè)計

        NiosII軟核處理器是Altera公司開發(fā)，基于FPGA操作平臺使用的一款高速處理器，為了適應(yīng)高速運(yùn)動圖像采集，提出了一種基于NiosII軟核處理的步進(jìn)電機(jī)接口設(shè)計，使用verilog HDL語言完成該接口設(shè)計，最后通過QuartusII軟件，給出了實(shí)驗(yàn)仿真結(jié)果。

    標(biāo)簽： NiosII 軟核處理器 步進(jìn)電機(jī) 接口設(shè)計

    上傳時間： 2014-12-28

    上傳用戶：jiwy

  • 基于FPGA的DDS IP核設(shè)計方案

    以Altera公司的Quartus Ⅱ 7.2作為開發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計，并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結(jié)果。將設(shè)計的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟核Nios II，構(gòu)成可編程片上系統(tǒng)（SOPC），利用極少的硬件資源實(shí)現(xiàn)了可重構(gòu)信號源。該系統(tǒng)基本功能都在FPGA芯片內(nèi)完成，利用 SOPC技術(shù)，在一片 FPGA 芯片上實(shí)現(xiàn)了整個信號源的硬件開發(fā)平臺，達(dá)到既簡化電路設(shè)計、又提高系統(tǒng)穩(wěn)定性和可靠性的目的。

    標(biāo)簽： FPGA DDS IP核 設(shè)計方案

    上傳時間： 2013-11-06

    上傳用戶：songkun

  • MagicSOPC例程編譯異常及解決方法

    1.1 問題產(chǎn)生的環(huán)境1.1.1 軟件環(huán)境1. PC機(jī)的系統(tǒng)為Microsoft Window XP Professional版本2002 Service Pack 2；2. Quartus II V7.0軟件，并安裝了MegaCore IP V7.0；3. NiosII IDE 7.0軟件。1.1.2 硬件環(huán)境核心板的芯片是EP2C35F672C8N的MagicSOPC實(shí)驗(yàn)箱的硬件系統(tǒng)。硬件的工作環(huán)境是在普通的環(huán)境下。1.2 問題的現(xiàn)象在使用MagicSOPC實(shí)驗(yàn)箱的光盤例程時，使用Quartus II編譯工程時出現(xiàn)編譯錯誤，錯誤提示信息如圖1.1、圖1.2所示。

    標(biāo)簽： MagicSOPC 編譯

    上傳時間： 2013-11-18

    上傳用戶：zhyiroy

  • 基于多核DSP的SDIF雷達(dá)信號分選算法實(shí)現(xiàn)

    針對實(shí)際應(yīng)用中電子戰(zhàn)設(shè)備對雷達(dá)信號分選的實(shí)時性要求，在分析了序列差直方圖算法和多核DSP任務(wù)并行模式的基礎(chǔ)上，設(shè)計了基于TMS320C6678的八核DSP雷達(dá)信號分選電路，對密集的雷達(dá)信號進(jìn)行分選。實(shí)驗(yàn)結(jié)果表明：該電路可對常規(guī)雷達(dá)信號實(shí)現(xiàn)快速分選，并且分選效果良好，系統(tǒng)可靠性高。

    標(biāo)簽： SDIF DSP 多核 雷達(dá)信號分選

    上傳時間： 2013-10-16

    上傳用戶：攏共湖塘

  • LabWindows_CVI多線程技術(shù)的應(yīng)用研究

    分析了線程與進(jìn)程的關(guān)系，研究了LabWindows/CVI多線程技術(shù)運(yùn)行機(jī)制及其數(shù)據(jù)保護(hù)機(jī)制，對利用異步定時器實(shí)現(xiàn)的多線程軟件與傳統(tǒng)單線程軟件進(jìn)行效能差異分析。在某武器系統(tǒng)測控軟件的開發(fā)中采用了LabWindows/CVI多線程技術(shù)，實(shí)現(xiàn)了系統(tǒng)的安全性和實(shí)時性設(shè)計。研究表明多線程技術(shù)能夠更好地執(zhí)行并行性任務(wù)，提高測控系統(tǒng)性能，在避免阻塞，減少運(yùn)行時間，增強(qiáng)系統(tǒng)可靠性等方面具有顯著優(yōu)勢。

    標(biāo)簽： LabWindows_CVI 多線程技術(shù) 應(yīng)用研究

    上傳時間： 2013-12-02

    上傳用戶：tfyt

  • 基于多核處理器的彈載嵌入式系統(tǒng)設(shè)計研究

    基于實(shí)現(xiàn)目標(biāo)探測識別以及高精度目標(biāo)信息測量等復(fù)雜處理算法的目的，采用單片多核DSP TMS320C6678構(gòu)成彈載高速多任務(wù)實(shí)時嵌入式處理平臺，通過數(shù)據(jù)流處理模式的并行軟件設(shè)計方法，將系統(tǒng)處理任務(wù)均衡分配到各處理器內(nèi)核，以實(shí)現(xiàn)實(shí)時并行處理，提升彈載信息處理系統(tǒng)的功能和性能。開展基于多核處理器的并行軟件研制、充分發(fā)揮多核處理能力將成為彈載嵌入式系統(tǒng)軟件設(shè)計的新課題。

    標(biāo)簽： 多核處理器 嵌入式系統(tǒng)設(shè)計

    上傳時間： 2013-11-23

    上傳用戶：璇珠官人

  • 《例說STM32》例程源碼（含MP3播放器源碼）

    《例說STM32》例程源碼（含MP3播放器源碼）

    標(biāo)簽： STM MP3 源碼 32

    上傳時間： 2013-11-12

    上傳用戶：2218870695

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