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基于FPGA的DDS IP核設計方案

  • 資源大小:810 K
  • 上傳時間: 2013-11-06
  • 上傳用戶:1105731580
  • 資源積分:2 下載積分
  • 標      簽: FPGA DDS IP核 設計方案

資 源 簡 介

以Altera公司的Quartus Ⅱ 7.2作為開發工具,研究了基于FPGA的DDS IP核設計,并給出基于Signal Tap II嵌入式邏輯分析儀的仿真測試結果。將設計的DDS IP核封裝成為SOPC Builder自定義的組件,結合32位嵌入式CPU軟核Nios II,構成可編程片上系統(SOPC),利用極少的硬件資源實現了可重構信號源。該系統基本功能都在FPGA芯片內完成,利用 SOPC技術,在一片 FPGA 芯片上實現了整個信號源的硬件開發平臺,達到既簡化電路設計、又提高系統穩定性和可靠性的目的。

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