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光伏并網(wǎng)(wǎng)發(fā)(fā)電

  • 基于FPGA流水線CPU控制器的設(shè)計與實現(xiàn):在FPGA上設(shè)計并實現(xiàn)了一種具有MIPS風(fēng)格的CPU硬布線控制器。

    基于FPGA流水線CPU控制器的設(shè)計與實現(xiàn):在FPGA上設(shè)計并實現(xiàn)了一種具有MIPS風(fēng)格的CPU硬布線控制器。

    標(biāo)簽: FPGA CPU MIPS 控制器

    上傳時間: 2013-08-06

    上傳用戶:qw12

  • FPGA和嵌入式處理器實現(xiàn)低成本智能顯示模塊,并帶有部分源程序

    FPGA和嵌入式處理器實現(xiàn)低成本智能顯示模塊,并帶有部分源程序

    標(biāo)簽: FPGA 嵌入式處理器 顯示模塊

    上傳時間: 2013-08-06

    上傳用戶:libinxny

  • FPGA和MCU的并口通信 及MCU和E2PROM(FM25H20)SPI通信

    FPGA 和MCU的并口通信 及MCU和E2PROM(FM25H20)SPI通信   \r\n 功能:FPGA對MCU的寫(FPGA發(fā)給MCU的地址是寫進(jìn)E2PROM的地址 ,E2PROM中的數(shù)據(jù)是      FPGA發(fā)送的數(shù)據(jù)。)\r\n    FPGA對MCU的讀(FPGA讀取它發(fā)給MCU在E2PROM中存取的數(shù)據(jù))\r\n    程序和圖見附件   懇請高手指導(dǎo)  小弟急啊!

    標(biāo)簽: MCU E2PROM FPGA 25H

    上傳時間: 2013-08-15

    上傳用戶:h886166

  • 介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計實現(xiàn),采用了狀態(tài)機(jī)和流水線技術(shù)

    介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計實現(xiàn)。采用了狀態(tài)機(jī)和流水線技術(shù),使得在面積和速度上達(dá)到最佳優(yōu)化;添加了輸入和輸出接口的設(shè)計以增強(qiáng)該算法應(yīng)用的靈活性。各模塊均用硬件描述語言實現(xiàn),最終下載到FPGA芯片Stratix EP1S25F780C5中。

    標(biāo)簽: 3DES FPGA 加密算法 算法

    上傳時間: 2013-08-20

    上傳用戶:HGH77P99

  • USB、串口、并口是PC機(jī)和外設(shè)進(jìn)行通訊的常用接口

    USB、串口、并口是PC機(jī)和外設(shè)進(jìn)行通訊的常用接口,但對于數(shù)據(jù)量大的圖像來說,若利用串行RS-232協(xié)議進(jìn)行數(shù)據(jù)采集,速度不能達(dá)到圖像數(shù)據(jù)采集所需的要求;而用USB進(jìn)行數(shù)據(jù)采集,雖能滿足所需速度,但要求外設(shè)必須支持USB協(xié)議,而USB協(xié)議與常用工程軟件的接口還不普及,給使用帶來困難。有些用戶為了利用標(biāo)準(zhǔn)并行口(SPP)進(jìn)行數(shù)據(jù)采集,但SPP協(xié)議的150kb/s傳輸率對于圖像數(shù)據(jù)采集,同樣顯得太低。因此,為了采集數(shù)據(jù)量大的圖像數(shù)據(jù),本文采用了具有較高傳輸速率的增強(qiáng)型并行口協(xié)議(EPP)和FPGA,實現(xiàn)對OV

    標(biāo)簽: USB PC機(jī) 串口 并口

    上傳時間: 2013-08-31

    上傳用戶:wsf950131

  • 基于FPGA的高階高速F IR濾波器的設(shè)計與實現(xiàn)方法

    提出了一種基于FPGA的高階高速F IR濾波器的設(shè)計與實現(xiàn)方法。通過一個169階的均方根\r\n升余弦滾降濾波器的設(shè)計,介紹了如何應(yīng)用流水線技術(shù)來設(shè)計高階高速F IR濾波器,并且對所設(shè)計的\r\nFIR濾波器性能、資源占用進(jìn)行了分析。

    標(biāo)簽: FPGA 濾波器 實現(xiàn)方法

    上傳時間: 2013-08-31

    上傳用戶:小火車?yán)怖怖?/p>

  • 采用Verilog語言,實現(xiàn)了FPGA控制視頻芯片的數(shù)據(jù)采集,并將數(shù)據(jù)按幀存儲起來

    采用Verilog語言,實現(xiàn)了FPGA控制視頻芯片的數(shù)據(jù)采集,并將數(shù)據(jù)按幀存儲起來

    標(biāo)簽: Verilog FPGA 語言 控制

    上傳時間: 2013-09-01

    上傳用戶:喵米米米

  • 并口epp模式下與fpga通信例子

    并口epp模式下與fpga通信例子,附源碼

    標(biāo)簽: fpga epp 并口 模式

    上傳時間: 2013-09-03

    上傳用戶:caiqinlin

  • PROTEL練習(xí)例子(電路圖和PCB版圖并有詳細(xì)介紹)

    PROTEL練習(xí)例子(電路圖和PCB版圖并有詳細(xì)介紹)

    標(biāo)簽: PROTEL PCB 電路圖 版圖

    上傳時間: 2013-09-14

    上傳用戶:nanfeicui

  • 電位計訊號轉(zhuǎn)換器

    電位計訊號轉(zhuǎn)換器 AT-PM1-P1-DN-ADL 1.產(chǎn)品說明 AT系列轉(zhuǎn)換器/分配器主要設(shè)計使用于一般訊號迴路中之轉(zhuǎn)換與隔離;如 4~20mA、0~10V、熱電偶(Type K, J, E, T)、熱電阻(Rtd-Pt100Ω)、荷重元、電位計(三線式)、電阻(二線式)及交流電壓/電流等訊號,機(jī)種齊全。 此款薄型設(shè)計的轉(zhuǎn)換器/分配器,除了能提供兩組訊號輸出(輸出間隔離)或24V激發(fā)電源供傳送器使用外,切換式電源亦提供了安裝的便利性。上方并設(shè)計了電源、輸入及輸出指示燈及可插拔式接線端子方便現(xiàn)場施工及工作狀態(tài)檢視。 2.產(chǎn)品特點 可選擇帶指撥開關(guān)切換,六種常規(guī)輸出信號0-5V/0~10V/1~5V/2~10V/4~20mA/ 0~20mA 可自行切換。 雙回路輸出完全隔離,可選擇不同信號。 設(shè)計了電源、輸入及輸出LED指示燈,方便現(xiàn)場工作狀態(tài)檢視。 規(guī)格選擇表中可指定選購0.1%精度 17.55mm薄型35mm導(dǎo)軌安裝。 依據(jù)CE國際標(biāo)準(zhǔn)規(guī)范設(shè)計。 3.技術(shù)規(guī)格 用途:信號轉(zhuǎn)換及隔離 過載輸入能力:電流:10×額定10秒 第二組輸出:可選擇 輸入范圍:P1:0 Ω ~ 50.0 Ω / ~ 2.0 KΩ P2:0 Ω ~ 2.0 KΩ / ~ 100.0 KΩ 精確度: ≦±0.2% of F.S. ≦±0.1% of F.S. 偵測電壓:1.6V 輸入耗損: 交流電流:≤ 0.1VA; 交流電壓:≤ 0.15VA 反應(yīng)時間: ≤ 250msec (10%~90% of FS) 輸出波紋: ≤ ±0.1% of F.S. 滿量程校正范圍:≤ ±10% of F.S.,2組輸出可個別調(diào)整 零點校正范圍:≤ ±10% of F.S.,2組輸出可個別調(diào)整 隔離:AC 2.0 KV 輸出1與輸出2之間 隔離抗阻:DC 500V 100MΩ 工作電源: AC 85~265V/DC 100~300V, 50/60Hz 或 AC/DC 20~56V (選購規(guī)格) 消耗功率: DC 4W, AC 6.0VA 工作溫度: 0~60 ºC 工作濕度: 20~95% RH, 無結(jié)露 溫度系數(shù): ≤ 100PPM/ ºC (0~50 ºC) 儲存溫度: -10~70 ºC 保護(hù)等級: IP 42 振動測試: 1~800 Hz, 3.175 g2/Hz 外觀尺寸: 94.0mm x 94.0mm x 17.5mm 外殼材質(zhì): ABS防火材料,UL94V0 安裝軌道: 35mm DIN導(dǎo)軌 (EN50022) 重量: 250g 安全規(guī)范(LVD): IEC 61010 (Installation category 3) EMC: EN 55011:2002; EN 61326:2003 EMI: EN 55011:2002; EN 61326:2003 常用規(guī)格:AT-PM1-P1-DN-ADL 電位計訊號轉(zhuǎn)換器,一組輸出,輸入范圍:0 Ω ~ 50.0 Ω / ~ 2.0 KΩ,輸出一組輸出4-20mA,工作電源AC/DC20-56V

    標(biāo)簽: 電位計 訊號 轉(zhuǎn)換器

    上傳時間: 2013-11-05

    上傳用戶:feitian920

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