介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計實現(xiàn)。采用了狀態(tài)機和流水線技術(shù),使得在面積和速度上達到最佳優(yōu)化;添加了輸入和輸出接口的設(shè)計以增強該算法應用的靈活性。各模塊均用硬件描述語言實現(xiàn),最終下載到FPGA芯片Stratix EP1S25F780C5中。
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