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位同步時(shí)鐘

  • FM-DCSK混沌通信系統的原型設計

    系統發射部分由Lorenz混沌電路和調頻電路產生混沌調頻載波信號,經采樣后在FPGA中實現差分延時和調制;接收部分基于非相干相關法,位同步模塊采用相關值與能量比值作為定時測度,通過設置門限和滑動搜索窗口尋找初始同步,而后引入數字鎖相環進行相關峰值跟蹤和位同步調整。

    標簽： FM-DCSK 混沌 原型設計 通信系統

    上傳時間： 2013-10-27

    上傳用戶：wkxiian

  • HDB3編解碼器設計

    HDB3(High Density Bipolar三階高密度雙極性)碼是在AMI碼的基礎上改進的一種雙極性歸零碼，它除具有AMI碼功率譜中無直流分量，可進行差錯自檢等優點外，還克服了AMI碼當信息中出現連“0”碼時定時提取困難的缺點，而且HDB3碼頻譜能量主要集中在基波頻率以下，占用頻帶較窄，是ITU-TG.703推薦的PCM基群、二次群和三次群的數字傳輸接口碼型,因此HDB3碼的編解碼就顯得極為重要了[1]。目前，HDB3碼主要由專用集成電路及相應匹配的外圍中小規模集成芯片來實現，但集成程度不高，特別是位同步提取非常復雜，不易實現。隨著可編程器件的發展，這一難題得到了很好地解決。

    標簽： HDB3 編解碼器

    上傳時間： 2013-11-01

    上傳用戶：lindor

  • VHDL程序

    VHDL程序，使用鎖相法實現位同步的算法，并可以對算法進行仿真

    標簽： VHDL 程序

    上傳時間： 2013-12-11

    上傳用戶：123456wh

  • 數字通信系統的設計及其性能和所傳輸的數字信號的統計特性有關。所謂 加擾技術

    數字通信系統的設計及其性能和所傳輸的數字信號的統計特性有關。所謂 加擾技術，就是不增加多余度而擾亂信號，改變數字信號的統計特性，使其近 似于白噪聲統計特性的一種技術。這種技術的基礎是建立在反饋移位寄存器序 列（偽隨機序列）理論之上的。解擾是加擾的逆過程，恢復原始的數字信號。 如果數字信號具有周期性，則信號頻譜為離散的譜線，由于電路的非線 性，在多路通信系統中，這些譜線對相鄰信道的信號造成串擾。而短周期信號 經過擾碼器后，周期序列變長，譜線頻率變低，產生的非線性分量落入相鄰信 道之外，因此干擾減小。 在有些數字通信設備中，從碼元“0”和“1”的交變點提取定時信息，若 傳輸的數字信號中經常出現長的“1”或“0”游程，將影響位同步的建立和保 持。而擾碼器輸出的周期序列有足夠多的“0”、“1”交變點，能夠保證同步 定時信號的提取。

    標簽： 數字通信系統 性能 傳輸 數字信號

    上傳時間： 2014-01-23

    上傳用戶：star_in_rain

  • 基于VHDL語言的HDB3碼編譯碼器的設計 HDB3 碼的全稱是三階高密度雙極性碼

    基于VHDL語言的HDB3碼編譯碼器的設計 HDB3 碼的全稱是三階高密度雙極性碼，它是數字基帶傳輸中的一種重要碼型，具有頻譜中無直流分量、能量集中、提取位同步信息方便等優點。HDB3 碼是在AMI碼(極性交替轉換碼)的基礎上發展起來的，解決了AMI碼在連0碼過多時同步提取困難的問題

    標簽： HDB3 VHDL 語言 編譯碼器

    上傳時間： 2015-12-21

    上傳用戶：jeffery

  • dpll的verilog代碼

    dpll的verilog代碼，完成數字鎖相。用于時鐘對準，位同步。

    標簽： verilog dpll 代碼

    上傳時間： 2017-07-04

    上傳用戶：lanjisu111

  • FPGAcpld結構分析 pga的EDA設計方法 fpga中的微程序設計 復雜可編程邏輯器件cpld專題講座(Ⅴ)──cpld的應用和實現數字邏 一種使用fpga設計的DRAM控制器 用cpld器件實

    FPGAcpld結構分析 pga的EDA設計方法 fpga中的微程序設計 復雜可編程邏輯器件cpld專題講座(Ⅴ)──cpld的應用和實現數字邏 一種使用fpga設計的DRAM控制器 用cpld器件實現24位同步計數器的設計

    標簽： cpld fpga FPGAcpld DRAM

    上傳時間： 2017-07-20

    上傳用戶：ikemada

  • wcdma里面擴頻所需的0號擾碼源文件

    wcdma里面擴頻所需的0號擾碼源文件，并產生S行曲線，實現超前滯后門位同步

    標簽： wcdma 擴頻

    上傳時間： 2014-01-01

    上傳用戶：源碼3

  • 2016年浙江省電子大賽F題

    2016年浙江省電子大賽F題 位同步時鐘提取電路

    標簽： 2016 電子大賽

    上傳時間： 2016-07-26

    上傳用戶：alia

  • AVR單片機SPI通信的一種抗干擾方法.

    一般的通信中，硬件抗干擾措施只能盡量減小誤碼的概率，而不可能絕對消除誤碼，對于一般個別位的誤碼，采取適當的輔助措施后，可以不影響實用。然而，如果一次性的干擾使得通信進入不正常狀態而無法恢復，那就是嚴重的問題，不得不特別對待。在普通單片機的同步串行通信中，從機一方完全依靠主機提供的位同步時鐘來工作，沒有單獨的“群同步”機制。因此一旦時鐘信號線上出現干擾，有可能使從機的位計數發生差錯，結果是從機一方的字節界限和主機一方發生錯位。這種錯位會一直持續下去，無法恢復，造成惡性后果。大多數的應用程序中，數據傳輸中間的空閑時間往往較長，因而在這一段時間中，時鐘信號線上受到干擾的可能性也相對較大。還有，如果主機和從機程序不同時開始加電運行，也有可能一開始字節界限就有錯位.本文介紹一種在AVR單片機SPI主從式通信中較徹底消除字節錯位的設計方法。其思想是：通過聯絡信號實現群同步，而聯絡信號可以直接利用AVR的SS引腳。1 AVR的SS引腳AVR單片機SPI通信接口有四個引腳：MOSI 主機用作數據輸出，從機用作數據輸入；MISO 主機用作數據輸入，從機用作數據輸出：SCK 同步時鐘信號；ss從機選擇。

    標簽： avr 單片機 spi 通信 抗干擾

    上傳時間： 2022-06-27

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