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仿真以及代碼實現(xiàn)

  • SVPWM算法優(yōu)化及其FPGACPLD實現(xiàn).rar

    電壓空間矢量脈沖寬度調(diào)制技術(shù)是一種性能優(yōu)越、易于數(shù)字化實現(xiàn)的脈沖寬度調(diào)制方案。在常規(guī)SVPWM算法中,判定等效電壓空間矢量所處扇區(qū)位置時需要進行坐標旋轉(zhuǎn)和反正切三角函數(shù)的運算,計算特定電壓空間矢量作用時間時需要進行正弦、余弦三角函數(shù)的運算以及過飽和情況下的歸一化處理過程,同時,在整個SVPWM算法中還包含了無理數(shù)的運算,這些復(fù)雜計算不可避免地會產(chǎn)生大量計算誤差,對高精度實時控制產(chǎn)生不可忽視的影響,而且這些復(fù)雜運算的計算量大,對系統(tǒng)的處理速度要求高,程序設(shè)計復(fù)雜,系統(tǒng)運行時間長,占用系統(tǒng)資源多。因此,從工程實際應(yīng)用的角度出發(fā),需要對常規(guī)SVPWM算法進行優(yōu)化設(shè)計。 本文提出的優(yōu)化SVPWM算法,只需進行普通的四則運算,計算非常簡單,克服了上述常規(guī)SVPWM算法中的缺點,同時,采用交叉分配零電壓空間矢量,并將零電壓空間矢量的切換點置于各扇區(qū)中點的方法,達到降低三相橋式逆變電路中開關(guān)器件開關(guān)損耗的目的。SVPWM算法要求高速的數(shù)據(jù)處理能力,傳統(tǒng)的MCU、DSP都難以滿足其要求,而具有高速數(shù)據(jù)處理能力的FPGA/CPLD則可以很好的實現(xiàn)SVPWM的控制功能,在實時性、靈活性等方面有著MCU、DSP無法比擬的優(yōu)越性。本文利用MATLAB/Simulink軟件對優(yōu)化的SVPWM系統(tǒng)原型進行建模和仿真,當(dāng)仿真效果達到SVPWM系統(tǒng)控制要求后,在XilinxISE環(huán)境下采用硬件描述語言設(shè)計輸入方法與原理圖設(shè)計輸入方法相結(jié)合的混合設(shè)計輸入方法進行FPGA/CPLD的電路設(shè)計與輸入,建立相同功能的SVPWM系統(tǒng)模型,然后利用ISESimulator(VHDL/Verilog)仿真器進行功能仿真和性能分析,驗證了本文提出的SVPWM優(yōu)化設(shè)計方案的可行性和有效性。

    標簽: FPGACPLD SVPWM 算法優(yōu)化

    上傳時間: 2013-07-30

    上傳用戶:15953929477

  • 1553B總線接口技術(shù)研究及FPGA實現(xiàn).rar

    本論文在詳細研究MIL-STD-1553B數(shù)據(jù)總線協(xié)議以及參考國外芯片設(shè)計的基礎(chǔ)上,結(jié)合目前新興的EDA技術(shù)和大規(guī)模可編程技術(shù),提出了一種全新的基于FPGA的1553B總線接口芯片的設(shè)計方法。 從專用芯片實現(xiàn)的具體功能出發(fā),結(jié)合自頂向下的設(shè)計思想,給出了總線接口的總體設(shè)計方案,考慮到電路的具體實現(xiàn)對結(jié)構(gòu)進行模塊細化。在介紹模擬收發(fā)器模塊的電路設(shè)計后,重點介紹了基于FPGA的BC、RT、MT三種類型終端設(shè)計,最終通過工作方式選擇信號以及其他控制信號將此三種終端結(jié)合起來以達到通用接口的功能。同時給出其設(shè)計邏輯框圖、算法流程圖、引腳說明以及部分模塊的仿真結(jié)果。為了資源的合理利用,對其中相當(dāng)部分模塊進行復(fù)用。在設(shè)計過程中采用自頂向下、碼型轉(zhuǎn)換中的全數(shù)字鎖相環(huán)、通用異步收發(fā)器UART等關(guān)鍵技術(shù)。本設(shè)計使用VHDL描述,在此基礎(chǔ)之上采用專門的綜合軟件對設(shè)計進行了綜合優(yōu)化,在FPGA芯片EP1K100上得以實現(xiàn)。通過驗證證明該設(shè)計能夠完成BC/RT/MT三種模式的工作,能處理多種消息格式的傳輸,并具有較強的檢錯能力。 最后設(shè)計了總線接口芯片測試系統(tǒng),選擇TMS320LF2407作為主處理器,測試主要包括主處理器的自發(fā)自收驗證,加入RS232串口調(diào)試過程提高測試數(shù)據(jù)的直觀性。驗證的結(jié)果表明本文提出的設(shè)計方案是合理的。

    標簽: 1553B FPGA 總線接口

    上傳時間: 2013-06-04

    上傳用戶:ayfeixiao

  • 基于ARMDSP架構(gòu)的太陽能光伏智能并網(wǎng)逆變器.rar

    隨著世界能源危機的到來,太陽能光伏發(fā)電在能源結(jié)構(gòu)中正在發(fā)揮著越來越大的作用。而太陽能光伏發(fā)電系統(tǒng)的核心部件并網(wǎng)逆變器的性能還需要進一步提高。為了迎合市場上對高品質(zhì)、高性能、智能化并網(wǎng)逆變器的需求,我們將ARM+DSP架構(gòu)作為并網(wǎng)逆變器的控制系統(tǒng)。本系統(tǒng)集成了ARM和DSP的各自的強大功能,使并網(wǎng)逆變器的性能和智能化水平得到了顯著提高。本論文是基于山東大學(xué)魯能實習(xí)基地“光伏并網(wǎng)逆變器項目”,目前已經(jīng)試制出樣機。本人主要負責(zé)并網(wǎng)逆變器控制系統(tǒng)的軟硬件設(shè)計工作。本文主要研究內(nèi)容有: @@ 1.本并網(wǎng)逆變器采用了內(nèi)高頻環(huán)逆變技術(shù)。文中詳細分析了這種逆變器的優(yōu)缺點,進行了充分的系統(tǒng)分析和論證。 @@ 2.采用MATLAB/Simulink軟件對并網(wǎng)逆變器的控制算法進行仿真,包括前級DC-DC變換的控制算法以及后級DC-AC逆變的控制算法。通過仿真驗證了所設(shè)計算法的可行性,對DSP程序開發(fā)提供了很好的指導(dǎo)意義。 @@ 3.本文將ARM+DSP架構(gòu)作為逆變器的控制系統(tǒng),并設(shè)計了相應(yīng)的硬件控制系統(tǒng)。DSP控制板硬件系統(tǒng)包括AD數(shù)據(jù)采集、硬件電流保護、電源、eCAN總線,SPI總線等硬件電路。ARM板硬件系統(tǒng)包括SPI總線、RS232總線、RS480總線、以太網(wǎng)總線、LCD顯示、實時時鐘、鍵盤等硬件電路。 @@ 4.本文設(shè)計和實現(xiàn)了兩種最大功率點跟蹤控制算法:功率擾動觀察法或增量電導(dǎo)法;孤島檢測方法采用被動式和主動式兩種檢測方式,被動式所采用的方法是將過/欠電壓和電壓相位突變檢測相結(jié)合的方式,主動式采用正反饋頻率偏移法;為了實現(xiàn)并網(wǎng)逆變器的輸出電流與電網(wǎng)電壓同頻同相,使用了軟件鎖相環(huán)控制技術(shù)。本文分別給出了以上各種算法的控制程序流程圖。 @@ 5.本文也給出了AD數(shù)據(jù)采集、eCAN總線、RS232、RS485、以太網(wǎng)、PWM輸出等程序流程圖,以及DSP和ARM之間的SPI總線通信程序流程圖。并且分別給出了ARM管理機控制系統(tǒng)主程序流程圖和DSP控制機控制系統(tǒng)主程序流程圖。 @@ 6.最后對并網(wǎng)逆變器樣機進行實驗結(jié)果分析。結(jié)果顯示:該樣機基本上實現(xiàn)了本文提出的設(shè)計方案所應(yīng)完成的各項功能,樣機的性能比較理想。 @@關(guān)鍵詞:太陽能光伏;并網(wǎng)逆變器;SPWM; DSP; ARM

    標簽: ARMDSP 架構(gòu) 太陽能光伏

    上傳時間: 2013-07-09

    上傳用戶:趙安qw

  • 51單片機播放音樂電路仿真和代碼.rar

    51單片機播放音樂電路仿真和代碼 51單片機播放音樂電路仿真和代碼 51單片機播放音樂電路仿真和代碼

    標簽: 51單片機 播放 仿真

    上傳時間: 2013-05-31

    上傳用戶:zhangyi99104144

  • C語言程序設(shè)計實訓(xùn)100例——基于8051Proteus仿真.zip

    基礎(chǔ)的單片機Proteus仿真例子,適合缺少硬件的人。

    標簽: Proteus 8051 100 zip

    上傳時間: 2013-05-24

    上傳用戶:YYRR

  • 基于FPGA的OFDM基帶系統(tǒng)研究.rar

    近幾年來,OFDM(Orthogonal Frequency Division Multiplexing)技術(shù)引起了人們的廣泛注意,根據(jù)這項新技術(shù),很多相關(guān)協(xié)議被提出來。其中WiMax(Wireless MetropolitanArea Networks)代表空中接口滿足IEEE 802.16標準的寬帶無線通信系統(tǒng),IEEE標準在2004年定義了空中接口的物理層(PHY),即802.16d協(xié)議。該協(xié)議規(guī)定數(shù)據(jù)傳輸采用突發(fā)模式,調(diào)制方式采用OFDM技術(shù),傳輸速率較高且實現(xiàn)方便、成本低廉,已經(jīng)成為首先推廣應(yīng)用的商業(yè)化標準。 本文主要對IEEE802.16d OFDM系統(tǒng)物理層進行研究,并在XILINX公司的Virtexpro II芯片上實現(xiàn)了基帶算法。 首先討論了OFDM基本原理及其關(guān)鍵技術(shù)。根據(jù)IEEE802.16d OFDM系統(tǒng)的物理層發(fā)送端流程搭建了基帶仿真鏈路,利用MATLAB/SIMULINK仿真了OFDM系統(tǒng)在有無循環(huán)前綴(CP)、多徑數(shù)目不同等情況下的性能變化。由于同步算法和信道估計算法計算量都很大,為了找到適合采用FPGA實現(xiàn)的算法,分析了同步誤差和不同信道估計算法對接收信號的影響,并結(jié)合計算量的大小提出了一種新的聯(lián)合同步算法,以及得出了LS信道估計算法最適合802.16d系統(tǒng)的結(jié)論。 其次,完成了基帶發(fā)射機和接收機的FPGA硬件電路實現(xiàn)。為了使系統(tǒng)的時鐘頻率更高,采用了流水線的結(jié)構(gòu)。設(shè)計中采用編寫Verilog程序和使用IP核相結(jié)合的辦法,實現(xiàn)了新的聯(lián)合同步算法,并且通過簡化結(jié)構(gòu),避免了信道估計算法中的繁瑣除法。利用ISE9. 2i和Modelsim6.Oc軟件平臺對程序進行設(shè)計、綜合和仿真,并將仿真結(jié)果和MATLAB軟件計算結(jié)果相對比。結(jié)果表明,采用16位數(shù)據(jù)總線可達到理想的精度。 最后,采用串口通信的方式對基帶系統(tǒng)進行了驗證。通過串口通信從功能上表明該系統(tǒng)確實可行。 關(guān)鍵詞:IEEE802. 16d; OFDM; 同步;信道估計;基帶系統(tǒng)

    標簽: FPGA OFDM 基帶

    上傳時間: 2013-07-31

    上傳用戶:1757122702

  • 射頻功放數(shù)字預(yù)失真技術(shù)研究及其FPGA實現(xiàn).rar

    隨著無線通信技術(shù)的不斷發(fā)展和社會需求的日益增長,對通信系統(tǒng)的傳輸質(zhì)量和容量的要求也越來越大。現(xiàn)代通信系統(tǒng)為了追求更高的數(shù)據(jù)速率和頻譜效率,更趨向于采用非恒定包絡(luò)的調(diào)制方式,而非恒定包絡(luò)調(diào)制方式對功率放大器的非線性非常敏感,加上現(xiàn)代通信系統(tǒng)對功率放大器的效率提出了更高的要求,以及功率放大器本身有限的線性度,這就使功率放大器線性化技術(shù)成為無線通信系統(tǒng)的關(guān)鍵技術(shù)之一。 本文對功率放大器的線性化技術(shù)進行了系統(tǒng)的研究。首先,介紹功率放大器的非線性特性、記憶效應(yīng)產(chǎn)生原理和常見的各種線性化技術(shù),重點研究了目前流行的自適應(yīng)數(shù)字預(yù)失真技術(shù)原理。其次,介紹了功率放大器的無記憶模型和有記憶模型,以及兩種實用的預(yù)失真實現(xiàn)方法--查表法和多項式法,在此基礎(chǔ)上重點研究了基于QRD_RLS自適應(yīng)算法的記憶多項式法預(yù)失真技術(shù),對該算法進行了Matlab仿真分析,為后面的FPGA實現(xiàn)奠定基礎(chǔ)。最后,確定了數(shù)字預(yù)失真實現(xiàn)的架構(gòu),介紹了與QRD_RLS算法實現(xiàn)相關(guān)的CORDIC技術(shù)、復(fù)數(shù)Givens旋轉(zhuǎn)及Systolic陣等原理,詳細闡述了基于CORDIC技術(shù)的復(fù)數(shù)QRD_RLS算法的Systolic實現(xiàn),從而在FPGA上實現(xiàn)了數(shù)字預(yù)失真。 在軟件無線電思想的指導(dǎo)下,本文利用System Generator軟件完成了基于QRD_RLS算法的記憶多項式法的數(shù)字預(yù)失真的FPGA設(shè)計,并且在硬件平臺上檢驗了預(yù)失真效果。

    標簽: FPGA 射頻功放 數(shù)字預(yù)失真

    上傳時間: 2013-04-24

    上傳用戶:84425894

  • 基于FPGA的電壓波動與閃變測量的數(shù)字化實現(xiàn)研究.rar

    隨著我國工業(yè)和國民經(jīng)濟的快速發(fā)展,電網(wǎng)負荷急劇增加,特別是沖擊性、非線性負荷所占比重不斷加大,使得供電電壓發(fā)生波動和閃變,嚴重影響著電網(wǎng)的電能質(zhì)量。根據(jù)國際電工委員會(IEC)電磁兼容(EMC)標準IEC61000-3-7以及國標GB12326-2000,電壓波動和閃變己成為衡量電能質(zhì)量的重要指標。 電壓波動和閃變作為衡量電能質(zhì)量的重要指標,能更直接、迅速地反映出電網(wǎng)的供電質(zhì)量。然而,目前國內(nèi)還沒有很好的電壓波動與閃變測量的數(shù)字信號處理方法。為此,論文在深入研究電壓波動和閃變測量技術(shù)的基礎(chǔ)上,提出一種基于Simulink/DSP Builder的數(shù)字信號處理的FPGA設(shè)計方法,利用DSP Builder工具將Simulink的模型文件(.mdl)轉(zhuǎn)化成通用的硬件描述語言VHDL文件,避免了VHDL語言手動編寫系統(tǒng)的煩瑣過程,從而能夠?qū)⒏嗑杏谙到y(tǒng)算法的優(yōu)化上。該方法充分利用Matlab/Simulink系統(tǒng)建模的優(yōu)勢,同時也能夠發(fā)揮FPGA并行執(zhí)行速度快、測量精度高的優(yōu)點。 論文首先介紹了電壓波動和閃變的基木概念、特征量,闡述了電壓波動與閃變的測量原理,分析比較了現(xiàn)有測量方法和裝置的特點和優(yōu)劣。然后依據(jù)電壓波動與閃變測量的IEC標準以及國家標準,在對電壓波動與閃變測量模擬仿真的基礎(chǔ)上研究其數(shù)字化實現(xiàn)方法,即采用數(shù)字濾波的方式在Simulink/DSP Builder工具下設(shè)計電壓波動與閃變測量系統(tǒng)的數(shù)字模型。同時在ModelSim SE6.1d軟件下進行了系統(tǒng)功能仿真,并且在Altera公司的FPGA設(shè)計軟件QuartusⅡ6.0下進行了系統(tǒng)時序仿真。 仿真結(jié)果表明,基于Simulink/DSP Builder窗口化的數(shù)字信號處理的FPGA設(shè)計方案,設(shè)計簡單、快捷高效,能夠滿足電壓波動和閃變測量最初的系統(tǒng)設(shè)計要求,為進一步從事電壓波動和閃變測量研究提供了一種全新的設(shè)計理念,具有一定的理論與現(xiàn)實意義。

    標簽: FPGA 電壓波動 測量

    上傳時間: 2013-07-10

    上傳用戶:笨小孩

  • 基于FPGA的高頻PWM開關(guān)電源控制器設(shè)計.rar

    電力電子裝置的控制技術(shù)隨著電力電子技術(shù)的發(fā)展而愈來愈復(fù)雜。開關(guān)電源是現(xiàn)代電力電子設(shè)備中不可或缺的組成部分,其質(zhì)量的優(yōu)劣以及體積的大小直接影響電子設(shè)備整體性能。高頻化、小型化、數(shù)字化是開關(guān)電源的發(fā)展方向。 在應(yīng)用數(shù)字技術(shù)進行控制系統(tǒng)設(shè)計時,數(shù)字控制器的性能決定了控制系統(tǒng)的整體性能。數(shù)字化電力電子設(shè)備中的控制部分多以MCU/DSP為核心,以軟件實現(xiàn)離散域的運算及控制。在很多高頻應(yīng)用的場合,目前常用的控制器(高性能單片機或DSP)的速度往往不能完全滿足要求。FPGA具有設(shè)計靈活、集成度高、速度快、設(shè)計周期短等優(yōu)點,與單片機和DSP相比,F(xiàn)PGA具有更高的處理速度。同時FPGA應(yīng)用在數(shù)字化電力電子設(shè)備中,還可以大大簡化控制系統(tǒng)結(jié)構(gòu),并可實現(xiàn)多種高速算法,具有較高的性價比。 依據(jù)FPGA的這些突出優(yōu)點,本文將FPGA應(yīng)用于直流開關(guān)電源控制器設(shè)計中,以實現(xiàn)開關(guān)電源數(shù)字化和高頻化的要求。主要研究工作如下: 介紹了基于FPGA的DC/DC數(shù)字控制器中A/D采樣控制、數(shù)字PI算法的實現(xiàn);重點描述了采用混合PWM方法實現(xiàn)高分辨率、高精度數(shù)字PWM的設(shè)計方案,并對各模塊進行了仿真測試;用FPGA開發(fā)板進行了一部分系統(tǒng)的仿真和實際結(jié)果的檢測,驗證了文中的分析結(jié)論,證實了可編程邏輯器件在直流開關(guān)電源控制器設(shè)計中的應(yīng)用優(yōu)勢。

    標簽: FPGA PWM 高頻

    上傳時間: 2013-07-23

    上傳用戶:qulele

  • 基于FPGA的IDE固態(tài)硬盤控制器的設(shè)計與實現(xiàn).rar

    固態(tài)硬盤是一種以FLASH為存儲介質(zhì)的新型硬盤。由于它不像傳統(tǒng)硬盤一樣以高速旋轉(zhuǎn)的磁盤為存儲介質(zhì),不需要浪費大量的尋道時間,因此它有著傳統(tǒng)硬盤不可比擬的順序和隨機存儲速度。同時由于固態(tài)硬盤不存在機械存儲結(jié)構(gòu),因此還具有高抗震性、無工作噪音、可適應(yīng)惡劣工作環(huán)境等優(yōu)點。隨著計算機技術(shù)的高速發(fā)展,固態(tài)硬盤技術(shù)已經(jīng)成為未來存儲介質(zhì)技術(shù)發(fā)展的必然趨勢。 本文以設(shè)計固態(tài)硬盤控制芯片IDE接口部分為項目背景,通過可編程邏輯器件FPGA,基于ATA協(xié)議并使用硬件編程語言verilog,設(shè)計了一個位于設(shè)備端的IDE控制器。該IDE控制器的主要作用在于解析主機所發(fā)送的IDE指令并控制硬盤設(shè)備進行相應(yīng)的狀態(tài)遷移和指令操作,從而完成硬盤設(shè)備端與主機端之間基本的狀態(tài)通信以及數(shù)據(jù)通信。論文主要完成了幾個方面的內(nèi)容。第一:論文從固態(tài)硬盤的基本結(jié)構(gòu)出發(fā),分析了固態(tài)硬盤IDE控制器的功能性需求以及寄存器傳輸、PIO傳輸和UDMA傳輸三種ATA協(xié)議主要傳輸模式所必須遵循的時序要求,并概括了IDE控制器設(shè)計的要點和難點;第二:論文設(shè)計了IDE控制器的總體功能框架,將IDE控制器從功能上分為寄存器部分、頂層控制模塊、異步FIFO模塊、PIO控制模塊、UDMA控制模塊以及CRC校驗?zāi)K六大子功能模塊,并分析了各個子功能模塊的基本工作原理和具體功能設(shè)計;第三:論文以設(shè)計狀態(tài)機流程和主要控制信號的方式實現(xiàn)了各個具體子功能模塊并列舉了部分關(guān)鍵代碼,同時給出了主要子功能模塊的時序仿真圖;最后,論文給出了基于PIO傳輸模式和基于UDMA傳輸模式的具體指令操作流程實現(xiàn),并通過SAS邏輯分析儀和QuartusⅡ?qū)DE控制器進行了功能測試和分析,驗證了本論文設(shè)計的正確性。

    標簽: FPGA IDE 固態(tài)硬盤

    上傳時間: 2013-07-31

    上傳用戶:liangrb

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