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中頻接收機(jī)(jī)

  • CCS中的graph詳細(xì)使用說明

    CCS中的graph詳細(xì)使用說明

    標(biāo)簽: graph CCS 使用說明

    上傳時間: 2013-07-30

    上傳用戶:1043041441

  • 智能讀寫IC設(shè)備的軟硬件系統(tǒng)設(shè)計

    隨著電子信息技術(shù)的發(fā)展和國際國內(nèi)成品油零售市場的激烈競爭,中國石油的成品油零售必須實行IC卡加油和信息化管理,從而實現(xiàn)“一卡在手、全國加油”。 本項目在原有基于ARM處理器的加油POS機(jī)基礎(chǔ)上進(jìn)行非接觸CP[J卡讀卡改造,深入研究了非接觸卡的原理以及卡片操作系統(tǒng)(COS),尤其是非接觸卡相對于接觸卡的先進(jìn)性和可靠性;在加油POS機(jī)上進(jìn)行非接觸CPU卡讀卡模塊改造,成功的實現(xiàn)了接觸卡接口協(xié)議和非接觸卡接口協(xié)議的軟硬件轉(zhuǎn)換,一定程度上降低了新設(shè)備研發(fā)的成本并符合中石油的項目進(jìn)度要求。該項目的試點成功為中石油在全國范圍內(nèi)實現(xiàn)所有的加油設(shè)備進(jìn)行非接觸卡改造積累了技術(shù)基礎(chǔ)及工程實施的經(jīng)驗。通過非接觸卡讀卡的可靠性研究,為非接觸CPU卡在石油行業(yè)的廣泛應(yīng)用奠定了很好的基礎(chǔ),同時為公司爭取更多的設(shè)備改造項目贏得了諸多的積累和支持。

    標(biāo)簽: 智能讀寫 設(shè)備 系統(tǒng)設(shè)計 軟硬件

    上傳時間: 2013-07-03

    上傳用戶:希醬大魔王

  • 高動態(tài)GPS接收機(jī)CA碼的接收

    GPS(全球定位系統(tǒng))是美國建立的高精度衛(wèi)星定位導(dǎo)航系統(tǒng),高動態(tài)GPS接收機(jī)可應(yīng)用于衛(wèi)星、飛機(jī)、高速列車等許多場合。高動態(tài)給GPS信號帶來很大的多普勒頻移和多普勒頻移變化率,普通民用接收機(jī)無法正常工作。適用于高動態(tài)條件的接收機(jī)可以有效消除多普勒頻移及其變化率對信號接收的影響,提高導(dǎo)航定位精度。 本文在深入研究GPS的系統(tǒng)組成、工作原理以及信號格式的基礎(chǔ)上,重點研究高動態(tài)條件下C/A碼和載波的捕獲與跟蹤方案。論文的主要工作如下: 1.深入研究擴(kuò)頻信號的各種捕獲算法,提出了一種適用于高動態(tài)的基于FFT的C/A碼快速捕獲算法; 2.研究擴(kuò)頻碼跟蹤和載波跟蹤技術(shù),設(shè)計了載波輔助的碼跟蹤環(huán)路——數(shù)字延遲鎖定環(huán)(DLL)及一種叉積自動頻率跟蹤環(huán)(CPAFC)與科斯塔斯(Costas)環(huán)相結(jié)合的載波跟蹤方案,并在MATLAB環(huán)境下建立系統(tǒng)模型,對環(huán)路參數(shù)進(jìn)行了詳細(xì)的設(shè)計; 3.初步完成了GPS接收機(jī)基帶處理模塊核心單元的FPGA設(shè)計和功能仿真。

    標(biāo)簽: GPS 動態(tài) 接收機(jī) 接收

    上傳時間: 2013-07-10

    上傳用戶:suxuan110425

  • 基于DSP和FPGA的CDMA多用戶檢測技術(shù)

    隨著社會的進(jìn)步及移動用戶的迅猛增長,第三代移動通信越來越受到各界的重視。多用戶檢測技術(shù)是第三代移動通信中重要的技術(shù)之一;常規(guī)CDMA接收機(jī)采用匹配濾波器的結(jié)構(gòu),但是這種結(jié)構(gòu)的接收機(jī)并沒有考慮到信道中多址干擾的存在,使彼此間影響減少來提高系統(tǒng)容量;而功控的方法也沒有從接收信號中真正去除多址干擾,只能緩解這種矛盾,不能從根本上解決問題。要想真正消除干擾,大幅度提高系統(tǒng)容量,必須通過多址對消和多用戶檢測技術(shù)。 本文首先介紹了CDMA的基本原理和多用戶檢測的基本原理。然后重點介紹和分析各種多用戶檢測的原理,然后依據(jù)多用戶檢測的四個技術(shù)指標(biāo)對各種多用戶檢測的方法進(jìn)行比較,從中選擇實現(xiàn)簡單,性能優(yōu)越的解相關(guān)檢測器來作為實現(xiàn)的標(biāo)的算法。 然后,本文重點研究分析解相關(guān)檢測器的原理,給出了實現(xiàn)解相關(guān)檢測器的系統(tǒng)設(shè)計的流程,其中包括硬件電路的搭建和軟件實現(xiàn)的方法。硬件電路是基于DSP(TI公司的TMS320C5402)和FPGA(Altera公司的EP1K10Q208-3)來完成。軟件部分主要采用C語言來完成。 本文系統(tǒng)研究了多用戶檢測技術(shù),并實現(xiàn)了解相關(guān)算法,在理論研究和實際應(yīng)用方面都有一定的價值。

    標(biāo)簽: CDMA FPGA DSP 多用

    上傳時間: 2013-07-29

    上傳用戶:anpa

  • 基于FPGA的JPEG壓縮系統(tǒng)設(shè)計與實現(xiàn)

    對弓網(wǎng)故障的檢測在列車提速的今天顯得尤其重要,原始故障圖像數(shù)據(jù)量的巨大使實時存儲和傳輸故障圖像極其困難。JPEG作為一種低復(fù)雜度、高壓縮比的圖像壓縮標(biāo)準(zhǔn)在多媒體、網(wǎng)絡(luò)傳輸?shù)阮I(lǐng)域得到廣泛的應(yīng)用。和相同圖像質(zhì)量的其它常用文件格式(如GIF,TIFF,PCX)相比,JPEG是目前靜態(tài)圖像中壓縮比最高的。 FPGA以其設(shè)計靈活、高速的卓越特性,逐漸成為許多應(yīng)用中首先器件,尤其是與Verilog和VHDL等語言的結(jié)合,大大變革了電子系統(tǒng)的設(shè)計方法,加速了系統(tǒng)的設(shè)計進(jìn)程。 本文旨在研究并實現(xiàn)一種實時采集并對特定幀進(jìn)行壓縮傳輸?shù)姆椒āMㄟ^采用可編程邏輯器件FPGA來實現(xiàn)整個采集、顯示、壓縮和傳輸,使系統(tǒng)具有可定制、高速度等優(yōu)點。 本文首先介紹了開發(fā)硬件可編程邏輯門陣列FPGA及其開發(fā)語言Veridlog,并介紹了FPGA的設(shè)計方法及開發(fā)流程;接著介紹了PAL制視頻采集的相關(guān)知識及設(shè)計,其中主要包括基于I2C總線的模擬視頻解碼控制、視頻的數(shù)字化ITU-R BT.601標(biāo)準(zhǔn)介紹及視頻同步信號的獲取、基于SDRAM的視頻幀存儲、VGA顯示控制設(shè)計;隨后介紹了JPEG標(biāo)準(zhǔn),并根據(jù)故障檢測的特點,設(shè)計了針對灰度圖像壓縮的JPEG編碼器,設(shè)計中先分別對組成JPEG編碼器的二維DCT變換模塊、量化模塊、Z字掃描模塊、變換直流系數(shù)的差分脈沖編碼模塊、交流系數(shù)的游程編碼模塊、哈夫曼編碼模塊及打包模塊進(jìn)行了仿真測試,然后再對整個JPEG編碼器進(jìn)行了測試;最后設(shè)計了單幀視頻的SRAM緩存,并將緩存的源圖像采用本文設(shè)計的JPEG編碼器進(jìn)行壓縮,再設(shè)計一個僅包含發(fā)送功能的UART 將壓縮后的碼流傳輸?shù)絇C機(jī),在PC機(jī)上通過將接收的碼流以ASCⅡ碼的形式還原為采集圖片。 本文實現(xiàn)了整個采集壓縮系統(tǒng),同時也進(jìn)一步驗證了本文設(shè)計的灰度圖像JPEG編碼器的正確性。相信本文無論是對弓網(wǎng)故障的圖像檢測,還是對于JPEG編碼器的芯片設(shè)計都有一定的參考價值。

    標(biāo)簽: FPGA JPEG 壓縮系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:cuiqiang

  • 短波差分跳頻通信系統(tǒng)的研究

    差分跳頻(DFH)是集跳頻圖案、信息調(diào)制與解調(diào)于一體,是一個全面基于數(shù)字信號處理的全新概念的通信系統(tǒng),其技術(shù)體制和原理與常規(guī)跳頻完全不同,較好地解決了數(shù)據(jù)速率和跟蹤干擾等問題,代表了當(dāng)前短波通信的一個重要發(fā)展方向。美國Sanders公司推出了名為CHESS的新型短波跳頻通信系統(tǒng),并獲得了成功,但我國對該體制和技術(shù)的研究還處于初始階段,目前還不太成熟,離實際應(yīng)用還有一段距離。 本文主要基于FPGA芯片的基礎(chǔ)上對差分跳頻進(jìn)行了研究,用FPGA來實現(xiàn)數(shù)字信號處理可以很好地解決并行性和速度問題,而且其靈活的可配置特性,使得FPGA構(gòu)成的DSP系統(tǒng)非常易于修改、測試及硬件升級。而且設(shè)計中盡量采用軟件無線電體系結(jié)構(gòu),減少模擬環(huán)節(jié),把數(shù)字化處理盡量靠近天線,從而建立一個通用、標(biāo)準(zhǔn)、模塊化的硬件平臺,用軟件編程來實現(xiàn)差分跳頻的各種功能,從基于硬件的設(shè)計方法中解放出來。 本文首先介紹了課題背景及研究的意義,闡述了目前差分跳頻中頻率合成跟頻率識別的實現(xiàn)方案。在頻率合成中,著重對DDS的相位截斷誤差及幅度量化誤差進(jìn)行仿真,找出基于FPGA實現(xiàn)的最佳參數(shù)及改善方法。在頻率識別中,基于Xilinx公司提供FFT IP核,接收端中的位同步,頻率識別均在FFT的理論上進(jìn)行設(shè)計。最后根據(jù)設(shè)計方案制作基于FPGA的電路板。 設(shè)計中跳頻圖案、直接數(shù)字頻率合成器、頻率識別、位同步、跳頻圖案恢復(fù)、線性調(diào)頻z變換等模塊均采用Verilog和VHDL兩種通用硬件描述語言進(jìn)行設(shè)計,以便能夠在所有廠家的FPGA芯片中移植。

    標(biāo)簽: 短波差分 跳頻通信

    上傳時間: 2013-07-22

    上傳用戶:yezhihao

  • 基于FPGA的光接收機(jī)數(shù)據(jù)恢復(fù)電路

    隨著信息產(chǎn)業(yè)的不斷發(fā)展,人們對數(shù)據(jù)傳輸速率要求越來越高,從而對數(shù)據(jù)發(fā)送端和接收端的性能都提出了更高的要求。接收機(jī)的一個重要任務(wù)就是在于克服各種非理想因素的干擾下,從接收到的被噪聲污染的數(shù)據(jù)信號中提取同步信息,并進(jìn)而將數(shù)據(jù)正確的恢復(fù)出來。而數(shù)據(jù)恢復(fù)電路是光纖通信和其他許多類似數(shù)字通信領(lǐng)域中不可或缺的關(guān)鍵電路,其性能決定了接收端的總體性能。 目前,數(shù)據(jù)恢復(fù)電路的結(jié)構(gòu)主要有“時鐘提取”和“過采樣”兩種結(jié)構(gòu)。基于“過采樣”的數(shù)據(jù)恢復(fù)方法的關(guān)鍵是過采樣,即通過引入?yún)⒖紩r鐘,并增加時鐘源個數(shù)的方式來代替第一種方法中的“時鐘提取”。與“時鐘提取”的數(shù)據(jù)恢復(fù)方法相比,基于“過采樣”的數(shù)據(jù)恢復(fù)方法在性能上還有較大的差距,但是后者擁有高帶寬、立即鎖存能力、較低的等待時間和更高的抖動容限,更易于通過數(shù)字的方法實現(xiàn),實現(xiàn)更簡單,成本更低,并且這是一種數(shù)字化的模擬技術(shù)。如果能通過“過采樣”方法在普通的邏輯電路上實現(xiàn)622.08Mb/s甚至更高速率的數(shù)據(jù)恢復(fù),并將它作為一個IP模塊來代替專用的時鐘恢復(fù)芯片,這無疑將是性能和成本的較好結(jié)合。 本文主要研究“過采樣”數(shù)據(jù)恢復(fù)電路的基本原理,通過全數(shù)字的設(shè)計方法,給出了在低成本可編程器件FPGA上實現(xiàn)數(shù)據(jù)恢復(fù)電路兩種不同的過采樣的實現(xiàn)方案,即基于時鐘延遲的過采樣和基于數(shù)據(jù)延遲的過采樣。基于時鐘延遲的過采樣數(shù)據(jù)恢復(fù)電路方案,通過測試驗證,其最高恢復(fù)的數(shù)據(jù)傳輸率可達(dá)到640Mb/s。測試結(jié)果表明,采用該方案實現(xiàn)的時鐘恢復(fù)電路可工作在光纖通信系統(tǒng)STM-4速率級,即622.08MHz頻率上,各方面指標(biāo)基本符合要求。

    標(biāo)簽: FPGA 光接收機(jī) 數(shù)據(jù)恢復(fù) 電路

    上傳時間: 2013-04-24

    上傳用戶:axxsa

  • 基于FPGA的紅外遙控電子密碼鎖的實現(xiàn)

    本文介紹了一種基于現(xiàn)場可編程門陣列FPGA器件的電子密碼鎖的設(shè)計方法。重點闡述了紅外遙控電子密碼鎖的整體架構(gòu)設(shè)計;介紹了一種由PT2248作為發(fā)送器,MIM-R1AA 38KHZ紅外一體化接收解調(diào)器作為接收器的紅外遙控系統(tǒng)的構(gòu)建方法;詳細(xì)說明了如何運(yùn)用EDA技術(shù)自頂向下的設(shè)計方法,來實現(xiàn)基于XILINX公司出品的Spartan-3E系列FPGA芯片的紅外遙控解碼、密碼鎖的解鎖、密碼修改、報警提示及液晶顯示等功能。在分析紅外遙控電子密碼鎖各功能模塊時,本論文詳細(xì)闡述了各模塊的功能及外部接口信號,給出了各模塊的仿真波形以及整個系統(tǒng)的測試流程和測試結(jié)果。本論文在介紹Spartan-3E系列FPGA芯片的特點和性能的同時,利用Spartan-3E系列的XC3S500芯片中的KCPSM3和自行設(shè)計完成的狀態(tài)機(jī)控制器分別實現(xiàn)液晶顯示控制器,通過比較分析得知KCPSM3實現(xiàn)的控制器,在對FPGA的資源利用方面更加合理,實現(xiàn)更加便捷。 本論文利用紅外遙控技術(shù)解鎖,大大提高了電子密碼鎖的安全性能;采用FPGA開發(fā)設(shè)計,所有算法完全由硬件電路來實現(xiàn),使得系統(tǒng)的工作可靠性大為提高,同時由于FPGA具有在系統(tǒng)可編程功能,當(dāng)設(shè)計需要更改時,只需更改FPGA中的控制和接口電路,利用EDA工具將更新后的設(shè)計下載到FPGA中即可,無需更改外部電路的設(shè)計,大大提高了設(shè)計的效率。因此,采用FPGA開發(fā)的數(shù)字系統(tǒng),不僅具有很高的工作可靠性,其升級與改進(jìn)也極其方便。

    標(biāo)簽: FPGA 紅外遙控 電子密碼鎖

    上傳時間: 2013-06-19

    上傳用戶:111111112

  • 基于FPGA的激光測距數(shù)據(jù)處理系統(tǒng)

    激光測距是隨著激光技術(shù)的出現(xiàn)而發(fā)展起來的一種精密測量技術(shù),因其良好的精確度特性廣泛地應(yīng)用在軍事和民用領(lǐng)域。但傳統(tǒng)的激光測距系統(tǒng)大多采用分立的單元電路搭建而成,不僅造成了開發(fā)成本較高,電路較復(fù)雜,調(diào)試?yán)щy等諸多問題,而且這種系統(tǒng)體積和重量較大,嚴(yán)重阻礙了激光測距系統(tǒng)的普及應(yīng)用,因此近年來激光測距技術(shù)向著小型化和集成化的方向發(fā)展。本文就旨在找出一種激光測距的集成化方案,將激光接收電路部分集成為一個專用集成電路,使傳統(tǒng)的激光測距系統(tǒng)簡化成三個部分,激光器LD、接收PD和一片集成電路芯片。 本文設(shè)計的激光測距系統(tǒng)基于相位差式激光測距原理,綜合當(dāng)前所有的測相技術(shù),提出了一種基于FPGA的芯片運(yùn)用DCM的動態(tài)移相功能實現(xiàn)相位差測量的方法。該方法實現(xiàn)起來方便快捷,無需復(fù)雜的過程計算,不僅能夠達(dá)到較高的測距精度,同時可以大大簡化外圍電路的設(shè)計,使測距系統(tǒng)達(dá)到最大程度的集成化,滿足了近年來激光測距系統(tǒng)向小型化和集成化方向發(fā)展的要求,除此,該方法還可以減少環(huán)境因素對測距誤差的影響,降低測距系統(tǒng)對測試環(huán)境的要求。本論文的創(chuàng)新點有: 1.基于方波實現(xiàn)激光的調(diào)制和發(fā)射,簡化了復(fù)雜的外圍電路設(shè)計; 2.激光測距的數(shù)據(jù)處理系統(tǒng)在一片F(xiàn)PGA芯片上實現(xiàn),便于系統(tǒng)的集成。 在基于DCM的激光測距方案中,本文詳細(xì)的敘述了利用DCM測相的基本原理,并給出了由相位信息得到距離信息的計算過程,然后將利用不同測尺測得的結(jié)果進(jìn)行合成,并最終將距離的二進(jìn)制信息轉(zhuǎn)換成十進(jìn)制顯示出來。本文以Xilinx公司Virtex-II Pro開發(fā)板做為開發(fā)平臺,通過編程和仿真驗證了該測距方案的可行性。在采用多次測量求平均值的情況下,該測距方案的測距精度可以達(dá)到3mm,測距量程可達(dá)100m。該方案設(shè)計新穎,可將整個的數(shù)據(jù)處理系統(tǒng)在FPGA芯片中實現(xiàn),為最終的專用集成芯片的設(shè)計打下了基礎(chǔ),有利于測距系統(tǒng)的集成單片化。

    標(biāo)簽: FPGA 激光測距 數(shù)據(jù)處理

    上傳時間: 2013-06-20

    上傳用戶:lili1990

  • 基于FPGA的擴(kuò)頻通信系統(tǒng)的實現(xiàn)

    擴(kuò)頻通信技術(shù)是信息時代的三大高技術(shù)通信傳輸方式之一,與常規(guī)的通信技術(shù)相比。具有低截獲率、強(qiáng)抗噪聲、抗干擾性,具有信息隱蔽和多址通信等特點,目前已從軍事領(lǐng)域向民用領(lǐng)域迅速發(fā)展。在民用化之后,它被迅速推廣到各種公用和專用通信網(wǎng)絡(luò)之中,如衛(wèi)星通信、數(shù)據(jù)傳輸、定位、測距等系統(tǒng)中。 擴(kuò)頻通信技術(shù)中,最常見的是直接序列擴(kuò)頻通信(DSSS)系統(tǒng),然而目前專用擴(kuò)頻芯片大部分功能都已固化。缺少產(chǎn)品開發(fā)的靈活性。其次,目前用FPGA與DSP相結(jié)合實現(xiàn)的直接序列擴(kuò)頻的收發(fā)系統(tǒng)比較多,系統(tǒng)復(fù)雜且成本高。另外,現(xiàn)代擴(kuò)頻通信系統(tǒng)在接收和發(fā)送端需要完成許多快速復(fù)雜的信號處理,這對電路的可靠性和處理速度提出了更高的要求。因此,設(shè)計一個全部用FPGA技術(shù)實現(xiàn)的擴(kuò)頻通信收、發(fā)系統(tǒng)具有較強(qiáng)的實際應(yīng)用價值。 根據(jù)FPGA的高速并行處理能力和全硬件實現(xiàn)的特點,采用直接序列擴(kuò)頻技術(shù),借助QuartusⅡ6.0及Protel99se工具,完成了系統(tǒng)的軟件仿真和硬件電路設(shè)計。實驗結(jié)果表明,比用傳統(tǒng)的FPGA與DSP相結(jié)合實現(xiàn)方式,提高了處理速度,減少了硬件延時。同時采用了流水線技術(shù),提高了系統(tǒng)并行處理的能力。并且系統(tǒng)功能可以通過程序來修改和升級,與專用擴(kuò)頻芯片相比,具有很大的靈活性。所有模塊都集成在一個芯片中,提高了系統(tǒng)的穩(wěn)定性和可靠性。

    標(biāo)簽: FPGA 擴(kuò)頻通信

    上傳時間: 2013-05-18

    上傳用戶:天天天天

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