本文檔主要是以Altera公司的Stratix II系列的FPGA器件為例,介紹了其內(nèi)嵌的增強型可重配置PLL在不同的輸入時鐘頻率之間的動態(tài)適應(yīng),其目的是通過提供PLL的重配置功能,使得不需要對FPGA進(jìn)行重新編程就可以通過軟件手段完成PLL的重新配置,以重新鎖定和正常工作。
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