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基于FPGA的數字頻率計的設計11利用VHDL 硬件描述語言設計,并在EDA(電子設計自動化) 工具的幫助下,用大規模可編程邏輯器件(FPGA/ CPLD) 實現數字頻率計的設計原理及相關程序

  • 資源大小:651 K
  • 上傳時間: 2013-11-25
  • 上傳用戶:dounob
  • 資源積分:2 下載積分
  • 標      簽: FPGA CPLD VHDL EDA

資 源 簡 介

基于FPGA的數字頻率計的設計11利用VHDL 硬件描述語言設計,并在EDA(電子設計自動化) 工具的幫助下,用大規模可編程邏輯器件(FPGA/ CPLD) 實現數字頻率計的設計原理及相關程序

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