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verilog code 16-bit carry look-ahead adder output [15:0] sum // 相加總和 output carryout // 進位 input

  • 資源大小:3 K
  • 上傳時間: 2014-12-06
  • 上傳用戶:xushenghao001
  • 資源積分:2 下載積分
  • 標      簽: output look-ahead carryout verilog

資 源 簡 介

verilog code 16-bit carry look-ahead adder output [15:0] sum // 相加總和 output carryout // 進位 input [15:0] A_in // 輸入A input [15:0] B_in // 輸入B input carryin // 第一級進位 C0

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