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用VHDL語言采用串行方法實現用1位全加器實現4位全加器

  • 資源大小:192 K
  • 上傳時間: 2016-05-27
  • 上傳用戶:zm250063191
  • 資源積分:2 下載積分
  • 標      簽: VHDL 全加器 語言 串行

資 源 簡 介

用VHDL語言采用串行方法實現用1位全加器實現4位全加器

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