RS編碼,verilog編寫,可以自定義多項(xiàng)式,(255,233)和(204,188)均可。
資源簡(jiǎn)介:RS編碼的源代碼使用Verilog在Xinloinx平臺(tái)
上傳時(shí)間: 2013-12-17
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資源簡(jiǎn)介:本程序仿真做出了一個(gè)RS編碼器。運(yùn)行本軟件,可得到一個(gè)可視化界面,按界面提示隨意輸入信息序列,即可對(duì)其進(jìn)行RS編碼。一般的RAR解壓即可
上傳時(shí)間: 2014-01-04
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資源簡(jiǎn)介:VC下實(shí)現(xiàn)RS編碼、解碼功能,功能比較完善,在vc下編譯通過
上傳時(shí)間: 2013-12-26
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資源簡(jiǎn)介:(31,25)RS編碼及解碼matlab程序
上傳時(shí)間: 2014-01-19
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資源簡(jiǎn)介:RS編碼vvhdl 希望能通過 我不曉得具體對(duì)大家有用否 希望懂RS編碼的多多交流
上傳時(shí)間: 2015-06-29
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資源簡(jiǎn)介:應(yīng)用于無線通信的RS編碼和OFDM調(diào)制源程序。64點(diǎn)FFT,19個(gè)子載波。調(diào)制輸 出速率8K。
上傳時(shí)間: 2015-08-17
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資源簡(jiǎn)介:經(jīng)典的里德索羅蒙碼RS編碼的dsp開發(fā)的c語言代碼。
上傳時(shí)間: 2014-06-27
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資源簡(jiǎn)介:給出RS編碼和譯碼的原理 以及解決方案,特別是硬件的一種解決方案,值得這一方面的人員研究。
上傳時(shí)間: 2013-12-25
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資源簡(jiǎn)介:給出RS編碼和譯碼的原理 以及解決方案,特別是仿真的一種解決方案,值得參考。
上傳時(shí)間: 2014-01-09
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資源簡(jiǎn)介:RS編碼,verilog編寫,可以自定義多項(xiàng)式,(255,233)和(204,188)均可。
上傳時(shí)間: 2016-02-13
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資源簡(jiǎn)介:RS編碼的某個(gè)校驗(yàn)符 RS編碼的某個(gè)校驗(yàn)符
上傳時(shí)間: 2013-12-17
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資源簡(jiǎn)介:RS編碼的verilog源代碼,拿來和大家分享
上傳時(shí)間: 2014-01-17
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資源簡(jiǎn)介:RS編碼解碼中的域乘中對(duì)偶基與自由基系數(shù)轉(zhuǎn)換,用VC++實(shí)現(xiàn)
上傳時(shí)間: 2014-01-01
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資源簡(jiǎn)介:高速RS編碼算法及FPGA實(shí)現(xiàn),一篇文章,寫的很好,介紹了接收機(jī)中常用的RS編碼的原理,指標(biāo)與實(shí)現(xiàn),覺得有用就看看吧.
上傳時(shí)間: 2013-12-25
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資源簡(jiǎn)介:RS編碼的matlab程序,很詳細(xì),方便初學(xué)者學(xué)習(xí)
上傳時(shí)間: 2013-12-15
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資源簡(jiǎn)介:c編的RS編碼的程 c編的RS編碼的程
上傳時(shí)間: 2013-12-31
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資源簡(jiǎn)介:一個(gè)很不錯(cuò)RS編碼,用于DVB的信道編碼,用VHDL語言編寫,在FPGA上通過驗(yàn)證。
上傳時(shí)間: 2016-06-29
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資源簡(jiǎn)介:用于數(shù)據(jù)塊容錯(cuò)編碼校驗(yàn)的芯片的RS編碼器設(shè)計(jì)
上傳時(shí)間: 2016-07-11
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資源簡(jiǎn)介:用于數(shù)據(jù)塊容錯(cuò)編碼校驗(yàn)的芯片的RS編碼器設(shè)計(jì)的測(cè)試代碼
上傳時(shí)間: 2014-05-29
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資源簡(jiǎn)介:本代碼在matlab下實(shí)現(xiàn)RS編碼并加入噪聲 以及糾錯(cuò)編碼
上傳時(shí)間: 2013-12-04
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資源簡(jiǎn)介:RS編碼程序設(shè)計(jì),含測(cè)試程序,編碼部分,信道部分等,經(jīng)測(cè)試能順利運(yùn)行
上傳時(shí)間: 2014-06-16
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資源簡(jiǎn)介:基于對(duì)偶基的比特并行算法實(shí)現(xiàn)RS編碼,是實(shí)現(xiàn)有限域乘法的指導(dǎo)論文
上傳時(shí)間: 2013-12-10
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資源簡(jiǎn)介:RS編碼和解碼功能函數(shù),在網(wǎng)上找到的不少RS編碼函數(shù)中,這個(gè)是比較完整的
上傳時(shí)間: 2016-11-17
上傳用戶:愛死愛死
資源簡(jiǎn)介:RS編碼用MATLAB實(shí)現(xiàn),非常有實(shí)用的程序
上傳時(shí)間: 2014-10-14
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資源簡(jiǎn)介:使用verilog完成了RS編碼的設(shè)計(jì),編碼參數(shù)為輸入188,輸出204
上傳時(shí)間: 2017-01-23
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資源簡(jiǎn)介:DSP中實(shí)現(xiàn)的RS編碼+MFSK調(diào)制的實(shí)現(xiàn)
上傳時(shí)間: 2017-03-07
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資源簡(jiǎn)介:伽勒華域乘法器用于RS編碼中,用verilogHDL語言實(shí)現(xiàn)
上傳時(shí)間: 2013-12-25
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資源簡(jiǎn)介:RS編碼 CodeWarrior環(huán)境例程!
上傳時(shí)間: 2017-06-08
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資源簡(jiǎn)介:cmmb RS 編碼
上傳時(shí)間: 2013-11-30
上傳用戶:huyiming139
資源簡(jiǎn)介:RS編碼是一種糾錯(cuò)碼,本程序?qū)崿F(xiàn)RS(255,223)用FPGA 實(shí)現(xiàn)RS編碼,程序在Quartus II中調(diào)試通過。
上傳時(shí)間: 2017-07-29
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