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• Content Addressable Memory 的verilog源代碼。經(jīng)過modelsim仿真。免費(fèi)下載

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• 用SmartGen 生成一個(gè)2k*8 Dual Port RAM免費(fèi)下載

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• 本例是一個(gè)神經(jīng)網(wǎng)絡(luò)仿真應(yīng)用程序免費(fèi)下載

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• 可利用MATLAB實(shí)現(xiàn)模糊神經(jīng)網(wǎng)絡(luò)仿真免費(fèi)下載

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• IGBT開關(guān)過程仿真分析中的PSPICE應(yīng)用研究免費(fèi)下載

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• 神經(jīng)網(wǎng)絡(luò)仿真的基本程序免費(fèi)下載

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• 神經(jīng)網(wǎng)絡(luò)仿真免費(fèi)下載

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• 我做神經(jīng)網(wǎng)絡(luò)仿真的免費(fèi)下載

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• 我做全部關(guān)于神經(jīng)網(wǎng)絡(luò)仿真方面的程序免費(fèi)下載

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• matlab神經(jīng)網(wǎng)絡(luò)仿真與應(yīng)用,不錯(cuò)的一篇論文免費(fèi)下載

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• 基于matlab的模糊神經(jīng)網(wǎng)絡(luò)仿真源程序免費(fèi)下載

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• Hopfield Model 神經(jīng)網(wǎng)絡(luò)仿真程序免費(fèi)下載

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• 對(duì)modelsim仿真過程中出現(xiàn)的一些常見問題的詳細(xì)解答免費(fèi)下載

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• 完整的過程仿真源代碼免費(fèi)下載

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• is a test of a verilog implementation to do a oscilloscope with Dual-port RAM免費(fèi)下載

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• 汽車永磁起動(dòng)機(jī)的計(jì)算機(jī)輔助設(shè)計(jì)、磁極優(yōu)化及動(dòng)態(tài)過程仿真.rar免費(fèi)下載

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• 神經(jīng)網(wǎng)絡(luò) 多級(jí)神經(jīng)網(wǎng)絡(luò)仿真免費(fèi)下載

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• 跳頻通信過程仿真。包括調(diào)解免費(fèi)下載

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• Synchronous read Write RAM verilog。經(jīng)過modelsim se仿真。免費(fèi)下載

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• Top Level Dual Port Ram Core Project, VHDL code免費(fèi)下載

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• 基于FPGA的分頻器設(shè)計(jì),已經(jīng)通過了仿真(VHDL語(yǔ)言編寫)免費(fèi)下載

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• 初學(xué)者的第一個(gè)成功之作,希望大家共同學(xué)習(xí)共同進(jìn)步.其中的S3C44B0X啟動(dòng)代碼經(jīng)過我認(rèn)真修改過了,很適合初學(xué)者使用.免費(fèi)下載

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• 一個(gè)BP神經(jīng)網(wǎng)絡(luò)的matlab仿真免費(fèi)下載

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