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在數字電路中

  • 資源大小:2 K
  • 上傳時間: 2015-08-25
  • 上傳用戶:l2335800
  • 資源積分:2 下載積分
  • 標      簽: 數字電路

資 源 簡 介

在數字電路中,常需要對較高頻率的時鐘進行分頻操作,得到較低頻率的時鐘信號。我們知道,在硬件電路設計中時鐘信號是最重要的信號之一。 下面我們介紹分頻器的 VHDL 描述,在源代碼中完成對時鐘信號 CLK 的 2 分頻, 4 分頻, 8 分頻, 16 分頻。 這也是最簡單的分頻電路,只需要一個計數器即可。

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