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此書為VerilogHDL的設(shè)計(jì)例子

  • 資源大小:258 K
  • 上傳時(shí)間: 2017-06-29
  • 上傳用戶:futianxiang0419
  • 資源積分:2 下載積分
  • 標(biāo)      簽: VerilogHDL

資 源 簡 介

此書為VerilogHDL的設(shè)計(jì)例子,里面所舉例比較實(shí)際好用,希望給同志們有幫助!

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