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西電SOC課程設計實驗報告

  • 資源大小:2807 K
  • 上傳時間: 2015-04-16
  • 上傳用戶:dangkan
  • 資源積分:2 下載積分
  • 標      簽: SOC課程設計

資 源 簡 介

采用VHDL硬件描述語言設計,包含加法器,乘法器等以及寄存器的詳細設計思路和設計源碼

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