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同步發電機效率檢測研究
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使用VHDL設計一個適用於ETSI OFDM的時間和頻率同步處理器
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費諾編碼的步驟: A 將概率按從大到小的順序排列 B 按編碼進制數將概率分組
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頻率計程序﹐一個基于PIC單片機的頻率計程序和電路圖。
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利用AT89C51搭配74C926來實現一個低頻的頻率記數器(範圍為1Hz~300KHz)
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將正在順時針或逆時針旋轉的步進馬達目前角度顯示在ＬＣＭ上。
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步進馬達控制器的編程方法
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FIFO（先進先出隊列）通常用于數據的緩存和用于容納異步信號的頻率或相位的差異。本FIFO的實現是利用 雙口RAM 和讀寫地址產生模塊來實現的.FIFO的接口信號包括異步的寫時鐘（wr_clk）和讀
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PLC與步進馬達(含詳細操作流程與CODE)
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