一組開發(fā)基于XILINX FPGA開發(fā)DSP算法的應(yīng)用資料，具有實(shí)用性，可操作性。（5）
標(biāo)簽： XILINX FPGA DSP 算法
上傳時間： 2013-12-18
上傳用戶：sjyy1001
在Xilinx環(huán)境下編寫的vhdl程序，實(shí)現(xiàn)推箱子的游戲任務(wù)，界面很漂亮。
標(biāo)簽： Xilinx vhdl 環(huán)境 編寫
上傳時間： 2015-05-30
上傳用戶：lx9076
Xilinx的modelsim 仿真庫！里面有許多庫函數(shù)，對于ｖｌｏｇ或ｖｈｄｌ編程有很多好的源代碼可以剪切！
標(biāo)簽： modelsim Xilinx 仿真庫 庫函數(shù)
上傳時間： 2015-06-01
上傳用戶：黃華強(qiáng)
自己在ISE下用VHDL寫的UART，簡單，易懂
標(biāo)簽： VHDL UART ISE
上傳時間： 2015-06-10
上傳用戶：jackgao
該程序是在xilinx的FPGA上實(shí)現(xiàn)DDR_SDRAM接口，程序是用verylog語言寫的
標(biāo)簽： DDR_SDRAM xilinx FPGA 程序
上傳用戶：爺?shù)臍赓|(zhì)
Xilinx 的Spartan3的原理圖,老外畫的,很值得研究 .
標(biāo)簽： Spartan3 Xilinx 原理圖
上傳時間： 2015-06-13
上傳用戶：wangzhen1990
UART 的VHDL源代碼。可在ISE, Max-Plus II,等開發(fā)環(huán)境下實(shí)現(xiàn)。
標(biāo)簽： Max-Plus UART VHDL ISE
上傳時間： 2013-12-16
上傳用戶：天涯
Xilinx Jtag Configuration source code, Support *.xsvf file
標(biāo)簽： Configuration Support Xilinx source
上傳時間： 2015-06-16
上傳用戶：luke5347
verilog 時鐘程序?qū)嵗趇se下編譯通過spatan3的芯片
標(biāo)簽： verilog spatan3 ise 時鐘
上傳時間： 2014-01-07
上傳用戶：colinal
基于Xilinx PicoBlaze處理器內(nèi)核的系統(tǒng) 源代碼
標(biāo)簽： PicoBlaze Xilinx 處理器內(nèi)核
上傳時間： 2014-11-08
上傳用戶：yy541071797
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