·IEEE Std 1364-2001 Standard Verilog hardware description language
標(biāo)簽： nbsp description Standard hardware
上傳時間： 2013-06-20
上傳用戶：蟲蟲蟲蟲蟲蟲
四位全加器verilog源碼，簡單實用！歡迎下載
標(biāo)簽： verilog 全加器 程序
上傳時間： 2013-05-16
上傳用戶：a6697238
verilog實現(xiàn)一個AGC模塊，信號輸入位寬16位，通過統(tǒng)計64個輸入完成其功率的統(tǒng)計，然后根據(jù)功率大小對信號進(jìn)行縮放。
標(biāo)簽： verilog AGC
上傳時間： 2013-06-09
上傳用戶：sc965382896
本文主要介紹了Verilog HDL 語言的一些基本知識，目的是使初學(xué)者能夠迅速掌握HDL 設(shè)計方法，初步了解并掌握Verilog HDL語言的基本要素，能夠讀懂簡單的設(shè)計代碼并能 夠進(jìn)行一些簡單設(shè)計的Verilog HDL建模。
標(biāo)簽： Verilog HDL 入門教程
上傳用戶：mosliu
Verilog基本電路設(shè)計指導(dǎo)書，可以作為學(xué)習(xí)verilog的入門書籍
標(biāo)簽： Verilog 基本電路 設(shè)計指導(dǎo)
上傳時間： 2013-04-24
上傳用戶：20160811
華為的verilog編碼規(guī)范，寫得很不錯！我就是用這個規(guī)范，需要的下載看看吧，免積分咯！~
標(biāo)簽： verilog 華為 編碼規(guī)范
上傳用戶：chongcongying
可編程邏輯器件 pld/fpga,vhdl/verilog的相關(guān)學(xué)習(xí)資料，設(shè)計技巧，抓緊免費(fèi)下載。
標(biāo)簽： verilog fpga vhdl pld
上傳時間： 2013-08-06
上傳用戶：李彥東
基于Xilinx FPGA的DDRSDRAM的Verilog控制代碼，使用的FPGA為Virtex-4，實現(xiàn)對DDRSDRAM的簡單控制（對一系列地址的寫入和讀取）。
標(biāo)簽： DDRSDRAM Verilog Xilinx FPGA
上傳時間： 2013-08-07
上傳用戶：ainimao
使用Verilog實現(xiàn)基于FPGA的SDRAM控制器
標(biāo)簽： Verilog SDRAM FPGA 控制器
上傳時間： 2013-08-08
上傳用戶：litianchu
實現(xiàn)USB接口功能的VHDL和verilog完整源代碼
標(biāo)簽： verilog VHDL USB 接口功能
上傳時間： 2013-08-11
上傳用戶：yangzhiwei
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