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VHDL與Verilog的比較
標簽： Verilog VHDL 比較
上傳時間： 2015-02-12
上傳用戶：hopy
verilog fifo
標簽： verilog fifo
上傳時間： 2015-02-16
上傳用戶：xaijhqx
Synthesizable Verilo---syntax and semantics一本很好的關(guān)于verilog可綜合設(shè)計的參考書
標簽： Synthesizable semantics verilog Verilo
上傳用戶：葉山豪
一本全面的verilog參考書
標簽： verilog
上傳時間： 2013-12-11
上傳用戶：CSUSheep
SystemC to Verilog 轉(zhuǎn)換源程序。
標簽： SystemC Verilog to 轉(zhuǎn)換
上傳時間： 2015-02-19
上傳用戶：erkuizhang
用verilog寫的跑表程序
標簽： verilog 跑表 程序
上傳時間： 2014-01-18
上傳用戶：lx9076
用verilog編寫的多功能數(shù)字鐘
標簽： verilog 編寫 多功能 數(shù)字
上傳時間： 2015-02-25
上傳用戶：王者A
IEEE Std 1364.1-2002 IEEE Std. 1364.1 - 2002 IEEE Standard for Verilog Register Transfer Level Synthesis.rar
標簽： IEEE 1364.1 2002 Std
上傳時間： 2013-12-23
Verilog源碼14.rar
標簽： Verilog 14 源碼
上傳時間： 2013-12-14
上傳用戶：dragonhaixm
Verilog源碼13.rar
標簽： Verilog 13 源碼
上傳時間： 2014-01-23
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