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synplify

synplify、synplifyPro和synplifyPremier是Synplicity（Synopsys公司于2008年收購了Synplicity公司）公司提供的專門針對FPGA和CPLD實現(xiàn)的邏輯綜合工具,Synplicity的工具涵蓋了可編程邏輯器件（FPGAs、PLDs和CPLDs）的綜合，驗證，調(diào)試，物理綜合及原型驗證等領(lǐng)域。

可編輯程邏輯及IC開發(fā)領(lǐng)域的EDA工具介紹

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大規(guī)模FPGA設(shè)計中的多點綜合技術(shù)

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Design Safe Verilog State Machine（Synplicity）

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通用陣列邏輯GAL實現(xiàn)基本門電路的設(shè)計

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數(shù)字均衡器是通訊信道抗碼間干擾的重要環(huán)節(jié),這是一個用vhdl寫的代碼以及用synplify8.0綜合的RTL電路圖它包含三個模塊FILTER,ERR_DECISION,ADJUST 希望對大家有用.

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波形發(fā)生器

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本文：采用了FPGA方法來模擬高動態(tài)(Global Position System GPS)信號源中的C／A碼產(chǎn)生器。C／A碼在GPS中實現(xiàn)分址、衛(wèi)星信號粗捕和精碼(P碼)引導捕獲起著重要的作用

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如題

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可編輯程邏輯及IC開發(fā)領(lǐng)域的EDA工具介紹

大規(guī)模FPGA設(shè)計中的多點綜合技術(shù)

Design Safe Verilog State Machine（Synplicity）

通用陣列邏輯GAL實現(xiàn)基本門電路的設(shè)計

數(shù)字均衡器是通訊信道抗碼間干擾的重要環(huán)節(jié),這是一個用vhdl寫的代碼以及用synplify8.0綜合的RTL電路圖它包含三個模塊FILTER,ERR_DECISION,ADJUST 希望對大家有用.

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波形發(fā)生器

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本文：采用了FPGA方法來模擬高動態(tài)(Global Position System GPS)信號源中的C／A碼產(chǎn)生器。C／A碼在GPS中實現(xiàn)分址、衛(wèi)星信號粗捕和精碼(P碼)引導捕獲起著重要的作用

如題