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  • AT91SAM9263, DBGU and UART0 charecter sending and receiver program

    AT91SAM9263, DBGU and UART0 charecter sending and receiver program

    標(biāo)簽: and charecter receiver sending

    上傳時間: 2017-08-23

    上傳用戶:阿四AIR

  • Electronic curcuit for Data Logging Receiver Supply Voltage Monitor

    Electronic curcuit for Data Logging Receiver Supply Voltage Monitor

    標(biāo)簽: Electronic Receiver curcuit Logging

    上傳時間: 2017-08-29

    上傳用戶:evil

  • This program is ICQ SMS Receiver. You have certainly seen that almost every web site provides an opt

    This program is ICQ SMS Receiver. You have certainly seen that almost every web site provides an option to send e-mail to that web site s owner. But what about SMS? It is now also possible, if your mobile phone service provider supported by ICQ

    標(biāo)簽: certainly Receiver provides program

    上傳時間: 2014-01-03

    上傳用戶:stvnash

  • Superhetrodyne AM Radio Receiver

    Superhetrodyne AM Radio Receiver

    標(biāo)簽: Superhetrodyne Receiver Radio AM

    上傳時間: 2017-09-07

    上傳用戶:zhaiye

  • 多目標(biāo)進(jìn)化計算算法在JGAP包上的實現(xiàn)。程序演示了多目標(biāo)進(jìn)化中fitness function和search operator的實現(xiàn)。

    多目標(biāo)進(jìn)化計算算法在JGAP包上的實現(xiàn)。程序演示了多目標(biāo)進(jìn)化中fitness function和search operator的實現(xiàn)。

    標(biāo)簽: function operator fitness search

    上傳時間: 2017-09-07

    上傳用戶:gtf1207

  • The UMTS Physical Layer model consists of an end-to-end (transmitter-to-receiver) simulation of the

    The UMTS Physical Layer model consists of an end-to-end (transmitter-to-receiver) simulation of the Frequency Division Duplex (FDD) Downlink physical layer for several Dedicated Channels (DCH) as specified by the 3GPP standard (Release 99).

    標(biāo)簽: transmitter-to-receiver end-to-end simulation Physical

    上傳時間: 2014-01-11

    上傳用戶:it男一枚

  • summing two vectors with operator overloading

    summing two vectors with operator overloading

    標(biāo)簽: overloading operator summing vectors

    上傳時間: 2017-09-15

    上傳用戶:tb_6877751

  • C51 UART function,transmiter and receiver

    C51 UART function,transmiter and receiver

    標(biāo)簽: transmiter function receiver UART

    上傳時間: 2013-12-20

    上傳用戶:kiklkook

  • 基于FPGA的通用異步收發(fā)器的設(shè)計.rar

    通用異步收發(fā)器(Universal Asynchronous Receiver Transmitter,UART)是一種能同時支持短距離和長距離數(shù)據(jù)傳輸?shù)拇型ㄐ沤涌冢粡V泛應(yīng)用于微機(jī)和外設(shè)之間的數(shù)據(jù)交換。像8251、NS8250、NS16550等都是常用的UART芯片,但是這些專用的串行接口芯片的缺點是數(shù)據(jù)傳輸速率比較慢,難以滿足高速率數(shù)據(jù)傳輸?shù)膱龊希匾木褪撬鼈兌季哂胁豢梢浦残裕虼艘眠@些芯片來實現(xiàn)PC機(jī)和FPGA芯片之間的通信,勢必會增加接口連線的復(fù)雜程度以及降低整個系統(tǒng)的穩(wěn)定性和有效性。 本課題就是針對UART的特點以及FPGA設(shè)計具有可移植性的優(yōu)勢,提出了一種基于FPGA芯片的嵌入式UART設(shè)計方法,其中主要包括狀態(tài)機(jī)的描述形式以及自頂向下的設(shè)計方法,利用硬件描述語言來編制UART的各個子功能模塊以及頂層模塊,之后將其集成到FPGA芯片的內(nèi)部,這樣不僅能解決傳統(tǒng)UART芯片的缺點而且同時也使整個系統(tǒng)變得更加具有緊湊性以及可靠性。 本課題所設(shè)計的LIART支持標(biāo)準(zhǔn)的RS-232C傳輸協(xié)議,主要設(shè)計有發(fā)送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個獨(dú)立的數(shù)據(jù)緩沖區(qū)FIFO模塊。該模塊具有可變的波特率、數(shù)據(jù)幀長度以及奇偶校驗方式,還有多種中斷源、中斷優(yōu)先級、較強(qiáng)的抗干擾數(shù)據(jù)接收能力以及芯片內(nèi)部自診斷的能力,模塊內(nèi)分開的接收和發(fā)送數(shù)據(jù)緩沖寄存器能實現(xiàn)全雙工通信。除此之外最重要的是利用IP模塊復(fù)用技術(shù)設(shè)計數(shù)據(jù)緩沖區(qū)FIFO,采用兩種可選擇的數(shù)據(jù)緩沖模式。這樣既可以應(yīng)用于高速的數(shù)據(jù)傳輸環(huán)境,也能適合低速的數(shù)據(jù)傳輸場合,因此可以達(dá)到資源利用的最大化。 在具體的設(shè)計過程中,利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發(fā)環(huán)境中對各個功能模塊進(jìn)行綜合優(yōu)化、仿真驗證以及下載實現(xiàn)。各項數(shù)據(jù)結(jié)果表明,本課題中所設(shè)計的UART滿足預(yù)期設(shè)計目標(biāo)。

    標(biāo)簽: FPGA 異步收發(fā)器

    上傳時間: 2013-08-02

    上傳用戶:rocketrevenge

  • 基于FPGA的藍(lán)牙HCIUART控制接口設(shè)計.rar

    通用異步收發(fā)器UART(Universal Asynchronous Receiver/Transmitter)是廣泛使用的串行傳輸協(xié)議。串行外設(shè)用到異步串行接口一般采用專用集成電路實現(xiàn)。但是這類芯片一般包含許多輔助模塊,而時常不需要使用完整的UART的功能和輔助功能,或者當(dāng)在FPGA上設(shè)計時,需要將UART功能集成到FPGA內(nèi)部而不能使用芯片。藍(lán)牙主機(jī)控制器接口則是實現(xiàn)主機(jī)設(shè)備與藍(lán)牙模塊之間互操作的控制部件。當(dāng)在使用藍(lán)牙設(shè)備的時候尤其是在監(jiān)控場所,接口控制器在控制數(shù)據(jù)與計算機(jī)的傳輸上就起了至關(guān)重要的作用。 論文針對信息技術(shù)的發(fā)展和開發(fā)過程中的實際需要,設(shè)計了一個藍(lán)牙HCI-UART(Host Controller Interface-Universal Asynchronous Receiver/Transmitter)控制接口的模塊。使用VHDL將其核心功能集成,既可以單獨(dú)使用,也可集成到系統(tǒng)芯片中,并且整個設(shè)計緊湊、穩(wěn)定且可靠,其用途廣泛,具有一定的使用價值。 本設(shè)計采用TOP-DOWN設(shè)計方法,整體上分為UART接口和藍(lán)牙主機(jī)控制器接口兩部分。首先根據(jù)UART和藍(lán)牙主機(jī)控制器接口的實現(xiàn)原理和設(shè)計指標(biāo)要求進(jìn)行系統(tǒng)設(shè)計,對系統(tǒng)劃分模塊以及各個模塊的信號連接;然后進(jìn)行模塊設(shè)計,設(shè)計出每個模塊的功能,并用VHDL語言編寫代碼來實現(xiàn)模塊功能;再使用ISE8.2I自帶的仿真器對各模塊進(jìn)行功能仿真和時序仿真;最后進(jìn)行硬件驗證,在Virtex-II開發(fā)板上對系統(tǒng)進(jìn)行功能驗證。實現(xiàn)了發(fā)送、接收和波特率發(fā)生等功能,驗證了結(jié)果,表明設(shè)計正確,功能良好,符合設(shè)計要求。

    標(biāo)簽: HCIUART FPGA 藍(lán)牙

    上傳時間: 2013-07-13

    上傳用戶:wfl_yy

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