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rc吸收電路

是一個用verilog寫成的加法器電路,可把七個元件加起來

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使用硬體描述語言HDL 設計硬體電路

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本程序實現2維TM波FDTD仿真此程序用PML設置吸收邊界條件

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這是一個用FDTD算法計算二維導體方柱散射場RCS的matlab程序.采用UPML吸收邊界條件和高斯脈沖源激勵,對于學習FDTD方法中的激勵源加入,近-遠場外推,吸收邊界設置等很有幫助

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學習如何設置UPML吸收邊界的3-D FDTD程序.對于初學者很有幫助

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5 bits 的加法器與減法器合併電路之原始程式製作

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三維直角坐標系FDTD應用UPML吸收邊界條件

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verilog除頻器可用於編碼段運用可以穩定電路設計

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有限差分二階二維聲波方程加吸收邊界變速剖面研究.c++實現！

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內含fulladder結構檔,電路檔,測試檔(testbench)以及執行檔(.do)

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