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是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（AlteraHardware支持DescriptionLanguage）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
FPGA實(shí)現(xiàn)的數(shù)字日歷
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超聲波語音通信的調(diào)制器設(shè)計(jì)
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基于FPGA的數(shù)字鐘電路設(shè)計(jì)
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通向FPGA之路-七天玩轉(zhuǎn)Altera之基礎(chǔ)篇
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豐富的FPGA與VHDL學(xué)習(xí)資料
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