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是業界最優秀的HDL語言仿真軟件，它能提供友好的仿真環境，是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器。它采用直接優化的編譯技術、Tcl/Tk技術、和單一內核仿真技術，編譯仿真速度快，編譯的代碼與平臺無關，便于保護IP核，個性化的圖形界面和用戶接口，為用戶加快調錯提供強有力的手段，是FPGA/ASIC設計的首選仿真軟件。
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-Altera_6.5仿真入門教程
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使用的簡單的方法
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的詳細使用教程
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6.5仿真入門教程
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5.8C_crack
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的教程吧（中文的）. 很好用的.對出學者幫助比較大的哦.
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發一個基于
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仿真的Verilog源代碼包
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用
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仿真一個正弦波產生程序
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一個很不錯的例子,實現的是4bit的加減乘除,用
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做的仿真.
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