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Mentor公司的
modelSim
是業界最優秀的HDL語言仿真軟件，它能提供友好的仿真環境，是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器。它采用直接優化的編譯技術、Tcl/Tk技術、和單一內核仿真技術，編譯仿真速度快，編譯的代碼與平臺無關，便于保護IP核，個性化的圖形界面和用戶接口，為用戶加快調錯提供強有力的手段，是FPGA/ASIC設計的首選仿真軟件。
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中文教程,有３篇講
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的資料
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這是mentor公司
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軟件的高級調試技巧培訓。對于從事可編程邏輯系統開發的工程師們
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SE 6.1 (電子仿真)具體破解
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一本詳細講解有關
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操作的教程,非常適合初學者.
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用VHDL語言編寫的語言,可以利用
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進行仿真.對于初學者,則更有參考價值.
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強烈推薦下載,verilog狀態機實例.可以在
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下運行.
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還是一個verilog原代碼,可以在
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下運行,強烈推薦下載
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破解工具 安裝
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后運行它即可破解
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幀同步模塊的Veriolog源碼。 在
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下的一個工程。有測試文件。
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Xilinx的
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仿真庫！里面有許多庫函數
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