ALDEC公司的Active-hdL是一個(gè)開放型的仿真工具。 可支持幾乎所有的FPGA/CPLD廠商的產(chǎn)品,設(shè)計(jì)輸入可以原理圖或硬件描述語言或有限狀態(tài)機(jī) 方式
標(biāo)簽: Active 8.10 hdL
上傳時(shí)間: 2013-05-29
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:視頻圖像采集verilog hdL源程序,視頻解碼芯片部分的,可以供參考
標(biāo)簽: verilog hdL 視頻圖像 源程序
上傳時(shí)間: 2013-04-24
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·詳細(xì)說明:正式出版物《Verilog hdL 硬件描述語言》一書的精美 PDF 電子版。- Official publication Verilog hdL Hardware Description Language a book fine PDF electron version.目 錄譯者序前言第1章 簡介&n
標(biāo)簽: nbsp Verilog hdL 硬件描述語言
上傳時(shí)間: 2013-07-02
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·本書從用戶的角度全面闡述了Verilog hdL語言的重要細(xì)節(jié)和基本設(shè)計(jì)方法,并詳細(xì)介紹了Verilog 2001版的主要改進(jìn)部分。本書重點(diǎn)關(guān)注如何應(yīng)用Verilog語言進(jìn)行數(shù)字電路和系統(tǒng)的設(shè)計(jì)和驗(yàn)證,而不僅僅講解語法。全書從基本概念講起,并逐漸過渡到編程語言接口以及邏輯綜合等高級(jí)主題。書中的內(nèi)容全部符合Verilog hdL IEEE 1364-2001標(biāo)準(zhǔn)。本書適合電子、計(jì)算機(jī)、自動(dòng)控制等專業(yè)
標(biāo)簽: Verilog nbsp hdL 數(shù)字設(shè)計(jì)
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·Verilog hdL: A Guide to Digital Design and
標(biāo)簽: nbsp Verilog Digital Design
上傳用戶:誰偷了我的麥兜
·Verilog hdL Synthesis, A Practical Primer
標(biāo)簽: nbsp Synthesis Practical Verilog
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人民郵電出版社一書的配套光盤,包含書上所有原代碼,特別是狀態(tài)機(jī)部分,值得學(xué)習(xí)
標(biāo)簽: verilog hdL
上傳時(shí)間: 2013-05-30
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·hdL Chip Design
標(biāo)簽: nbsp Design Chip hdL
上傳時(shí)間: 2013-06-18
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本文主要介紹了Verilog hdL 語言的一些基本知識(shí),目的是使初學(xué)者能夠迅速掌握hdL 設(shè)計(jì)方法,初步了解并掌握Verilog hdL語言的基本要素,能夠讀懂簡單的設(shè)計(jì)代碼并能 夠進(jìn)行一些簡單設(shè)計(jì)的Verilog hdL建模。
標(biāo)簽: Verilog hdL 入門教程
上傳時(shí)間: 2013-05-16
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TMS3205402Verilog hdL源碼
標(biāo)簽: 3205402 Verilog TMS hdL
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