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ep2

  • usb 端點(diǎn)測(cè)試程序 塊傳輸 從EP6輸入512字到ep2傳出。

    usb 端點(diǎn)測(cè)試程序 塊傳輸 從EP6輸入512字到ep2傳出。

    標(biāo)簽: usb EP6 512 ep2

    上傳時(shí)間: 2013-12-30

    上傳用戶:ryb

  • 使用Usb cy7c68013與DSP通信

    使用Usb cy7c68013與DSP通信,現(xiàn)在已經(jīng)能夠很正確的傳遞(上傳數(shù)據(jù))了。 USB資源: 使用了Ep2,Ep6 ep2, out auto Ep6, in auto FlagA---  PF3 FlagB--- PF6 FlagC---  PF1    需要 EP2 EMPTY     EP6  FULL信號(hào) 因此  FlagA---  PF3 --- ep2空 --- 8 h  FlagB--- PF6 --- EP6滿 --- e h FlagC---  PF1   PINFLAGSAB=0xE8  極性設(shè)置:  PKTEND,EPEF,EPFF high  其他的低   因此 FIFOPINPOLAR = 0x23 包結(jié)束信號(hào)接在DSP 的 PF7 上面。 以上結(jié)束06.11.28  

    標(biāo)簽: c68013 68013 Usb DSP

    上傳時(shí)間: 2015-12-27

    上傳用戶:youke111

  • The first task at hand is to set up the endpoints appropriately for this example. The following code

    The first task at hand is to set up the endpoints appropriately for this example. The following code switches the CPU clock speed to 48 MHz (since at power-on default it is 12 MHz), and sets up ep2 as a Bulk OUT endpoint, 4x buffered of size 512, and EP6 as a Bulk IN endpoint, also 4x buffered of size 512. This set-up utilizes the maximum allotted 4-KB FIFO space. It also sets up the FIFOs for manual mode, word-wide operation, and goes through a FIFO reset and arming sequence to ensure that they are ready for data operations

    標(biāo)簽: appropriately The endpoints following

    上傳時(shí)間: 2013-12-02

    上傳用戶:dianxin61

  • 使用68013的測(cè)試程序

    使用68013的測(cè)試程序,包含68013固件程序(采用slave FIFO bulk同步讀寫(xiě),ep2 OUT,EP6 IN),驅(qū)動(dòng),PC端測(cè)試用程序。CPLD的VHDL代碼

    標(biāo)簽: 68013 測(cè)試程序

    上傳時(shí)間: 2013-11-29

    上傳用戶:luke5347

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