將VHDL設(shè)計(jì)轉(zhuǎn)換成Verilog設(shè)計(jì)的程式
標(biāo)簽： Verilog VHDL 程式
上傳時間： 2016-01-18
上傳用戶：wkchong
JPEG的硬體設(shè)計(jì)採用的是VHDL設(shè)計(jì),有源碼
標(biāo)簽： JPEG VHDL 有源
上傳用戶：agent
(Channel Estimation in OFDM Systems)正交分頻多工系統(tǒng)中的各種通道估測技術(shù)
標(biāo)簽： Estimation Channel Systems OFDM
上傳時間： 2016-01-22
上傳用戶：nanfeicui
Channel Estimation Techniques Based on Pilot Arrangement in OFDM Systems(OFDM系統(tǒng)的一個通道估測方法)
標(biāo)簽： OFDM Arrangement Estimation Techniques
上傳時間： 2013-12-20
上傳用戶：luke5347
使用FPGA設(shè)計(jì)WiMax接收機(jī)之OFDM同步硬體電路(內(nèi)附VHDL code)
標(biāo)簽： WiMax FPGA OFDM VHDL
上傳用戶：zhuyibin
一個簡單的游戲設(shè)計(jì)...好好玩的
標(biāo)簽：
上傳時間： 2013-12-31
上傳用戶：edisonfather
這是一個利用模擬退火來計(jì)算TSP旅行家的問題
標(biāo)簽： TSP 模 旅行 家
上傳時間： 2016-01-28
上傳用戶：chenxichenyue
這是利用基因演算法來計(jì)算皇后問題的小程式 絕對是狠快速的方法
標(biāo)簽： 基因 算法 程式 速的方法
上傳用戶：英雄
這是一個可以計(jì)算學(xué)期成績的視窗程式 是利用讀入純文字檔案 來計(jì)算學(xué)期成績和平均
標(biāo)簽： 程式
上傳用戶：天涯
倒數(shù)計(jì)時器 提供時間到關(guān)機(jī)的功能 可自由設(shè)定是否關(guān)機(jī)或者提供警示
上傳時間： 2016-02-02
上傳用戶：lepoke
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