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cpld

cpld采用CMOSEPROM、EEPROM、快閃存儲器和SRAM等編程技術(shù)，從而構(gòu)成了高密度、高速度和低功耗的可編程邏輯器件。cPCI總線

--cpld技術(shù)及其應(yīng)用-292頁-13.5M.pdf

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--cpld-FPGA常用模塊與綜合系統(tǒng)設(shè)計實例精講-452頁-65.7M.pdf

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pld與cpld數(shù)字電路設(shè)計——使用machxl-229頁-3.3M.pdf

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cpld技術(shù)及其應(yīng)用-282頁-6.1M.pdf

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cpld-FPGA高級應(yīng)用開發(fā)指南-283頁-10.6M.pdf

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Altera-FPGA-cpld設(shè)計-高級篇-335頁-23.6M.pdf

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Altera-FPGA-cpld設(shè)計-基礎(chǔ)篇-332頁-24.5M.pdf

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實現(xiàn)基于cpld的CCD采集系統(tǒng)設(shè)計源碼.rar

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用一片cpld實現(xiàn)數(shù)字鎖相環(huán),用VHDL或V語言.rar

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FPGA-cpld入門教程.files.rar

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