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來(lái)實(shí)現(xiàn)對(duì)LED的靜態(tài)顯示
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CPLD與8051的總線接口的
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設(shè)計(jì)源碼及原理圖和說(shuō)明
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這是我用
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語(yǔ)言
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基于FPGA的直接數(shù)字合成器的設(shè)計(jì)與分析的代碼程序,代碼格式為
Vhdl
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一個(gè)很好的
Vhdl
實(shí)現(xiàn)的功能模塊程序
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Vhdl
語(yǔ)言編寫(xiě)的FIR濾波器源碼
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FPGA的一些常識(shí)及含IP核的
Vhdl
設(shè)計(jì)源代碼
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利用
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語(yǔ)言編寫(xiě)的一個(gè)crc功能模塊
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Vhdl
寫(xiě)的LMS算法程序。利用本地正弦信號(hào)
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數(shù)字設(shè)計(jì)——CPLD應(yīng)用與
Vhdl
源文件
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