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Verilog

VerilogHDL是一種硬件描述語言，以文本形式來描述數字系統硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數字邏輯系統所完成的邏輯功能。VerilogHDL和VHDL是世界上最流行的兩種硬件描述語言，都是在20世紀80年代中期開發出來的。前者由GatewayDesignAutomation公司（該公司于1989年被Cadence公司收購）開發。兩種HDL均為IEEE標準。[1]

Verilog浮點乘發器

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Verilog浮點乘發器

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Verilog浮點乘發器

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Verilog寫的回波抵消程序

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RS編碼的源代碼使用Verilog在Xinloinx平臺

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VHDL與Verilog的比較

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Verilog fifo

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Synthesizable Verilo---syntax and semantics一本很好的關于Verilog可綜合設計的參考書

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一本全面的Verilog參考書

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SystemC to Verilog 轉換源程序。

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