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VHDL-AMS

VHDL-AMS是VHDL的一個(gè)分支，它支持模擬、數(shù)字、數(shù)模混合電路系統(tǒng)的建模與仿真。

各種功能的計(jì)數(shù)器實(shí)例（VHDL源代碼）

各種功能的計(jì)數(shù)器實(shí)例（VHDL源代碼）:ENTITY counters IS PORT ( d : IN INTEGER RANGE 0 TO 255; clk : IN BIT; clear : IN BIT; ld : IN BIT; enable : IN BIT; up_down : IN BIT; qa : OUT INTEGER RANGE 0 TO 255; qb : OUT INTEGER RANGE 0 TO 255; qc : OUT INTEGER RANGE 0 TO 255; qd : OUT INTEGER RANGE 0 TO 255; qe : OUT INTEGER RANGE 0 TO 255; qf : OUT INTEGER RANGE 0 TO 255; qg : OUT INTEGER RANGE 0 TO 255; qh : OUT INTEGER RANGE 0 TO 255; qi : OUT INTEGER RANGE 0 TO 255;

標(biāo)簽： VHDL 計(jì)數(shù)器源代碼

上傳時(shí)間： 2013-10-09

上傳用戶：松毓336
DES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。

DES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。

標(biāo)簽： TESTBENCH VERILOG VHDL DES

上傳時(shí)間： 2015-01-04

上傳用戶：songyue1991
i2c總線的vhdl實(shí)現(xiàn)和vxworks的文件系統(tǒng)

i2c總線的vhdl實(shí)現(xiàn)和vxworks的文件系統(tǒng)

標(biāo)簽： vxworks vhdl i2c 總線

上傳時(shí)間： 2015-01-06

上傳用戶：王小奇
8051核的vhdl原代碼。

8051核的vhdl原代碼。

標(biāo)簽： 8051 vhdl 代碼

上傳時(shí)間： 2015-01-08

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vhdl

vhdl

標(biāo)簽： vhdl

上傳時(shí)間： 2013-12-18

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vhdl

vhdl

標(biāo)簽： vhdl

上傳時(shí)間： 2015-01-08

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Xilinx Sdram控制器VHDL源代碼

Xilinx Sdram控制器VHDL源代碼

標(biāo)簽： Xilinx Sdram VHDL 控制器

上傳時(shí)間： 2014-01-14

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lattice sdram 控制器VHDL源代碼

lattice sdram 控制器VHDL源代碼

標(biāo)簽： lattice sdram VHDL 控制器

上傳時(shí)間： 2015-01-09

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用VHDL編寫(xiě)DDR SDRAM Controller的源代碼

用VHDL編寫(xiě)DDR SDRAM Controller的源代碼

標(biāo)簽： Controller SDRAM VHDL DDR

上傳時(shí)間： 2013-12-19

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本程序使用vhdl編寫(xiě)的jtag接口實(shí)現(xiàn)程序,其中有些功能未能實(shí)現(xiàn),希望有人能夠幫忙完善!

本程序使用vhdl編寫(xiě)的jtag接口實(shí)現(xiàn)程序,其中有些功能未能實(shí)現(xiàn),希望有人能夠幫忙完善!

標(biāo)簽： vhdl jtag 程序接口

上傳時(shí)間： 2013-12-25

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