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VC中自己定義的文件類型關(guān)聯(lián)(lián)圖標(biāo)和程序

  • 能精確計算C語言延時程序中延時時間的小工具

    能精確計算C語言延時程序中延時時間的小工具

    標(biāo)簽: 計算 C語言 延時程序 延時

    上傳時間: 2013-07-29

    上傳用戶:357739060

  • 保密通信中RS編解碼的FPGA實(shí)現(xiàn)

    由于信道中存在干擾,數(shù)字信號在信道中傳輸?shù)倪^程中會產(chǎn)生誤碼.為了提高通信質(zhì)量,保證通信的正確性和可靠性,通常采用差錯控制的方法來糾正傳輸過程中的錯誤.本文的目的就是研究如何通過差錯控制的方法以提高通信質(zhì)量,保證傳輸?shù)恼_性和可靠性.重點(diǎn)研究一種信道編解碼的算法和邏輯電路的實(shí)現(xiàn)方法,并在硬件上驗證,利用碼流傳輸?shù)臏y試方法,對設(shè)計進(jìn)行測試.在以上的研究基礎(chǔ)之上,橫向擴(kuò)展和課題相關(guān)問題的研究,包括FPGA實(shí)現(xiàn)和高速硬件電路設(shè)計等方面的研究. 糾錯碼技術(shù)是一種通過增加一定的冗余信息來提高信息傳輸可靠性的有效方法.RS碼是一種典型的糾錯碼,在線性分組碼中,它具有最強(qiáng)的糾錯能力,既能糾正隨機(jī)錯誤,也能糾正突發(fā)錯誤.在深空通信,移動通信以及數(shù)字視頻廣播等系統(tǒng)中具有廣泛的應(yīng)用,隨著RS編碼和解碼算法的改進(jìn)和相關(guān)的硬件實(shí)現(xiàn)技術(shù)的發(fā)展,RS碼在實(shí)際中的應(yīng)用也將更加廣泛. 在研究中,對所研究的問題進(jìn)行分解,集中精力研究課題中的重點(diǎn)和難點(diǎn),在各個模塊成功實(shí)現(xiàn)的基礎(chǔ)上,成功的進(jìn)行系統(tǒng)組合,協(xié)調(diào)各個模塊穩(wěn)定的工作. 在本文中的EDA設(shè)計中,使用了自頂向下的設(shè)計方法,編解碼算法每一個子模塊分開進(jìn)行設(shè)計,最后在頂層進(jìn)行元件例化,正確實(shí)現(xiàn)了編碼和解碼的功能. 本文首先介紹相關(guān)的數(shù)字通信背景;接著提出糾錯碼的設(shè)計方案,介紹RS(31,15)碼的編譯碼算法和邏輯電路的實(shí)現(xiàn)方法,RTL代碼編寫和邏輯仿真以及時序仿真,并討論了FPGA設(shè)計的一般性準(zhǔn)則以及高速數(shù)字電路設(shè)計的一些常用方法和注意事項;最后設(shè)計基于FPGA的硬件電路平臺,并利用靜態(tài)和動態(tài)的方法對編解碼算法進(jìn)行測試. 通過對編碼和解碼算法的充分理解,本人使用Verilog HDL語言對算法進(jìn)行了RTL描述,在Altera公司Cyclone系列FPGA平臺上面實(shí)現(xiàn)了編碼和解碼算法. 其中,編碼的最高工作頻率達(dá)到158MHz,解碼的最高工作頻率達(dá)到91MHz.在進(jìn)行硬件調(diào)試的時候,整個系統(tǒng)工作在30MHz的時鐘頻率下,通過了硬件上的靜態(tài)測試和動態(tài)測試,并能夠正確實(shí)現(xiàn)預(yù)期的糾錯功能.

    標(biāo)簽: FPGA 保密通信 RS編解碼

    上傳時間: 2013-07-01

    上傳用戶:liaofamous

  • U盤MP3下的文件系統(tǒng)(完全兼容FAT16/FAT32)

    ·文件列表:   U盤MP3下的文件系統(tǒng) 完全兼容FAT16 FAT32   ......................................\U盤MP3文件系統(tǒng)   ......................................\..............\fat.c   .............................

    標(biāo)簽: FAT MP3 16 32

    上傳時間: 2013-06-21

    上傳用戶:Shoen

  • 很全的文件系統(tǒng)(完整支持FAT12/FAT16/FAT32)

    ·很全的文件系統(tǒng)(完整支持FAT12/FAT16/FAT32)市面還有書籍支持文件列表:   ZLG.FS   ......\dir.C   ......\disk.C   ......\FAT.C   ......\Fat.h   ......\FDT.C   ......\file.C   ......\OSFile

    標(biāo)簽: FAT 12 16 32

    上傳時間: 2013-04-24

    上傳用戶:

  • H.264高清視頻編解碼系統(tǒng)中ARM控制模塊的軟件設(shè)計

    ·H.264高清視頻編解碼系統(tǒng)中ARM控制模塊的軟件設(shè)計

    標(biāo)簽: 264 ARM 高清視頻 編解碼

    上傳時間: 2013-07-22

    上傳用戶:wmwai1314

  • 可以在里面修改協(xié)議.主要是cmos---fpga--usb(68013a)中除68013a部分的程序

    可以在里面修改協(xié)議.主要是cmos---fpga--usb(68013a)中除68013a部分的程序

    標(biāo)簽: 68013a cmos fpga usb

    上傳時間: 2013-08-21

    上傳用戶:半熟1994

  • 自己現(xiàn)在用的CPLD下載線原理圖用74HC244芯片\r\n

    自己現(xiàn)在用的CPLD下載線,用74HC244芯片\r\n要注意設(shè)置下載模式

    標(biāo)簽: CPLD 244 74 HC

    上傳時間: 2013-08-31

    上傳用戶:dancnc

  • JPEG2000中嵌入式塊編碼的FPGA設(shè)計

    本論文主要論述JPEG2000中嵌入式塊編碼的FPGA設(shè)計,非常有參考價值

    標(biāo)簽: JPEG 2000 FPGA 嵌入式

    上傳時間: 2013-09-03

    上傳用戶:liuwei6419

  • 有關(guān)FPGA中狀態(tài)機(jī)開發(fā)的文章

    有關(guān)FPGA中狀態(tài)機(jī)開發(fā)的文章,內(nèi)容很經(jīng)典的,有開發(fā)例程。對硬件設(shè)計工程師比較有用

    標(biāo)簽: FPGA 狀態(tài)

    上傳時間: 2013-09-03

    上傳用戶:steveng

  • 從ORCAD的原理圖中導(dǎo)出元件庫的方法

    從ORCAD的原理圖中導(dǎo)出元件庫的方法.簡單有效。

    標(biāo)簽: ORCAD 原理圖 元件庫

    上傳時間: 2014-03-26

    上傳用戶:jelenecheung

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