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UART-FPGA

基于FPGA 的OFDM 寬帶數(shù)據(jù)通信同步系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

這是篇, 覺得甚是有用，大家共同學(xué)學(xué)。

標(biāo)簽： FPGA OFDM 寬帶數(shù)據(jù) 同步系統(tǒng)

上傳時(shí)間： 2013-08-31

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人民郵電出版社出版的《FPGA硬件接口設(shè)計(jì)實(shí)踐》一書的代碼

人民郵電出版社出版的《FPGA硬件接口設(shè)計(jì)實(shí)踐》一書的代碼。包括USB，PCI，I2C，UTRN，SPI等多種接口的VHDL代碼。

標(biāo)簽： FPGA 出版社代碼硬件

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FPGA 數(shù)字電路時(shí)序時(shí)延路徑建立時(shí)間保持時(shí)間

關(guān)鍵詞：FPGA 數(shù)字電路時(shí)序時(shí)延路徑建立時(shí)間保持時(shí)間

標(biāo)簽： FPGA 數(shù)字電路保持時(shí)序

上傳時(shí)間： 2013-08-31

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采用FPGA模擬高動態(tài)GPS信號源中的C／A碼產(chǎn)生器

本文：采用了FPGA方法來模擬高動態(tài)(Global Position System GPS)信號源中的C／A碼產(chǎn)生器。C／A碼在GPS中實(shí)現(xiàn)分址、衛(wèi)星信號粗捕和精碼(P碼)引導(dǎo)捕獲起著重要的作用，通過硬件描述語言VERILOG在ISE中實(shí)現(xiàn)電路生成，采用MODELSIM、SYNPLIFY工具分別進(jìn)行仿真和綜合。

標(biāo)簽： FPGA GPS 模擬動態(tài)

上傳時(shí)間： 2013-08-31

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FPGA-based_oscilloscope,VHDL寫的實(shí)現(xiàn) 示波器的程序

FPGA-based_oscilloscope,VHDL寫的實(shí)現(xiàn) 示波器的程序，及完整的工程描述文檔

標(biāo)簽： FPGA-based_oscilloscope VHDL 示波器程序

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一個(gè)fpga開發(fā)板的原理圖具有l(wèi)ed燈、ram、flash

一個(gè)fpga開發(fā)板的原理圖，此板具有l(wèi)ed燈、ram、flash

標(biāo)簽： flash fpga led ram

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EDA高手入門必看-FPGA-CPLD-開發(fā)流程

EDA高手入門必看，F(xiàn)PGA-CPLD-開發(fā)流程。

標(biāo)簽： FPGA-CPLD EDA 高手開發(fā)流程

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Median Filter 在FPGA中的實(shí)現(xiàn)

Median Filter 在FPGA中的實(shí)現(xiàn)

標(biāo)簽： Median Filter FPGA 中的實(shí)現(xiàn)

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FPGA-CPLD_DesignTool,事例程序3-4

FPGA-CPLD_DesignTool,事例程序3-4陸續(xù)上傳請需要的朋友下載

標(biāo)簽： FPGA-CPLD_DesignTool 程序

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DDS技術(shù)應(yīng)用于FPGA實(shí)現(xiàn)正弦波（周期信號）的產(chǎn)生

DDS技術(shù)應(yīng)用于FPGA實(shí)現(xiàn)正弦波（周期信號）的產(chǎn)生

標(biāo)簽： FPGA DDS 技術(shù)應(yīng)用周期信號

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