<pre id="mw6k2"></pre> 首先， 簡要介紹四足微型爬壁機器人的機構(gòu)部分， 然后詳細介紹四足微型爬壁機器人控制系統(tǒng)的 硬件設(shè)計， 以及實時多任務(wù)操作系統(tǒng) c／os—I I在Phi¨ P s公司32位ARM處理器LPC2
標簽： 2104 LPC 爬壁機器人 控制系統(tǒng)設(shè)計
上傳時間： 2013-06-28
上傳用戶：xuanjie
ADI將創(chuàng)新、業(yè)績和卓越作為企業(yè)的文化支柱，并基此成長為該技術(shù)領(lǐng)域最持久高速增長的企業(yè)之一。ADI公司是業(yè)界廣泛認可的數(shù)據(jù)轉(zhuǎn)換和信號處理技術(shù)全球領(lǐng)先的供應(yīng)商，擁有遍布世界各地的60,000客戶，涵蓋了全部類型的電子設(shè)備制造商。作為領(lǐng)先業(yè)界40多年的高性能模擬集成電路（IC）制造商，ADI的產(chǎn)品廣泛用于模擬信號和數(shù)字信號處理領(lǐng)域。公司總部設(shè)在美國馬薩諸塞州諾伍德市，設(shè)計和制造基地遍布全球。ADI公司的股票在紐約證券交易所上市，并被納入標準普爾500指數(shù)（S&P 500 Index ）。 ADI生產(chǎn)的數(shù)字信號處理芯片(DSP:Digital Singal Processor),代表系列有 ADSP Sharc 211xx (低端領(lǐng)域),ADSP TigerSharc 101,201,....(高端領(lǐng)域),ADSP Blackfin 系列(消費電子領(lǐng)域).
標簽： ADI
上傳時間： 2013-07-17
上傳用戶：小火車啦啦啦
本文介紹了一種基于AVR 單片機Atmel 169，與旋轉(zhuǎn)編碼器AS5040 及3966 控制直流電機構(gòu)成的電風扇360 度內(nèi)搖頭角度調(diào)節(jié)裝置的實現(xiàn)，設(shè)計了AS5040 旋轉(zhuǎn)編碼器接口電路、P
上傳時間： 2013-05-19
上傳用戶：cath
雷達顯控終端作為對雷達數(shù)據(jù)的直觀表述，是各種雷達系統(tǒng)中的重要組成部分。該文對Direct3D 和雷達顯示器進行介紹，并在此基礎(chǔ)上，提出一種新的基于VC++和Direct3D 的雷達P 型顯示器仿真模型
上傳時間： 2013-06-19
上傳用戶：
光纖布拉格光柵(Fiber Bragg Grating)傳感器是近幾年光纖傳感技術(shù)領(lǐng)域的研究熱點，光纖光柵傳感器可以工作在強電磁場、高溫有腐蝕性的以及有爆炸危險性的惡劣環(huán)境中，且易于將多個光纖光柵串聯(lián)在一起構(gòu)成光纖光柵陣列，實現(xiàn)分布式傳感，這是其他傳感元件所不及的。 本文設(shè)計了光纖光柵傳感網(wǎng)絡(luò)可調(diào)諧法布里-珀羅(Fabry-Perot)腔解調(diào)測試系統(tǒng)。系統(tǒng)主要分光路和電路兩部分，在光路部分，研究了光纖光柵解調(diào)技術(shù)，分析和比較了幾種常見的波長解調(diào)方法，由于F-P腔調(diào)諧范圍寬，可以實現(xiàn)多點測量，因此決定采用可調(diào)諧F．P腔法進行信號解調(diào)。對可調(diào)諧 F-P腔解調(diào)法做了理論分析和研究，并通過Matlab仿真對影響F-P濾波效果的腔長和反射率兩個參數(shù)進行了優(yōu)化設(shè)計。在電路部分，首先設(shè)計整形電路將光電探測器的輸出信號整形成矩形脈沖信號，設(shè)計了計算中心波長的方法，最后搭建了硬件電路來驗證中心波長的計算方法。硬件電路以 Philips公司的 LPC2214 為核心處理器。該硬件電路包括電源電路，復(fù)位電路，串口電路，JTAG 調(diào)試接口，數(shù)碼管顯示等。軟件方面，設(shè)計了相關(guān)的軟件程序和模擬信號源，最后利用模擬信號源作為該解調(diào)測試系統(tǒng)的信號進行實驗驗證，得出實驗數(shù)據(jù)，經(jīng)過分析驗證了該解調(diào)測試系統(tǒng)的可行性。
標簽： ARM 光纖光柵 傳感網(wǎng)絡(luò) 解調(diào)器
上傳時間： 2013-05-26
上傳用戶：hooooor
在利益的驅(qū)使下，超限運輸在世界各地已成為了普遍現(xiàn)象。這給國家?guī)砹酥T多經(jīng)濟和社會問題。實踐證明動態(tài)稱重系統(tǒng)（WIM）能有效地抑制超限運輸，但同時也存在部分問題，這些問題的解決有賴于國家相關(guān)法規(guī)的出臺，也有賴于關(guān)鍵測量設(shè)備（WIM系統(tǒng)）性能的提高。 由于應(yīng)變式稱重傳感器容易受到各種環(huán)境干擾，對環(huán)境適應(yīng)性差，課題采用光纖Bragg光柵傳感器(FBG)作為稱重傳感器，它具有很強的抗干擾性，利于提高系統(tǒng)測量精度。使用光纖傳感器的關(guān)鍵是波長解調(diào)技術(shù)，本文在比較了幾種常見解調(diào)技術(shù)的前提下，結(jié)合課題的實際情況選用了基于F-P腔可調(diào)諧濾波解調(diào)方法，文章在分析該解調(diào)方法原理的基礎(chǔ)上，設(shè)計了解調(diào)器中的各個硬件電路模塊；此外，為了提高數(shù)據(jù)采集、傳輸?shù)男剩恼逻€對數(shù)據(jù)緩沖電路進行了設(shè)計，在電路中引入了換體存儲及DMA傳輸技術(shù)。 鑒于動態(tài)稱重信號為短歷程信號并且包含各種各樣的噪聲，稱重算法的研究也是本課題要解決的重要內(nèi)容。本文在分析了稱臺振動及已有先驗知識的基礎(chǔ)上，將小波分析、LM非線性擬合算法及殘差分析相結(jié)合應(yīng)用在動態(tài)稱重系統(tǒng)中，為了驗證算法的有效性，利用MATLAB對實測數(shù)據(jù)進行了仿真分析，結(jié)果表明該算法能夠提高測量精度。 提高動態(tài)稱重系統(tǒng)性能指標的另一方面是提高系統(tǒng)運行的軟硬件平臺。課題采用的核心硬件為Xscale ARM平臺，處理器時鐘可高達400MHz；軟件上采用了多用戶、多任務(wù)的Linux操作系統(tǒng)平臺。文章對操作系統(tǒng)linux2.6進行了合適的配置，成功地將它移植到了課題的ARM平臺上，并且在此操作系統(tǒng)上設(shè)計了基于MiniGUI的人機交互界面及波長解調(diào)和數(shù)據(jù)緩沖電路的驅(qū)動程序。
標簽： ARM 光纖傳感技術(shù) 動態(tài)稱重 系統(tǒng)研究
上傳時間： 2013-07-26
上傳用戶：neibuzhuzu
加密算法一直在信息安全領(lǐng)域起著極其重要的作用,它直接影響著國家的安全和發(fā)展.隨著計算機技術(shù)的飛速發(fā)展,原有的數(shù)據(jù)加密標準(DES)已不能滿足人們的保密要求.在未來的20年內(nèi),高級數(shù)據(jù)加密標準(AES)將替代DES成為新的數(shù)據(jù)加密標準.在不對原有應(yīng)用系統(tǒng)作大的改動的情況下,3-DES算法有了很大的生存空間.該文介紹了DES和3-DES算法的概要,給出了一種電路實現(xiàn)模型,并基于XILINX公司的FPGA器件設(shè)計了IP核,介紹了I P核設(shè)計中主要模塊的設(shè)計方法.最后對該IP核進行了分析,給出它的性能參數(shù).該課題系統(tǒng)地論述了基3-DES算法的密碼IP核設(shè)計全過程.文章首先闡述了該設(shè)計的課題背景,給出了使用VHDL方法設(shè)計密碼電路的特點和研究思路和特點,然后對IP核的設(shè)計環(huán)境和密碼算法進行了介紹.在此基礎(chǔ)上,詳細討論了3-DES算法的密碼芯片設(shè)計方法和各個電路模塊實現(xiàn)的結(jié)構(gòu)圖,包括算法電路、譯碼電路、接口電路和控制模塊電路等.通過對各個模塊設(shè)計的介紹,闡明了使用VHDL語言設(shè)計專用集成電路的原理和特點.
上傳時間： 2013-04-24
上傳用戶：萌萌噠小森森
隨著安全通信數(shù)據(jù)速率的提高,關(guān)鍵數(shù)據(jù)加密算法的軟件實施成為重要的系統(tǒng)瓶頸.基于FPGA的高度優(yōu)化的可編程的硬件安全性解決方案提供了并行處理能力,并且可以達到所要求的加密處理性能(每秒的SSL或RSA運算次數(shù))基準.網(wǎng)絡(luò)的迅速發(fā)展,對安全性的需要變得越來越重要.然而,盡管網(wǎng)絡(luò)技術(shù)進步很快,安全性問題仍然相對落后.由于FPGA所提供的設(shè)計優(yōu)勢,特別是新的高速版本,網(wǎng)絡(luò)系統(tǒng)設(shè)計人員可以在這些網(wǎng)絡(luò)設(shè)備中經(jīng)濟地實現(xiàn)安全性支持.FPGA是實現(xiàn)設(shè)計靈活性和功能升級的關(guān)鍵,對于容錯、IPSec協(xié)議和系統(tǒng)接口問題而言這兩點非常重要.而且,FPGA還為網(wǎng)絡(luò)系統(tǒng)設(shè)計人員提供了適應(yīng)不同安全處理功能以及隨著安全技術(shù)的發(fā)展方便地增加對新技術(shù)支持的能力.標準加密/解決以及認證算法,如RC-4、DES、三次DES、MD-5以及安全哈希算法-1(SHA-1)被廣泛用于全球網(wǎng)絡(luò)安全系統(tǒng)中.本文介紹了基于PCI總線的加密卡的研制,硬件板卡的結(jié)構(gòu),著重論述了加密卡上加密模塊的實現(xiàn),即用FPGA實現(xiàn)3DES及IDEA、MD5算法的過程,加密卡的工作原理,加密卡中多種密碼算法的配置原理,最后對3DES算法及IDEA、MD5算法的實現(xiàn)進行仿真,并繪制了板卡的原理圖,對PCI接口原理進行了闡述.在論文中,首先闡述了數(shù)據(jù)加密原理.介紹了數(shù)據(jù)加密的算法和數(shù)據(jù)加密的技術(shù)發(fā)展趨勢,并重點說明了3DES的算法.由于加密卡的生存空間在于其高速的加密性能與便捷的使用方式,所以,我們的加密卡采用的是基于PCI插槽的結(jié)構(gòu),遵從的是PCI2.2規(guī)范,理解并掌握PCI總線的規(guī)范是了解整個系統(tǒng)的重要一環(huán),本文講述了PCI總線的特點和性能,以及總線的信號.由于遵從高速性的要求,我們在硬件選型的時候,選用的是TI公司高速DSP T M S 3 2 0 C 5 4 x:T I公司新推出的T M S 3 2 0 C 6 x系列D S P功能強,速度也非常快,但目前價格仍然太高,不適合一般加解密使用.而TMS3 2 0 C 5 4 x系列具有性能適中,價格低廉,產(chǎn)品成熟等特點,是較好的選擇.FPGA選用的XILINX公司的XC2V3000,在隨后的文章中,我們將會對這些器件特性做相應(yīng)說明.并由此得出電路原理圖的繪制.文章的重點之一在于3DES算法及IDEA、MD5算法的FPGA實現(xiàn),以Xilinx公司VIRTEXII結(jié)構(gòu)的VXC2V3000為例,闡述用FPGA高速實現(xiàn)3DES算法及IDEA、MD5算法的設(shè)計要點及關(guān)鍵部分的設(shè)計.
上傳時間： 2013-04-24
上傳用戶：qazwsc
近年來，隨著網(wǎng)絡(luò)技術(shù)的發(fā)展和視頻編碼標準受到廣泛接受，視頻點播、視頻流和遠程教育等基于網(wǎng)絡(luò)的多媒體業(yè)務(wù)逐漸普及。為了對擁有不同終端資源，不同接入網(wǎng)絡(luò)以及不同興趣的用戶提供靈活的多媒體數(shù)據(jù)訪問服務(wù)，多媒體數(shù)據(jù)的內(nèi)容需要根據(jù)應(yīng)用環(huán)境動態(tài)調(diào)整，轉(zhuǎn)碼正是實現(xiàn)這一挑戰(zhàn)性任務(wù)的關(guān)鍵技術(shù)之一。 視頻轉(zhuǎn)碼對時間的要求非常苛刻，以至于用高速的通用微處理器芯片也無法在規(guī)定的時間內(nèi)完成必要的運算。因此，必須為這樣的運算設(shè)計一個專用的高速硬線邏輯電路，在高速FPGA器件上實現(xiàn)或制成高速專用集成電路。用高密度的FPGA來構(gòu)成完成轉(zhuǎn)碼算法所需的電路系統(tǒng)，實現(xiàn)專用集成電路的功能，因其成本低、設(shè)計周期短、功耗小、可靠性高、使用靈活等優(yōu)點而成為適合本課題的最佳選擇。 本文根據(jù)MPEG-2中可變長編碼(VLC)理論，采用了兩級查找表減少了VLC存儲空間的使用，完成VLC編碼的實現(xiàn)。根據(jù)MPEG-2中關(guān)于System Packet的定義，針對FPGA可實現(xiàn)性，以空間換取復(fù)雜度的減少，實現(xiàn)了PES包的打包模塊。根據(jù)MPEG-2相應(yīng)的轉(zhuǎn)碼理論，完成了對系統(tǒng)解碼模塊相應(yīng)的連接和調(diào)試，對解碼模塊以真實的bit流進行了貼近板級的情況的仿真。根據(jù)MPEG-2中TM5的算法的局限性，分析得出只需要對P幀進行相應(yīng)處理即可改進場景變換對視頻質(zhì)量的影響，完成對TM5的算法的改進。通過性能估算和電路仿真，各模塊的吞吐率能夠滿足轉(zhuǎn)碼系統(tǒng)的要求。
上傳時間： 2013-07-22
上傳用戶：shinesyh
隨著集成電路的設(shè)計規(guī)模越來越大，F(xiàn)PGA為了滿足這種設(shè)計需求，其規(guī)模也越做越大，傳統(tǒng)平面結(jié)構(gòu)的FPGA無法滿足實際設(shè)計需求。首先是硬件設(shè)計上的很難控制，其次就是計算機軟件面臨很大挑戰(zhàn)，所有復(fù)雜問題全部集中到布局布線(P&R)這一步，而實際軟件處理過程中，P&R所占的時間比例是相當大的。為了緩解這種軟件和硬件的設(shè)計壓力，多層次化結(jié)構(gòu)的FPGA得以采用。所謂層次化就是可配置邏輯單元內(nèi)部包含多個邏輯單元(相對于傳統(tǒng)的單一邏輯單元)，并且內(nèi)部的邏輯單元之間共享連線資源，這種結(jié)構(gòu)有利于減少芯片面積和提高布通率。與此同時，F(xiàn)PGA的EDA設(shè)計流程也多了一步，那就是在工藝映射和布局之間增加了基本邏輯單元的裝箱步驟，該步驟既可以認為是工藝映射的后處理，也可認為是布局和布線模塊的預(yù)處理，這一步不僅需要考慮打包，還要考慮布線資源的問題。裝箱作為連接軟件前端和后端之間的橋梁，該步驟對FPGA的性能影響是相當大的。 本文通過研究和分析影響芯片步通率的各種因素，提出新的FPGA裝箱算法，可以同時減少裝箱后可配置邏輯單元(CLB)外部的線網(wǎng)數(shù)和外部使用的引腳數(shù)，從而達到減少布線所需的通道數(shù)。該算法和以前的算法相比較，無論從面積，還是通道數(shù)方面都有一定的改進。算法的時間復(fù)雜度仍然是線性的。與此同時本文還對FPGA的可配置邏輯單元內(nèi)部連線資源做了分析，如何設(shè)計可配置邏輯單元內(nèi)部的連線資源來達到即減少面積又保證芯片的步通率，同時還可以提高運行速度。 另外，本文還提出將電路分解成為多塊，分別下載到各個芯片的解決方案。以解決FPGA由于容量限制，而無法實現(xiàn)某些特定電路原型驗證。該算法綜合考慮影響多塊芯片性能的各個因數(shù)，采用較好的目標函數(shù)來達到較優(yōu)結(jié)果。
上傳時間： 2013-04-24
上傳用戶：zhaoq123
蟲蟲下載站版權(quán)所有 京ICP備2021023401號-1
<dl id="82oam"></dl>