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SoC-wishbone

該算法能自適應(yīng)地完成SOC中軟硬件劃分問(wèn)題

該算法能自適應(yīng)地完成SOC中軟硬件劃分問(wèn)題，且效果很好。

標(biāo)簽： SOC 算法分軟硬件

上傳時(shí)間： 2013-12-26

上傳用戶(hù)：xlcky
zigbee開(kāi)發(fā)的最佳選擇平臺(tái).陳工科技提供的開(kāi)發(fā)板,軟件使用說(shuō)明.主芯片是使用jennic的SOC zigbee芯片.

zigbee開(kāi)發(fā)的最佳選擇平臺(tái).陳工科技提供的開(kāi)發(fā)板,軟件使用說(shuō)明.主芯片是使用jennic的SOC zigbee芯片.

標(biāo)簽： zigbee jennic SOC 芯片

上傳時(shí)間： 2013-12-29

上傳用戶(hù)：515414293
samsung最近推出的s3c2443 soc芯片的完整測(cè)試代碼(官方),外圍設(shè)備包括ADC,Audio,Timer,RTC,WDT,Video,cs8900,IIC,SPI,CF,SD/MMC,以及

samsung最近推出的s3c2443 soc芯片的完整測(cè)試代碼(官方),外圍設(shè)備包括ADC,Audio,Timer,RTC,WDT,Video,cs8900,IIC,SPI,CF,SD/MMC,以及系統(tǒng)的DMA,PLL,Power等.對(duì)需要寫(xiě)soc芯片底層驅(qū)動(dòng)的朋友比較有幫助

標(biāo)簽： samsung s3c2443 Audio Timer

上傳時(shí)間： 2014-01-17

上傳用戶(hù)：thuyenvinh
samsung推出的s3c2410 soc(可以說(shuō)是公板)芯片的完整測(cè)試代碼(官方),外圍設(shè)備包括ADC,Timer,RTC,IIC,IIS,SPI以及系統(tǒng)的DMA,PLL,Power等.對(duì)需要寫(xiě)so

samsung推出的s3c2410 soc(可以說(shuō)是公板)芯片的完整測(cè)試代碼(官方),外圍設(shè)備包括ADC,Timer,RTC,IIC,IIS,SPI以及系統(tǒng)的DMA,PLL,Power等.對(duì)需要寫(xiě)soc芯片底層驅(qū)動(dòng)的朋友比較有幫助

標(biāo)簽： samsung s3c2410 Timer Power

上傳時(shí)間： 2013-12-18

上傳用戶(hù)：lyy1234
microblaze.pdf 介紹soc的一個(gè)入門(mén)教程

microblaze.pdf 介紹soc的一個(gè)入門(mén)教程

標(biāo)簽： microblaze soc 入門(mén)教程

上傳時(shí)間： 2014-01-18

上傳用戶(hù)：BOBOniu
西安交大SOC設(shè)計(jì)中心的Synplifypro FPGA綜合工具經(jīng)典教程.

西安交大SOC設(shè)計(jì)中心的Synplifypro FPGA綜合工具經(jīng)典教程.

標(biāo)簽： Synplifypro FPGA SOC 教程

上傳時(shí)間： 2015-11-05

上傳用戶(hù)：zhangjinzj
free hardware ip core about sparcv8,a soc cpu in vhdl

free hardware ip core about sparcv8,a soc cpu in vhdl

標(biāo)簽： hardware sparcv about free

上傳時(shí)間： 2015-11-10

上傳用戶(hù)：xsnjzljj
直接數(shù)字式頻率合成器(DDS)設(shè)計(jì)實(shí)驗(yàn)(電子設(shè)計(jì)競(jìng)賽賽題) 其它詳細(xì)資料說(shuō)明請(qǐng)參考 http://www.kx-soc.com

直接數(shù)字式頻率合成器(DDS)設(shè)計(jì)實(shí)驗(yàn)(電子設(shè)計(jì)競(jìng)賽賽題) 其它詳細(xì)資料說(shuō)明請(qǐng)參考 http://www.kx-soc.com

標(biāo)簽： kx-soc http DDS com

上傳時(shí)間： 2013-12-26

上傳用戶(hù)：牛津鞋
The GRLIB IP Library is an integrated set of reusable IP cores, designed for system-on-chip (SOC) d

The GRLIB IP Library is an integrated set of reusable IP cores, designed for system-on-chip (SOC) development. The IP cores are centered around a common on-chip bus, and use a coherent method for simulation and synthesis. The library is vendor independent, with support for different CAD tools and target technologies. A unique plug&play method is used to configure and connect the IP cores without the need to modify any global resources.

標(biāo)簽： system-on-chip integrated designed reusable

上傳時(shí)間： 2015-11-17

上傳用戶(hù)：D&L37
LEON3 SOC GRlip IP core. Memory controller.

LEON3 SOC GRlip IP core. Memory controller.

標(biāo)簽： controller Memory LEON3 GRlip

上傳時(shí)間： 2015-11-17

上傳用戶(hù)：wcl168881111111

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