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SoC-wishbone

  • MDIO Verilog RTL代碼,SOC可以通過MDIO接口來訪問外部PHY等慢速外設

    MDIO Verilog RTL代碼,SOC可以通過MDIO接口來訪問外部PHY等慢速外設

    標簽: verilog soc 接口

    上傳時間: 2022-06-26

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  • SW6208/06全協議快充22.5W移動電源SOC

    珠海智融SW6208/06全協議快充22.5W移動電源SOC

    標簽: 快速充電 移動電源

    上傳時間: 2022-07-04

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  • 基于自適應卡爾曼濾波的鋰離子電池SOC估計

    基于自適應卡爾曼濾波的鋰離子電池SOC估計               

    標簽: 卡爾曼濾波 鋰離子電池 soc

    上傳時間: 2022-07-06

    上傳用戶:slq1234567890

  • ARM,DSP,FPGA,CPLD,SOPC,SOC之間有什么區別和聯系

    ARM,DSP,FPGA,CPLD,SOPC,SOC之間有什么區別和聯系                                         

    標簽: arm dsp fpga cpld sopc soc

    上傳時間: 2022-07-08

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  • BMS系統均衡及SOC簡介

    BMS系統均衡及SOC簡介                    

    標簽: bms soc

    上傳時間: 2022-07-09

    上傳用戶:kent

  • soc與ad9361的軟件無線電射頻收發機

    本文將會描述一個基于S0C和AD9361的一個較完整的軟件無線電收發系統,論文講述的系統最主要的由兩個部分組成:集成了ARM和FPGA的片上系統(SOC)以及將射頻前端集成到一起的射頻捷變收發器AD9361芯片,這兩部分是該系統的核心部分。論文完成了對系統的理論研究、設計搭建和應用的驗證,主要內容為:第一、分析研究了軟件無線電技術的發展和現狀,討論了這一綜合技術所用到的重要技術,并結合本系統對設計一個完整的軟件無線電系統做了分析和總結。第二、將本文主要講述的軟件無線電系統按照SOC和AD9361兩個部分,分別做了詳細的講解。完成了整個系統的搭建,包括硬件、軟件和操作系統的搭建,并將每一步做了詳細的介紹。第三、將搭建好的系統進行了實踐操作,驗證了系統對無線信號的接收和發射等基本功能。用數學工具MATLAB對波形和濾波器做了設計,并通過信號的波形驗證了設計的正確性。最后根據一個設計要求將系統創新性的用在了調頻廣播信號處理上,并依照設計要求場合對完成的系統進行了功能的驗證,解決了調頻廣播信號的隧道內覆蓋的問題。

    標簽: soc ad9361 軟件無線電 射頻收發機

    上傳時間: 2022-07-11

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  • 基于LabVIEW和SOPC的智能型函數發生器的研究與設計.rar

    函數發生器又名任意波形發生器,是一種常用的信號源,廣泛應用于通信、雷達、導航等現代電子技術領域。信號發生器的核心技術是頻率合成技術,主要方法有:直接模擬頻率合成、鎖相環頻率合成(PLL)、直接數字合成技術(DDS)。DDS是開環系統,無反饋環節,輸出響應速度快,頻率穩定度高。因此直接數字頻率合成技術是目前頻率合成的主要技術之一,其輸出信號具有相對較大的帶寬、快速的相位捷變、極高的相位分辨率和相位連續等優點。本文的主要工作是采用SOPC結合虛擬儀器技術,進行DDS智能函數發生器的研制。 本文介紹了虛擬儀器技術的基本理論,簡要闡述了儀器驅動程序、VISA等相關技術。對SOPC技術進行了深入的研究:SOPC技術是基于可編程邏輯器件的可重構片上系統,它作為SOC和CPLD/FPGA相結合的一項綜合技術,結合了兩者的優點,集成了硬核或軟核CPU、DSP、鎖相環、存儲器、I/O接口及可編程邏輯,可以靈活高效地解決SOC方案,而且設計周期短,設計成本低,非常適合本設計的應用。本文還對基于DDS原理的設計方案進行了分析,介紹了DDS的基本理論以及數學綜合,在研究DDS原理的基礎上,利用SOPC技術,在一片FPGA芯片上實現了整個函數發生器的硬件集成。 本文就函數發生器的設計制定了整體方案,對軟硬件設計原理及實現方法進行了具體的介紹,包括整個系統的硬件電路,SOPC片上系統和PC端軟件的設計。在設計中,LabVIEW波形編輯軟件和函數發生器二者采用異步串口進行通信。利用LabVIEW的強大功能,把波形的編輯,系統的設置放到計算機上完 成,具有人機界面友好、系統升級方便、節約硬件成本等諸多優勢。同時充分利用了FPGA內部大量的邏輯資源,將DDS模塊和微處理器模塊集成到一個單片FPGA上,改變了傳統的系統設計思路。通過對系統仿真和實際測試,結果表明該智能型函數發生器不僅能產生理想的輸出信號,還具有集成度高、穩定性好和擴展性強等優點。關鍵詞:智能型函數發生器,虛擬儀器,可編程片上系統,直接數字合成技術,NiosⅡ處理器。

    標簽: LabVIEW SOPC 智能型

    上傳時間: 2013-07-09

    上傳用戶:zw380105939

  • 純電動汽車電池管理系統的研究.rar

    隨著社會的發展以及能源、環保等問題的日益突出,純電動汽車以其零排放,噪聲低等優點越來越受到世界各國的重視,被稱作綠色環保車。作為發展電動車的關鍵技術之一的電池管理系統(BMS),是電動車產業化的關鍵。本課題配合“基于開關磁阻電機的電動汽車的研制”,研制適用于純電動汽車的電池管理系統。 電池管理系統直接檢測及管理電動汽車的儲能電池運行的全過程,包括電池基本信息測量、電量估計、單體電池間的均衡、電池故障診斷幾個方面。 本論文主要工作是研制適用于純電動汽車的蓄電池管理系統。研究鉛酸蓄電池二階模型的建立與剩余容量的卡爾曼濾波估算方法。分析鉛酸蓄電池的基本工作原理和影響蓄電池組剩余容量SOC(state of charge)的主要因素。 介紹了基于DSP2407的蓄電池組控制器的硬件平臺,完成DSP小系統、電池數據采集電路、信號調理電路、CAN總線相關電路等硬件電路設計、調試、完善。獨立完成系統所有軟件設計,包括:主程序設計,電池基本信息檢測子程序設計,電池剩余電量卡爾曼濾波估算程序設計,電池狀態檢測子程序設計,CAN收發子程序設計,EEPROM讀寫子程序設計。 最后,在電動汽車上搭建實驗平臺,將鉛酸蓄電池組與設計的軟硬件系統聯合進行調試、試驗。測得了相關數據。試驗結果表明,本文介紹的電池管理系統硬件電路可靠、經濟、抗干擾能力強。可以實現:電池電壓、電流、溫度的模擬量采集;剩余電量的計算和電池狀態的判斷;實時顯示,故障時報警等BMS相關功能。

    標簽: 純電動汽車 電池管理系統

    上傳時間: 2013-06-11

    上傳用戶:hustfanenze

  • 20kW車用鉛酸電池智能管理系統.rar

    環境的不斷污染、石油能源的加劇消耗促使純電動車成為了各國各汽車廠商爭相研究的對象。而閥控免維護鉛酸蓄電池(VRLA)憑著其低廉的價格優勢占據了車用蓄電池的大部分市場份額。本文旨在開發一套完整的VRLA蓄電池管理系統,包括蓄電池狀態檢測、均衡充放電管理、溫度管理、充放電管理等。 本文首先討論了車用VRLA蓄電池的特性,包括其失效模式、改進方式以及各種充電方法對其物理上的影響。隨后,針對VRLA車用蓄電池,本文著重討論了電動汽車蓄電池的智能管理系統,第三章到第四章詳細介紹了裝載車內的管理系統(檢測系統、均衡系統);第五章著重討論了置于車外的充放電管理系統的設計和實現。 狀態檢測系統系統主要包括電池狀態采集系統以及剩余容量SoC、健康狀態SoH測量系統。本文針對電動汽車這個特殊應用場合,提出了一種新的同時基于AH定律、Peukert方程、溫度修正、SoH以及開路電壓的的容量預測方法。 均衡充電系統的目的是保持串聯電池組單體電池容量的均衡。均衡管理系統主要包括控制器、開關組件以及輔助均衡充電器三個部分。 主充電系統采用的是正負脈沖的充電方式,本系統通過一個全橋雙向DC/DC變流器來實現。主充電器的功率等級為20kW,在本課題組中,這個功率等級較之以往有較大的突破。

    標簽: 20 kW 車用

    上傳時間: 2013-04-24

    上傳用戶:飛翔的胸毛

  • 基于FPGA動態重構的故障容錯技術.rar

    可重構計算技術兼具通用處理器(General-Purpose Processor,GPP)和專用集成電路(Application Specific Integr—ated Circuits,ASIC)的特點,既可以提供硬件高速的特性,又具有軟件可以重新配置的特性。而動態部分可重構技術是可重構計算技術的最新進展之一。該技術的要點就是在系統正常工作的情況下,修改部分模塊的功能,而系統其它模塊能夠照常運行,這樣既節約硬件資源,又增強了系統靈活性。 可重構SoC既可以在處理器上進行編程又可以改變FPGA內部的硬件結構,這使得SoC系統既具有處理器善于控制和運算的特點,又具FPGA靈活的重構特點;由于處理器和FPGA硬件是在同一塊硅片上,使得它們之間的通信寬帶大大提高,這種平臺很適合于容錯算法的實現。 本文基于863計劃項目;動態重構計算機的可信實現關鍵技術,重點研究應用于惡劣環境中FPGA自我容錯的體系結構,提出了一套完整的SoC系統的容錯設計方案,并研究其實現技術,設計實現了實現該技術的硬件平臺和軟件算法,并驗證成功。 論文取得了如下的創新性研究成果: 1、設計了實現動態重構技術的硬件平臺,包括高性能的FPGA(內含入式處理器PowcrPC)、PROM、SRAM、FLASH、串口通信等硬件模塊。 2、說明了動態重構技術的設計規范和設計流程,實現動態重構技術。 3、提出了一種基于動態重構實現容錯的方法,不需要外部處理器干預,由嵌入式處理器負責管理整個過程。 4、設計并實現了嵌入式處理器運行時需要的軟件,主要有兩個功能,首先是從CF卡中讀入重構所需的配置文件,并將配置文件寫進FPGA內部的配置存儲器中,改變FPGA內部的功能。其次,是實現容錯技術的算法。

    標簽: FPGA 動態 容錯技術

    上傳時間: 2013-04-24

    上傳用戶:edrtbme

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