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SdrAM

同步動態(tài)隨機(jī)存取內(nèi)存（synchronousdynamicrandom-accessmemory，簡稱SdrAM）是有一個同步接口的動態(tài)隨機(jī)存取內(nèi)存（DRAM）。通常DRAM是有一個異步接口的，這樣它可以隨時響應(yīng)控制輸入的變化。而SdrAM有一個同步接口，在響應(yīng)控制輸入前會等待一個時鐘信號，這樣就能和計(jì)算機(jī)的系統(tǒng)總線同步。時鐘被用來驅(qū)動一個有限狀態(tài)機(jī)，對進(jìn)入的指令進(jìn)行管線(Pipeline)操作。這使得SdrAM與沒有同步接口的異步DRAM(asynchronouSdrAM)相比，可以有一個更復(fù)雜的操作模式。

清華大學(xué)－電子信息工程系－實(shí)驗(yàn)用ARM-linux－源代碼－SdrAM篇

清華大學(xué)－電子信息工程系－實(shí)驗(yàn)用ARM-linux－源代碼－SdrAM篇

標(biāo)簽： ARM-linux SdrAM 清華大學(xué) 實(shí)驗(yàn)

上傳時間： 2014-01-02

上傳用戶：維子哥哥
verilog hdl coding DDR SdrAM control for fpga

verilog hdl coding DDR SdrAM control for fpga

標(biāo)簽： verilog control coding SdrAM

上傳時間： 2013-12-17

上傳用戶：wangchong
Hynix公司8M byte sdr SdrAM的verilog語言仿真實(shí)現(xiàn)。

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標(biāo)簽： verilog Hynix SdrAM byte

上傳時間： 2014-12-04

上傳用戶：h886166
將SdrAM中數(shù)據(jù)通過DMA送至UART,可以通過串口助手查看數(shù)據(jù).

將SdrAM中數(shù)據(jù)通過DMA送至UART,可以通過串口助手查看數(shù)據(jù).

標(biāo)簽： SdrAM UART DMA 數(shù)據(jù)

上傳時間： 2015-12-17

上傳用戶：1583060504
已經(jīng)成功的FPGA 控制的SdrAM控制器代碼.只要修改你需要的寬度就可以了.

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標(biāo)簽： SdrAM FPGA 控制代碼

上傳時間： 2013-12-14

上傳用戶：sunjet
SdrAM的控制器 verilog源碼

SdrAM的控制器 verilog源碼

標(biāo)簽： verilog SdrAM 控制器源碼

上傳時間： 2014-01-13

上傳用戶：aappkkee
FPGA連接SdrAM的源程序

FPGA連接SdrAM的源程序，VHDL語言實(shí)現(xiàn)，功能基本完全。應(yīng)用效果好。

標(biāo)簽： SdrAM FPGA 連接源程序

上傳時間： 2013-12-17

上傳用戶：頂?shù)弥?/p>
tms320c6000的dsp以edma方式從SdrAM讀數(shù)

tms320c6000的dsp以edma方式從SdrAM讀數(shù)，

標(biāo)簽： c6000 SdrAM 320c 6000

上傳時間： 2014-01-20

上傳用戶：lijianyu172
usb-jtag轉(zhuǎn)換,sparc芯片反匯編,sparc芯片調(diào)試的工具,可以對芯片內(nèi)的gpio,SdrAM,flash進(jìn)行讀寫,還可以一次下載64K大小的數(shù)據(jù),反匯編,在線調(diào)試.

usb-jtag轉(zhuǎn)換,sparc芯片反匯編,sparc芯片調(diào)試的工具,可以對芯片內(nèi)的gpio,SdrAM,flash進(jìn)行讀寫,還可以一次下載64K大小的數(shù)據(jù),反匯編,在線調(diào)試.

標(biāo)簽： sparc usb-jtag flash SdrAM

上傳時間： 2016-01-11

上傳用戶：阿四AIR
對芯片ti6713的存儲器的存儲初時化程序。包括SdrAM和flash存儲器。能夠?qū)崿F(xiàn)高所存儲數(shù)據(jù)功能。

對芯片ti6713的存儲器的存儲初時化程序。包括SdrAM和flash存儲器。能夠?qū)崿F(xiàn)高所存儲數(shù)據(jù)功能。

標(biāo)簽： SdrAM flash 6713 存儲器

上傳時間： 2014-01-17

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SdrAM

清華大學(xué)－電子信息工程系－實(shí)驗(yàn)用ARM-linux－源代碼－SdrAM篇

verilog hdl coding DDR SdrAM control for fpga

Hynix公司8M byte sdr SdrAM的verilog語言仿真實(shí)現(xiàn)。

將SdrAM中數(shù)據(jù)通過DMA送至UART,可以通過串口助手查看數(shù)據(jù).

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SdrAM的控制器 verilog源碼

FPGA連接SdrAM的源程序

tms320c6000的dsp以edma方式從SdrAM讀數(shù)

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對芯片ti6713的存儲器的存儲初時化程序。包括SdrAM和flash存儲器。能夠?qū)崿F(xiàn)高所存儲數(shù)據(jù)功能。