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SRAM-IP-CORE

  • 在測控系統(tǒng)中用IP核實現(xiàn)DA轉(zhuǎn)換

    在測控系統(tǒng)中用IP核實現(xiàn)DA轉(zhuǎn)換.doc

    標簽: 測控系統(tǒng) IP核 DA轉(zhuǎn)換

    上傳時間: 2013-08-13

    上傳用戶:13736136189

  • Altera cyclone ep1c6對sram idt71系列的讀寫時序控制

    Altera cyclone ep1c6對sram idt71系列的讀寫時序控制

    標簽: cyclone Altera ep1c6 sram

    上傳時間: 2013-08-16

    上傳用戶:13681659100

  • FPGA系統(tǒng)的sram的軟仿真設(shè)計

    FPGA系統(tǒng)的sram的軟仿真設(shè)計,可以實現(xiàn)按位寫,按位讀。

    標簽: FPGA sram 仿真設(shè)計

    上傳時間: 2013-08-23

    上傳用戶:wsq921779565

  • arm9_fpga2_verilog是一個可以綜合的用verilog寫的arm9的ip軟核

    arm9_fpga2_verilog是一個可以綜合的用verilog寫的arm9的ip軟核,對學(xué)習(xí)arm和FPGA開發(fā)有幫助。

    標簽: verilog fpga arm9 arm

    上傳時間: 2013-08-23

    上傳用戶:xlcky

  • 一個UART的FPGA core

    一個UART的FPGA core,附有詳細的代碼閱讀筆記

    標簽: UART FPGA core

    上傳時間: 2013-08-24

    上傳用戶:stella2015

  • FPGA向SRAM中寫入數(shù)據(jù)

    FPGA向SRAM中寫入數(shù)據(jù),VHDL編程

    標簽: FPGA SRAM 數(shù)據(jù)

    上傳時間: 2013-08-28

    上傳用戶:zhliu007

  • FPGA將從CY7C68013讀到的數(shù)寫入SRAM

    FPGA將從CY7C68013讀到的數(shù)寫入SRAM

    標簽: C68013 68013 FPGA SRAM

    上傳時間: 2013-08-29

    上傳用戶:lijianyu172

  • FPGA讀SRAM中的數(shù)再傳給CY7C68013

    FPGA讀SRAM中的數(shù)再傳給CY7C68013

    標簽: C68013 68013 FPGA SRAM

    上傳時間: 2013-08-30

    上傳用戶:15070202241

  • FPGA的一些常識及含IP核的VHDL設(shè)計源代碼

    關(guān)于FPGA的一些常識及含IP核的VHDL設(shè)計源代碼。

    標簽: FPGA VHDL 常識 IP核

    上傳時間: 2013-09-03

    上傳用戶:tsfh

  • 充分利用IP以及拓撲規(guī)劃提高PCB設(shè)計效率

    本文探討的重點是PCB設(shè)計人員利用IP,并進一步采用拓撲規(guī)劃和布線工具來支持IP,快速完成整個PCB設(shè)計。從圖1可以看出,設(shè)計工程師的職責(zé)是通過布局少量必要元件、并在這些元件之間規(guī)劃關(guān)鍵互連路徑來獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設(shè)計人員,由他們完成剩余的設(shè)計。 圖1:設(shè)計工程師獲取IP,PCB設(shè)計人員進一步采用拓撲規(guī)劃和布線工具支持IP,快速完成整個PCB設(shè)計。現(xiàn)在無需再通過設(shè)計工程師和PCB設(shè)計人員之間的交互和反復(fù)過程來獲取正確的設(shè)計意圖,設(shè)計工程師已經(jīng)獲取這些信息,并且結(jié)果相當精確,這對PCB設(shè)計人員來說幫助很大。在很多設(shè)計中,設(shè)計工程師和PCB設(shè)計人員要進行交互式布局和布線,這會消耗雙方許多寶貴的時間。從以往的經(jīng)歷來看交互操作是必要的,但很耗時間,且效率低下。設(shè)計工程師提供的最初規(guī)劃可能只是一個手工繪圖,沒有適當比例的元件、總線寬度或引腳輸出提示。隨著PCB設(shè)計人員參與到設(shè)計中來,雖然采用拓撲規(guī)劃技術(shù)的工程師可以獲取某些元件的布局和互連,不過,這個設(shè)計可能還需要布局其它元件、獲取其它IO及總線結(jié)構(gòu)和所有互連才能完成。PCB設(shè)計人員需要采用拓撲規(guī)劃,并與經(jīng)過布局的和尚未布局的元件進行交互,這樣做可以形成最佳的布局和交互規(guī)劃,從而提高PCB設(shè)計效率。隨著關(guān)鍵區(qū)域和高密區(qū)域布局完成及拓撲規(guī)劃被獲取,布局可能先于最終拓撲規(guī)劃完成。因此,一些拓撲路徑可能必須與現(xiàn)有布局一起工作。雖然它們的優(yōu)先級較低,但仍需要進行連接。因而一部分規(guī)劃圍繞布局后的元件產(chǎn)生了。此外,這一級規(guī)劃可能需要更多細節(jié)來為其它信號提供必要的優(yōu)先級。

    標簽: PCB 利用IP 拓撲規(guī)劃

    上傳時間: 2013-10-12

    上傳用戶:sjyy1001

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